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第一部份 电子电路软件仿真我们用来做模拟实验的软件是EWB（Electonics Workbench）,其工作界面如图在C盘中点击EWB，而后点击WEWB32即可得上述工作界面，下述的几个仿真实验全部在此平台上实现。实验一串联谐振一、实验目的1测定串联谐振电路的谐振频率，并比较测量值与计算值。2.测定串联谐振电路的带宽，并比较测量值与计算值。3.测定串联谐振电路的品质因数。4.测定串联谐振电路的谐振阻抗。5.测定串联谐振电路谐振时电压与电流之间的相位关系。6.研究电路电阻变化时对串联谐振电路的谐振频率和带宽的影响。二、实验器材信号发生器1台双踪示波器1台100mH电感1个0.25F1个1K电阻1个三、实验准备在图1-1、图1-2所示的电路中，信号频率为串联谐振电路的谐振频率时感抗等于容抗因为感抗与容抗有的相位差，所以在谐振率上总电抗为零，这时总阻抗最小，并且等于电路电阻。在谐振频率上电路电流I最大，因此 由此可求得谐振频率在图1-1和图1-2所示的电路中，串联谐振电路的带度BW可从频率特性曲线图通过测量低端频率和高端频率来确定，在这两点上电流下降为峰值的0.707倍（-3dB）。因此，带宽为 带宽也可由电路元件值来计算 品质因数可反映谐振电路的带宽与谐振频率之间的关系。品质因数越高，则带宽越窄。品质因数可用下式计算 图1-1 串联谐振在谐振频率上，因为感抗与容抗相等，总电抗为零，总阻为纯电阻性，所以谐振时电路的电压与电流同相。做这个实验要使用波特图仪，可参考电子工作平台的仪器菜单。图1-2 串联谐振的频率特性曲线四、实验步骤1电子工作平台上建立如图1-1所示的验电路。单击仿真开关进行动态分析。在表1-1中记录相应频率的节点电压和。表1-1100300700100030004000100002按表1-1改变信号发生器的频率，运行动态分析，记录每种频率的峰值电压和必要时可调整示波器。3据表1-1中的每个值及图1-1所示电路的值，计算每种频率的电流，并将结果记录到表中。4画出电流随频率变化的曲线图，频率用对数刻度。10I/mA.Z/K /K8I/mA.Z/K /K64 2 /Hz/Hz100 200 500 1K 2K 5K 10K5根据步骤4的曲线图，测定串联谐振电路的谐和振频率。6根据图1-1中的元件值，计算串联谐振电路的谐振频率。7根据步骤4的曲线图，测定串联谐振电路的带宽。8根据图1-1中的元件值，计算串联谐振电路的带宽。9根据步骤7中测量的带宽和步骤5中测量的谐振频率，计算这个串联谐振电路的品质因数。10根据表1-1中的值和值，计算每种频率对应的串联谐振电路阻抗，将结果记录到表中。11作出串联电路阻抗随频率变化的曲线图，频率用对数刻度。12根据图1-1中的电路元件值，计算串联谐振电路的谐振阻抗。13将信号发生器的频率调整为谐振频率，记录电压与电流之间的相位差，必要时可调整示波器的有关参数。14在电子工作平台上建立如图1-2所示的实验电路。单击仿真开关进行动态分析。波特图仪将图示串联谐振电路的电流与频率之间的函数关系。在纵轴上每个刻度代10mA从曲线图测量并记录谐振频率和带宽。15将电阻改为，重复步骤14，必要时可改变波特图仪的设置。五、思考与分析1步骤6中谐振频率的计算值与曲线测定值比较，情况如何？2步骤8中带宽的计算值与曲线测定值比较，情况如何？3根据步骤11中的曲线图，对串联谐振电路的阻抗随频率的变化情况可得出什么结论？4步骤12中算得的谐振阻抗与表1-1中记录的谐振阻抗比较，情况如何？5在步骤13中，对谐振时电压与电流的相位差可得出什么结论？6在步骤15中，关于电阻值的变化对谐振频率和带宽的影响可得出什么结论？实验二 并联谐振一、实验目的1测定并联谐振电路的谐振频率并比较测量值与计算值。2测定并联谐振电路的带宽并比较测量值与计算值。3测定并联谐振电路的品质因数。4测定并联谐振电路的谐振阻抗并比较测量值与计算值。5测定并联谐振电路谐振时电压电流之间的相位关系。6研究电感的电阻值对并联谐和振电路的谐振频率和带宽的影响。二、实验器材信号发生器 1台双踪示波器 1台100mH电感 1个0.25MF电容 1个10，50K电阻 各1个三、实验准备当信号频率为并联谐振电路的谐振频率时，电感和电容的无功功率相等，总阻抗为电阻性并且达到最大值，流入电路的电流与电路两端的电压同相，这个电压也达到最大值。在实际的并联谐振电路中，电感的电阻对谐振频率是有影响的，因此计算谐振频率时应当加以考虑，算式为 如果足够小，使1-近似等于1，则并联谐振电路谐振频率的算式与串联谐振电路相同。/Hz在图2-1和图2-2所示的并联谐振电路中，50K电阻不是谐振电路的一部分，加上它的目的是使信号源具有恒流作用。因此，交流电源可为并联谐振电路提供一个恒定电流。在图2-1和图2-2中，并联谐振电路的带宽可通过测定频率特性曲线上的低端频率高端频率来测量，在这两点上并联谐振电路两端的电压下降到峰值的0.707倍（-3dB）。因此品质因数反映谐振电路的带宽与谐振频率之间的关系。品质因数越高，则带宽越窄。品质因数可用谐振时的感抗和电感电阻来计算式中，。并联谐振电路的带宽也可用谐振频率和品质因数来计算：这个计算公式仅对高值并联谐振电路（）才是比较准确的。并联谐振电路的谐振阻抗Z可通过谐振时的感抗和电感电阻来计算这个实验要使用波特图仪，可参考电子工作平台的仪器菜单。图2-1并联谐振 图2-2并联谐振的频率特性四、实验步骤1在电子工作平台上建立如图2-1所示的实验电路。单击仿真开关进行动态分析。在表2-1中记录每种频率对应的节点峰值电压和。表2-110050080010001200200050002按表2-1中的每个频率改变信号发生器的频率，运行动态分析，记录每种频率相应的峰值电压和。必要时可调整示波器。3根据表2-1中的每个值和图2-1中的10电阻值，计算每种频率的电流，并记录到表中。值得注意的是，交流电压源串联大电阻后可当作交流恒流源。/Hz1/mA,Z/K4作出并联谐振电路两端的电压随频率变化曲线图，频率用对数坐标。500 400 300 200 100 100 200 500 1k 2k 5k 10k5根据步骤4作出的曲线图，测定并联谐振电路的谐振频率。6根据图2-1的元件值，计算并联谐振电路的谐振频率。7根据步骤4的曲线图，测定并联谐振电路的带宽。8根据图2-1的电路元件值，计算并联谐振电路的品质因数。9根据步骤8算得的品质因数和步骤6算得的谐振频率，计算这个并联谐振电路的带宽。10根据表2-1中每个值和值，计算在每个频率上并联谐振电路的阻抗，并将结果记录到表中。11作出并联谐振电路的阻抗特性图，频率用对数坐标。12根据图2-1中的电路元件值，计算并联谐振电路的谐振阻抗。13将信号发生器的频率改为步骤6算得的谐振频率，运行动态分析，记录电压与电流之间的相位差必要时可改变示波器的设置。14在电子工作平台上建立如图2-2所示的实验电路。单击仿真开关进行动态分析。波特图仪将显示并联谐振电路的电压与频率之间的函数关系。测量并记录谐振频率及曲线图的带宽。15将线圈电阻改为100，重复步骤14。必要时可高速波特图仪。五、思考与分析1步骤6中谐振频率的计算值与曲线测定值比较，情况如何？2步骤9中带宽的计算值与步骤7的曲线测定值比较，情况如何？两者之间有何差别？3根据步骤11中的曲线图，对并联谐和振电路的阻抗随频率变化的情况可得出什么样结论？4步骤12中谐振阻抗的计算值与2-1中的有关记录比较，情况如何？5在步骤13中，对电压与电流谐振时的相位差可得出什么结论？6关于线圈电阻对谐振频率和带宽的影响可作出什么结论？实验三 单稳态触发器和多谐振荡器一、实验目的1研究555单稳态触发器的功能。2研究由555构成的多谐振荡器的功能。二、实验器材5V直流电源 1个逻辑探头 1个555定时器 1台信号发生器 1台双踪示波器 1台电容器 1F、100F、0.02F 各1个0.01F 2个电阻 200、100、72、48、10、5、1 各1个三、实验准备单稳态触发器具有三个特点：第一，有一个稳态和一个暂稳态；第二，在外来触发脉冲的作用下，能够从稳态翻转为暂稳态；第三，暂稳态维持一段时间以后将自动返回稳态而暂稳态的维持时间与触发脉冲无关，仅决定于电路本身的参数。图3-1 555单稳态触发器图3-1可用来验证555单稳态触发器的逻辑功能。图中TRI为下沿触发脉冲输入端，由时钟逻辑开关CLOCK提供下沿触发脉冲。逻辑探头Output可显示单稳电路的输出状态，稳态Out=0，暂稳态时Out=1。暂稳态的维持时间由RC电路的时间常数来决定，其计算公式为图3-2为测试555单稳态触发器时间波形的电路。信号发生器将一系列短周期方波脉冲加到单稳电路的下沿触发器输入端TRI，示波器将显示触发输入端TRI和输出端Out波形。图3-3是一个用555定时器连成的多谐振荡器电路。电路的振荡频率和输出矩形波的占空比由外接元件、和决定。为控制输入端CON的旁路电容，对振荡频率没有什么影响，在有些情况下可以去掉。振荡频率可由输出脉冲的周期求出，即图3-2 555单稳电路的时间波形占空比q为用百分数表示的多谐振荡器输出高电平的时间与周期之比，即对于图3-3所示的多谐振荡电路，在一周内输出低电平的时间、输出高电平的时间、振荡周期、振荡频率及占空比的近似值可由下列公式求出图3-3 555多谐振荡器四、实验步骤1在EWB平台上建立如图3-1所示的实验电路，这是一个验证单稳态触发器逻辑功能的虚拟实验电路。逻辑探头Output检测单稳电路输出Out的高低电平。逻辑开关CLOCK为单稳电路触发输入端TRI提供下沿触发信号，开始时这个逻辑开关应该接高电平。单击仿真开关进行动态分析，同时按计算机键盘上的空格键Space两次，给单稳电路触发端加上一个下沿触发脉冲，测量并记录单稳电路输出高电平（Out=1，逻辑探头Outptut发红光）的持续时间。2根据电阻值和电容值，计算555单稳电路输出高平的持续时间。3单击开关停止仿真。将电阻值改为200，这时逻辑开关CLOCK应当接高电平。单击仿真开关进行动态分析，同时连续按键盘上的空格键两次，给单稳电路的触发端加上一个下沿触发信号，测量并记录单稳电路输出高电平的持续时间。4单击开关停止仿真。在EWB平台上建立如图3-2所示的实验电路，这是一个用信号发生器和示波器测量555单稳触发器时间波形的电路。信号发生器和示波器按图设置。5单击仿真开关进行动态分析。信号发生器在单稳电路的下沿触发端TRI加上一系列持续时间很短的方波信号，示波器则显示输入及输出信号的波形。6单击开关停止仿真。在EWB平台上建立如图3-3所示的实验多谐振荡器电路，示波器按图设置。7测量并记录输出低电平的时间、输出高电平的时间及振荡周期。8测量并记录触发电压的最大值及最小值。9根据步骤7测出的振荡周期，计算脉冲频率，单位为。10根据步骤7测出的、及，计算占空比 。11根据图3-3所示的电路中的电阻值、及电容值，计算、及。12单击开关停止仿真。将电阻值和改为48。单击仿真开关进行动态分析。等振荡稳定后按计算机键盘上的F9键暂停仿真。13测量并记录输出低电平的时间、输出高电平的时间及周期。14根据步骤13测出的周期，计算频率。15根据步骤13测出的、及，计算占空比。16根据新的电阻值、及新的电容值，计算、及。17单击开关停止仿真。将电容值改为0.02F。单击仿真开关进行动态分析。等振荡稳定后，按计算机键盘上的F9键暂停仿真。18测量并记录输出低电平的时间、输出高电平的时间和周期。19根据测出的、及，计算占空比 。20根据新测出的周期，计算频率。五、思考与分析1说明555时基电路各个引脚的功能。2步骤1单稳电路输出脉冲宽度的测量值与步骤2的计算值比较，情况如何？3图3-2所示的单稳电路是由输入脉冲信号的上沿触发还是下沿触发？4改变输入脉冲信号的频率，图3-2所示的单稳电路输出脉冲宽度会改变吗？5多谐振荡器、及的测量值与计算值比较，情况如何？6多谐振荡器输出波形占空比的测量值与计算值比较，情况如何？实验四 异步计数器一、实验目的1研究JK触发器在异步计数器中的应用。2研究触发器的传播延迟对异步计数器的影响。3测试普通递减异步计数器的功能。4测试7493递减异步计数器的功能。5研究异步计数器的分频功能。6研究怎样改变异步计数器的分频数。二、实验器材5V直流电源 1个逻辑开关4个下沿JK触发器74112 4个异步计数器74932个数字信号发生器1台逻辑分析仪1台信号发生器1台示波器1台三、实验准备当JK触发器的J、K输入端为高电平1时可连成二进制计数器。二进制计数器分为同步计数器和异步计数器。异步计数器的计数脉冲不是同时加到所有触发器的计数输入端，而只加到最低位触发器的计数输入端，其它各级触发器则由相邻的低位触发器来触发。因为计数进位信号像波浪一样推进，所以又称为纹波计数器。一个触发器的传播延迟时间为触发器从接收边沿触发输入信号到发生输出状态变化所需要的时间。因为在异步计数器中，后级触发器在前级触发器的输出状态发生变化以前是没有时钟信号输入的，所有的输出不能同时响应计数时钟脉冲的输入，所以从计数脉冲输入到最后一个触发器改变输出之间的延迟时间由触发器的个数N来决定。如果时钟频率过高，则在下一个输入时钟脉冲到达时最后一个触发器还来不及改变输出状态，就会造成计数错误。基于这个原因，异步计数器的最大时钟频率将低于同步计数器的最大时钟频率。对于异步计数器，最大时钟频率可用下式计算异步计数器常用于分频电路。因为JK触发器的J、K端均为高电平时，仅在时钟脉冲的下沿（或上沿）到达时才改变输出状态，所以在异步计数器中每个触发器输出波形的频率为时钟输入波形频率的一半。图4-1异步计数器在图41所示的电路中用4个下沿JK触发器组成一个4位二进制异步计数器。每个触发器的J、K输入端都接5V电源，即J=K=1，时钟脉冲下沿触发有效。第一个触发器由计数时钟脉冲CLK触发。每个高位触发器的CLK输入端接到相邻低位触发器的Q输出端。当低位触发器的输出由1降为0时，相邻高位触发器被触发。每个触发器的直接复位端都接到计数器的清零端CLR，当CLR=0时，计数器清零。每次清零后，CLR应当接回高电平，否则计数器无法正常工作。图42所示的电路用来研究触发器的传播延迟时间对4位异步计数器的影响。数字信号发生器的时钟输出端将时钟脉冲加到计数器的CLK输入端。数字信号发生器发出的第一个时钟脉冲为0，对计数器清零，然后所加的脉冲都是1，使计数器进行计数。逻辑分析仪则显示计数器CLK端的时钟输入波形和端的计数输出波形。 图4-2 4位异步计数器的时间波形 图4-3 4位异步递减计数器图4-4 7493异步计数器图43电路是由4个下沿JK触发器构成的4位异步二进制递减计数器。在计数器中每个高位触发器的CLK输入端接到相邻低位触发器的Q反相输出端。电路的其余部分与图41电路完全相同。图44为7493异步二进制计数器，其中4个JK触发器的J、K输入端接高电平，触发器的输出端分别为、和。在计数器内部，由最低位触发器的下沿时钟输入端和输出端组成1位计数器，分频数为2，即输出信号频率为输入时钟信号频率除以2；由另外3个触发器组成3位计数器，其下沿时钟输入端为，输出端分别为、和，分频数为8。通过外部连接7493也可组成一个16分频的4位二进制计数器，方法是将1位计数器的输出端与3位计数器的输入端相连。这个特性使得7493用起来非常方便，可随意接成1位、3位或4位计数器。7493还有两个高电平复位输入端。这两个输入端可用来对计数器清0，为了改变计数器的分频还可用它来中止计数。用不同的方式连接计数器，可改变它的分频数，范围是2分频至16分频。图4-5 7493异步计数器的时间波形图45测试7493异步计数器时间波形的电路。数字信号发生器的时钟输出端CLK给异步计数器加上时钟脉冲，逻辑分析仪则显示时钟脉冲波形和计数器输出波形。当逻辑开关D往下打时，7493用作为时钟输入构成1位计数器，分频数为。当开关D往上打时，7493用作为时钟输入构成3位计数器，分频数为。当开关D仍旧往上打时，若将接到，并将作为时钟输入端，则7493构成4位计数器，分频数计数时高电平复位输入端要始终接地。在图4-6中7493接成12进制计数器。电路中与连接使7493构成4位计数器，而且输出端和接到复位端。这种连接方式使计数器只在0到12之间进行计数，当第12个时钟脉冲到达时计数器复位，这样就构成了十二进制计数器，分频数为12。图4-6 7493接成十二进制计数器图4-7 7493分频电路（一）在图47图49，7493计数器接成3种分频电路。示波器用来显示时钟输入波形和计数输出波形。仔细观察、的连接方式，可确定计数器的分频数，情况与图46电路相似。计数器的分频数n还可通过实验来测定，方法是先用示波器测出时钟周期Tc和计数周期To。因为频率为周期的倒数，所以时钟频率和计数频率分别为最后由和可求出计数器的分频数n，即 图4-8 7493分频电路（二）图4-9 7493分频电路（三）在图410电路中，用两个7493级联组成异步计数器，以增大计数器的分频数。信号发生器提供100KHZ的方波信号作为计数器的时钟脉冲输入。示波器则显示级联计数器的输出波形。级联计数器的分频数n可通过实验来测定。用上面所介绍的方法，先测定第一级计数器的分频数,再测定第二级计数器的分频数，则级联计数器的分频数等于和的乘积，即图4-10 7493分频电路（四）四、实验步骤1在EWB平台上建立如图41所示的实验电路，这是一个由4个下沿JK触发器组成的4位异步二进制计数器。逻辑开关C和CLK开始时应当置1。单击仿真开关进行动态分析，按计算机键盘上的C键对计数器清0，然后再按一次C键使CLR端接回“1”的位置。2按键盘上的空格键使CLK的输入由1降为0，产生一个下沿触发时钟信号。对每个时钟脉冲输入，在表41中记录相应的二进制计数输出。41计数输出（一）输 入输 出输 入输 出时钟脉冲时钟脉冲192103114125136147158163继续按空格键产生下沿触发时钟脉冲，并记录相应的二进制计数输出，直至填满表414单击开关停止仿真。在EWB平台上建立如图42所示的实验电路，研究触发器传播延迟时间4位异步计数器的影响。数字信号发生器和逻辑分析仪按图设置。单击仿真开关进行动态分析。根据逻辑分析仪屏幕的显示情况，在实验报告中画出时钟脉冲输入CLK及计数输出的时间波形图。5根据触发器的传播延迟时间和触发器的个数N，计算计数器的最高时钟频率。6.单击开关停止仿真。在EWB平台上建立如图43所示的实验电路，这是一个用4个下沿JK触发器组成的4位异步递减计数器，开始时逻辑开关C和CLK应该置1。单击仿真开关进行动态分析。按计算机键盘上的C键对计数器清0，然后再按一次C键将CLR端置1。7.按计算机键盘上的空格键使CLK输入由1降为0，产生一个下降沿触发的时钟脉冲信号，对每个触发脉冲输入，在表42中记录相应的计数输出。然后继续按空格键，产生足够多的下沿触发脉冲，继续记录计数输出，直至完成表42。表42计数输出（二）输 入输 出输 入输 出时钟脉冲时钟脉冲192103114125136147158168单击开关停止仿真。在EWB平台上建立如图44所示的实验电路，这是一个7493 4位二进制异步计数器。这种计数器具有两个高电平输入有效的复位端、及两个下沿触发时钟脉冲输入端、。用来触发由触发器A组成的1位二进制计数器，用来触发由触发器B、C、D组成的3位二进制计数器。通过外部边线将触发器A的输出端接到触发器B的时钟输入端，并将作为计数时钟脉冲输入端，就可连成4位二进制计数器，其分频数。当逻辑开关D向下打时，7493用作为时钟输入可构成1位计数器，分频数；用作为时钟输入可构成3位计数器，分频数。当逻辑开关D向上打时，用作为时钟输入7493可构成4位计数器，分频数。9开始时开关R和D应该处在往下打的位置，开关和也往下打。单击仿真开关进行动态分析。如果计数器输出没有复位，则按计算机键盘上的R键使和接高电平1，对计数器清0。计数器复位后再按一次R键，使接低电平0。10开关D处在往下打的位置，按键盘上的A键，给输入端加上一个下沿触发脉冲，然后继续按A键入下沿触发脉冲，观察计数器输出端的状态变化。11开关D处在往下打的位置，按键盘上的B键，给输入端加上一个下沿触发脉冲，然后继续按B键输入下沿触发脉冲，观察计数器输出端的状态变化。12按键盘上的D键使开关D往上打，将输出端与输入端连接起来。按R键使计数器复位，然后再按一次R键将接地。连续按几次A键给端输入下沿触发时钟脉冲，观察的输出变化。13单击开关停止仿真。在EWB平台上建立如图45所示的实验电路，用这个电路可显示7493异步计数器的时间波形。数字信号发生器和逻辑分析仪按图设置。当逻辑开关D往下打时，7493用作为时钟输入可构成1位计数器，分频数；如果用作为时钟输入，则构成3位计数器，分频数。当开关D往上打时，用作为时钟输入7493可构成4位计数器，分频数。开始时开关D应该处于往上打的位置。14单击仿真开关进行动态分析。在逻辑分析仪的屏幕上，将显示时钟输入波形、1位计数器的输出波形及3位计数器的、输出波形。在实验报告中画出这些波形曲线图。15单击开关停止仿真。按键盘上的D键把逻辑开关D往上打，将输出端与输入端连接起来。再次单击仿真开关进行动态分析。根据逻辑分析仪的显示情况，在实验报告中画出波形曲线图。16单击开关停止仿真。在EWB平台上建立如图46所示的实验电路，这是一个用7493连成的十二进制计数器，分频数。值得注意的是，电路中输出端接到输入端，输出端接到复位输入端，并且输出端接到复位输入端。单击仿真开关进行动态分析。按键盘上的A键，次数要足够多，给输入端加上下沿触发时钟脉冲，观察的输出变化，并将观察结果记录到表43中。表43计数输出（三）输 入输 出输 入输 出时钟脉冲时钟脉冲1921031141251361471581617单击开关停止仿真。在EWB平台上建立如图47所示的异步计数器电路，信号发生器和示波器按图设置。单击仿真开关进行动态分析。单击示波器虚拟面板上的放大按钮Zoom，利用示波器的屏幕放大特性，测定并记录时钟输入波形的周期、计数输出波形的周期及频率。时钟输入 计数输出 18根据步骤17的测量结果，计算这个计数器的分频数n。19单击开关停止仿真。在EWB上建立如图48所示的实验电路，信号发生器和示波器按图47设置。单击仿真开关进行动态分析。利用示波器的屏幕放大特性，测量并记录时钟输入波形的周期、频率、计数输出波形的周期和频率。时钟输入 计数输出 20根据步骤19的测量结果，计算这个计数器的分频数n。21单击开关停止仿真。在EWB平台上建立如图49所示的实验电路，信号发生器和示波器按图48设置。单击仿真开关进行动态分析。利用示波器的放大特性，测量并记录时钟输入波形的周期、频率，计数输出波形的周期和频率。时钟输入 计数输出 22.根据步骤21的测量结果，计算这个计数器的分频数n。23单击开关停止仿真。在EWB平台上建立如图410所示的实验电路，信号发生器和示波器按图49设置。单击仿真开关进行动态分析。利用示波器的放大特性，测量并记录计数输出波形的周期和频率。计数输出 24根据图410级连计数器电路和100KHZ的时钟频率，计算这个计数器的输出频率。五、思考与分析1图41所示的计数器是用时钟脉冲的上沿触发还是下沿触发？2在表41中，时钟脉冲输入的顺序数与计数输出的二进制数之间有何关系？3在图42所示的异步计数器电路中，每个触发器的输出脉冲频率与输入时钟频率之间有何关系？JK触发器的传播延迟时间大约等于多少？4图43所示的电路有什么计数功能？5怎样改变7493外部电路的连接，才能构成1位、3位或4位计数器？6从步骤15测出的波形曲线图中，可以看出这个计数器的分频数n等于多少？7在表43中，时钟脉冲输入的顺序数与计数输出的二进制数之间有何关系？8在步骤17、18中，计数器分频数n的测量值与计算值比较，情况如何？9在步骤19、20中，计数器分频数的测量值与计算值比较，情况如何？10在步骤21、22中，计数器分频数的测量值与计算值比较，情况如何？11在步骤23、24中，计数器输出频率的测量值与计算值比较，情况如何？实验五 D/A转换器一、实验目的1研究D/A转换器数字输入与模拟输出之间的关系。2研究怎样设置D/A转换器的输出范围。3研究怎样测量D/A转换器的输出偏移电压。4研究怎样提高D/A转换器的分辨率。5研究怎样测试D/A转换器的分辨率。二、实验器材5V、10V直流电源 各 1个逻辑开关 8个逻辑探头 8个D/A转换器 1个异步计数器7493 1个74191 2个电位器 1个10V电压表 1个信号发生器 1台示波器 1台三、实验准备我们把从数字信号到模拟信号的转换称为数/模转换或D/A转换，把实现D/A转换的电路称为D/A转换器，简称DAC。D/A转换的过程是，先把输入数字量的每一位代码按其权的大小转换成相应的模拟量，然后将代表各位的模拟量相加，即可得到与该数字量成正比的模拟量，从而实现数字/模拟转换。DAC通常由译码网络、模拟开关、求和运算放大器和基准电压源等部分组成。DAC的满度输出电压，为全部有效数码1加到输入端时DAC的输出电压值。满度输出电压决定了DAC的输出范围。DAC的输出偏移电压，为全部有效数码0加到输入端时DAC的输出电压值。在理想的DAC中，输出偏移电压为0。在实际的DAC中，输出偏移电压不为0。许多DAC产品设有外部偏移电压调整端，可将输出偏移电压调为0。DAC的转换精度与它的分辨率有关。分辨率是指DAC对最小输出电压的分辨能力，可定义为输入数码只有最低有效位1时的输出电压与输入数码为全1小时的满度输出电压之比，即分辨率=当一定时，输入数字代码的位数越多，则分辨率越小，分辨能力就越高。图5-1 D/A转换电路图5-1为8位电压输出型DAC电路，这个电路可加深我们对DAC数字输入与模拟输出关系的理解。DAC满度输出电压的设定方法为，首先在DAC数码输入端加全1（即11111111），然后调整电位器使满度电压值达到输出电压的要求。图5-2 DAC输出波形在图5-2电路中，一个8位电压输出型DAC与7493 4位二进制计数器相连，计数器的输入时钟脉冲由1kHz信号发生器提供。电路中只有DAC低4位输入端接到计数器的输出端，高4位输入端接地。这就意味着这个DAC最多只有15级模拟电压输出，面不是通常8位DAC的255级。计数器在计到最后一个二进制数1111时，将复位到0000，并开始新一轮计数。因此在示波器的屏幕上，所看到的DAC模拟电压输出曲线像是一个15级楼梯。通过测量示波器曲线图上第15级的最大电压值，可确定DAC的满度输出电压。这个电压将小于全8位数码输入时255級DAC的滿输出电压。在图53电路中，一个8位电压输出型DAC与两个级联的74191 4位二进制计数器连接，两个74191接成8位计数器。这种连接方式使8位DAC能够覆盖05V整个输出范围，并完成255级8位计算。值得注意的是，与15级计数的曲线图相比，255级计数的输出范电压特性曲线更像一条直线。在任何指定的电压范围内，计数的级数越多，则DAC的输出越接近真实模拟信号，数/模转换的分辨率也越高。图5-3 DAC输出分辨率的测定四、实验步骤1在EWB平台上建立如图51所示的实验电路，这是一个8位电压输出型DAC电路，通过这个电路实验，可以使我们进一步了解数/模转换器数字输入模拟输出之间的关系。电位器用来设置满度输出电压（即输出电压范围）。开始时所有输入逻辑开关应该置1。2单击仿真开关进行动态分析。调整电位器，使DAC输出电压尽量接近5V，这时DAC的满度输出电压设置为5V。3按计算机键盘上的数键0-7，将DAC的数码输入改为00000000，在表5-1中记录数/模转换器相应的输出电压。表5-1 DAC的输出电压二进制输入输出电压/V0000 00000000 00010000 00100000 01000000 10001111 11114 按键盘上的数字，将DAC的8位数码输入改为00000001，在表5-1中记录DAC的输出电压。继续输入表中其余的数码，并记录相应的输出电压。5根据DAC的满度输 出电压和8位输 入的级数，计算图5-1所示的DAC电路的分辨率。6根据表5-1的数据，计算这个DAC的分辨率。7单击开关停止仿真。在EWB平台上建立如图5-2所示的实验电路，这是一个8位电压输出型DAC与4位二进制计数器连接的电路，信号发生器为计数器提供1KHZ输入时钟脉冲。DAC的低4位输入端与计数器的输出端相连，而高4位输入端接地。因此D/A转换器的模拟输出只有15级，而不是通常8位DAC的255级。在电路中，信号发生器和示波器按图设置。8单击仿真开关进行动态分析。在示波器屏幕上将显示DAC模拟输出的阶梯波。利用示波器的屏幕放大功能，测量并记录DAC的分辨率和满度输出电压。分辨率= = 9单击开关停止仿真。在EWB平台上建立如图5-3所示的实验电路，这是一个8位电压输出型DAC与8位计数器连接的电路，8位计数器由两个级联的74191 4位二进制计数器构成。8位DAC可覆盖05V的电压输出范围，并可完成255级8位计数。电路中信号发生器和示波器按图设置。单击仿真开关进行动态分析。注意观察示波器显示的输出特性曲线，这种输出波形更接近直线，而不像“楼梯”。五、思考与分析1根据表5-1的实验数据，对图5-1所示的电路回答下列问题（1）DAC的输出偏移电压有多大？（2）DAC的满度输出电压是几伏？（3）DAC的分辨率是多少？（4）DAC的输出电压与输入数码的大小成比例吗