2022年抗混叠滤波器设计方案.docx
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1、精品学习资源抗混叠滤波器设计抗混叠滤波器的设计包括一个过采样架构和一个补充数字抽取滤波器;这个过采样架构将那奎斯特频率放置在远离信号带宽的位置 上,而数字抽取滤波器衰减大多数有害的带外信号;当把二者组合在一起时,它们可以实现更加自由的抗混叠滤波器响应,只需几个分立式组件即可实现这一功能;图 1:用一个适当的抗混叠滤波器来阻挡这些混叠我们知道,在高精度ADC应用中使用抗混叠滤波器是有益的,不过,设计合适的抗混叠滤波器也同样重要假如你不当心的话,就欢迎下载精品学习资源像把有害误差从系统中排除一样,很简洁将有害误差引入到你的系统中;在为你的应用设计抗混叠滤波器时,请考虑以下3 个通用指导原就:1.
2、挑选你的滤波器截止频率最简洁的抗混叠滤波器是一个单极、低通滤波器,如图2 所示,它使用一个串联电阻器 R和共模电容器 CCM;设计这个滤波器的第一步就是挑选所需的截止频率, fC;在 fC 上,滤波器的响应滚降至-3dB,并且在频率域范畴内连续以 -20dB/ 十倍频的速度削减;挑选一个比 ADC调制器采样频率,fMOD,至少低十倍频的截止频率,其目的在于,在这些频率上以10 倍或更高倍数打压带外噪声;对于增加的衰减,通过增加R 和 CCM的值来进一步削减截止频率;我在上一篇文章中提到过,你的数字抽取滤波器的用途就是供应帮 助,所以就没有必要在所需信号带宽之后立刻设定你的抗混叠滤波 器截止频率
3、;方程式 1 运算出单极、低通滤波器的截止频率为 -3dB:欢迎下载精品学习资源图 2.ADC输入上的单极、低通滤波器有时候,一个单极、低通滤波器或许仍不够;诸如振动感测等应用或许是用更少的过采样来分析更宽带宽上的信号;这就使数字抽取滤波器的通带更加靠近fMOD,并且使得抗混叠滤波器的滚降空间更小;在这些情形下,你可以添加一个包含额外RC对的其次极或第三极,以实现一个更加灵敏的滤波器响应;图 3 中显示的是,设计用于ADC的单极和双极滤波器的响应;这个ADC在 fMOD = 1MHz 上对输入进行采样;双极滤波器扁平通带向外扩展至大约 20kHz,并且仍旧能够在 1MHz上实现 -60dB 的
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