全国大学生电子竞赛失败了(转)-一篇总结(共3页).doc
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2、责任在我,但是客观上讲,是我们团队、实验室太仓促、准备不足,有句话说机会是给有准备的人的,可是我们一无所有,我们几乎没准备,我们没有在拿到题的时候理性分析。在比赛前我们已经猜出有示波器、低频采集高频信号这道题,正是由于前几年出过示波器的题,所以我们提前确定了这个方向。出题后,不出所料,我们就在潜意识里认为这道题可做。在这里我是有责任的,比赛中,几乎所有数字部分都是我一个人在做,而这道题的数字部分内容很多。由于题目的要求比较高、普通的单片机速度太慢,只能用 FPGA。我对HDL已经很不熟悉了,还是在一年前采用过。由于我们没有准备,就连ADC/DAC的控制模块也是从头开始写。我觉得我很累,我有点疑
3、问,为什么李硕不写verilog,他会,我不是责怪队友,现在想想也许是队友过于信任我,而错的应该在我没有提出这个问题,也就是在选题的时候,我们选了道数字部分特别多的题目。我觉得起码两个人会写程序甚至三个人。因该说,我们选题失败了。之所以会这样,可能还是因为我们从一开始就接受了这个题目。这道题是有难度的,比赛前李硕和徐蕊鑫去北交了解,他们一暑假都在做低频采集高频的这道题目,似乎做的也不好。其次,说到准备不足,那确实是一个很严重的问题。数字示波器的题目在几年前是已经出过的,我们没有好好的作过一遍,事实上讲,我们做的时候已经晚了。别人做了一暑假。或者说我们应该在那一年简易示波器的基础上去比赛,如果四
4、天就搞在低频采集高频,这样或许成的可能性大一些,可我们几乎是从零开始的。刚开始是AD/DA。我们也选了不少器件,可是TLC5510和DAC900都好像数据不对,像什么AD7528什么都用过。最后还是用了MAX114和DAC0832。第一天,很多时间是用在了这个上面。直到现在我还是纳闷,DAC出来的三角波为什么会有轻微的晃动,也就是说,我们连那年的基础都没做好。还有,看了原来的报告,说采用2000点的存储深度,好像是两天后我改成256点了,我想没有必要那么深,不利于读取存储,题目要求也只是=200点而已。还有个问题就是我们的触发没做好,直到现在我觉得这是一个很严重的问题。触发电路是徐搭的,是用高
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