数字电子钟实习报告(共18页).doc
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1、精选优质文档-倾情为你奉上数字电子钟课程设计学院:电气信息工程学院专业、班级:自动化11-02姓名:周振学号:9专心-专注-专业目录摘 要电子数字钟是一种用数字电路技术实现时、分、秒计时的装置,与机械式时钟相比具有更高的准确性和直观性,因此得到了广泛的使用。电子数字钟从原理上讲是一种典型的数字电路,其中包括了组合逻辑电路和时序电路。因此,此次设计与制做电子数字钟就是可以了解电子数字钟的原理,学会制作电子数字钟。通过电子数字钟的制作能进一步的了解各种在制作中用到的中小规模集成电路的作用及实用方法,通过它可以进一步学习与掌握各种组合逻辑电路与时序电路的原理与使用方法。这次电子数字钟的设计主要是利用
2、74LS90的计数功能来实现电子钟时、分、秒的跳变,整个设计主要分为六个模块:时模块、分模块、秒模块、分频模块、校时校分模块、整点报时模块。时、分、秒模块分别用两块74LS90实现,并且分别将它们设置为60进制,60进制,24进制。秒信号的产生用石英晶体振荡器加分频器来实现,将秒信号送入秒模块,每累计60秒发出一个分脉冲信号,分模块每累计60分钟,发出一个时脉冲信号,时模块实现对24小时的累计,通过六个七段LED显示器显示出来。整点报时电路根据计时系统的输出状态产生一脉冲信号,然后加上一个高频或低频信号送到蜂鸣器实现报时。校时电路是直接加一个脉冲信号到时计数器或者分计数器或者秒计数器来对“时”
3、、“分”、“秒”显示数字进行校对调整。关键词:CD4511 74LS90 分频器 晶体振荡器 校时校分电路 数字电路1.设计目的数字电子钟是一种用数字电路技术实现时、分、秒计时的装置,与机械钟相比具有更高的准确性和直观性,且具有无机械传动装置等特点,因此得到了广泛的使用。 数字电子钟从原理上看是一种典型的数字电路,其中包括了组合逻辑电路和时序电路。设计与制做数字电子钟可以使我们了解数字电子钟的原理,并且学会制作数字电子钟.而且通过数字电子钟的制作进一步地了解各种在制作中用到的中小规模集成电路的作用及使用方法.且由于数字电子钟包括组合逻辑电路和时序电路.通过此次课程设计可以进一步学习与掌握各种组
4、合逻辑电路与时序电路的原理与使用方法.2.设计任务设计制作一个数字电子钟指标:(1)时间计数电路采用24进制,从00开始到23后再回到00;(2)各用2位数码管显示时、分、秒;(3)具有手动校时、校分功能,可以分别对时及分进行单独校时,使其校正到标准时间; (4)计时过程具有报时功能,当时间到达整点前10秒开始,蜂鸣器1秒响1秒停地响5次;(5)为保证计时器的稳定性及准确性,由晶体振荡器提供时间基准信号。3.数字电子钟的电路系统设计下面将介绍数字电子钟的整个电路系统设计的过程。包括数字电子钟的设计原理,设计方案的确定,数字电子钟的电路设计计算机仿真,电路的设计、焊接与调试几大部分。3.1 设计
5、原理数字电子钟是一个对标准频率(1Hz)进行计数的计数电路。主要由振荡器、分配器、计数器、译码器和显示器电路功能模块组成。振荡器产生的时钟信号经过分频器形成秒脉冲信号,秒脉冲信号输入计数器进行计数,并把累计结果通过显示器以“时”、“分”、“秒”的顺序以数字形式显示出来。秒计数器电路计满60后触发分计数器电路,分计数器电路计满60后触发时计数器电路,当计满24小时后又开始下一轮的循环计数。可以通过校时电路对分和时进行校时,且具有整点报时功能,当时间到达整点前10秒开始,蜂鸣器将以1秒响1秒停的形式响5次。3.2 方案确定通过在互联网网和图书馆查找资料和对电子技术基础(数字部分)的学习,讨论确定一
6、个既符合本设计要求又具有比较强的操作性的方案作为此次设计的对象。3.2.1 设计方案本电路系统由晶体振荡电路,时间计数电路,校时电路,译码驱动电路组成。其中,时间计数电路用六个74LS90组成。校时电路主要由74LS00P组成RS触发器,而且加入消抖电路,达到了自动校时的效果。电路原理方框示意图如下:4511译码驱动4511译码驱动4511译码驱动4511译码驱动4511译码驱动4511译码驱动时十位计数时个位计数分十位计数分个位计数秒十位计数秒个位计数具有消抖动的校分、校时控制电路32768晶体振荡电路 CD4060分频器2Hz 二分频电路(74LS90)1Hz 图1 设计方案的设计原理图3
7、.2.2 设计方案的确定(1)利用单片机实现的数字钟具有编程灵活,便于数字钟功能的扩充,即可用该数字钟发出各种控制信号,精确度高等特点。(2)考虑到本学期所学的知识,这个课程设计给予的是一个实践的机会,因此最终选择了用数字逻辑电路来实现这个设计方案。3.3 数字电子钟的电路设计下面将介绍设计电路。含时间计数电路的设计、整点报时电路的设计、校时电路的设计、秒信号发生器的设计、译码驱动显示电路的设计几个部分。3.3.1时间计数电路的设计时间计数电路由60进制的秒计数器,60进制的分计数器和24进制的计数器组成。图2 60进制电路当分的74LS90芯片的进位输入端11端的脉冲进位信号传到时的脉冲输入
8、端时,时便计数一次,并且其十位和个位的进位关系与分(秒)的十位和个位的进位关系一样。24进制计数器如下图所示:图3 24进制电路3.3.2 整点报时电路的设计电路应在整点前10秒钟内开始整点报时,即是当时间在59分50秒到59分59秒期间时,报时电路报时控制信号。当时间在59分50秒到59分59秒期间时,分十位、分个位和秒十位均保持不变,分别为5、9和5,因此可将分计数器十位的Q和Q 、个位的Q和Q及秒计数器十位的Q和Q相与,从而产生报时控制信号。数字钟要求在差10s为整点时开始产生每隔1s鸣叫一次的响声,共鸣五次,每次持续时间为1s。其电路如下图所示。图4 整点报时电路3.3.3校时电路的设
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