数字电子技术期末复习题库及答案(共34页).doc

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1、精选优质文档-倾情为你奉上第1单元 能力训练检测题 一、填空题1、由二值变量所构成的因果关系称为 逻辑 关系。能够反映和处理 逻辑 关系的数学工具称为逻辑代数。2、在正逻辑的约定下，“1”表示 高 电平，“0”表示 低 电平。3、数字电路中，输入信号和输出信号之间的关系是 逻辑 关系，所以数字电路也称为 逻辑 电路。在 逻辑 关系中，最基本的关系是 与逻辑 、 或逻辑 和 非逻辑 。4、用来表示各种计数制数码个数的数称为 基数 ，同一数码在不同数位所代表的 权 不同。十进制计数各位的 基数 是10， 位权 是10的幂。5、 8421 BCD码和 2421 码是有权码； 余3 码和 格雷 码是无

2、权码。6、 进位计数制 是表示数值大小的各种方法的统称。一般都是按照进位方式来实现计数的，简称为 数 制。任意进制数转换为十进制数时，均采用 按位权展开求和 的方法。7、十进制整数转换成二进制时采用 除2取余 法；十进制小数转换成二进制时采用 乘2取整 法。8、十进制数转换为八进制和十六进制时，应先转换成 二进 制，然后再根据转换的 二进 数，按照 三个数码 一组转换成八进制；按 四个数码 一组转换成十六进制。9、逻辑代数的基本定律有 交换 律、 结合 律、 分配 律、 反演 律和 非非 律。10、最简与或表达式是指在表达式中 与项中的变量 最少，且 或项 也最少。13、卡诺图是将代表 最小项

3、 的小方格按 相邻 原则排列而构成的方块图。卡诺图的画图规则：任意两个几何位置相邻的 最小项 之间，只允许 一位变量 的取值不同。14、在化简的过程中，约束项可以根据需要看作 1 或 0 。二、判断正误题1、奇偶校验码是最基本的检错码，用来使用PCM方法传送讯号时避免出错。（ 对 ）2、异或函数与同或函数在逻辑上互为反函数。 （ 对 ）3、8421BCD码、2421BCD码和余3码都属于有权码。 （ 错 ）4、二进制计数中各位的基是2，不同数位的权是2的幂。 （ 对 ）3、每个最小项都是各变量相“与”构成的，即n个变量的最小项含有n个因子。（ 对 ）4、因为逻辑表达式A+B+AB=A+B成立，

4、所以AB=0成立。 （ 错 ）5、逻辑函数F=A+B+C+B已是最简与或表达式。 （ 错 ）6、利用约束项化简时，将全部约束项都画入卡诺图，可得到函数的最简形式。（ 错 ）7、卡诺图中为1的方格均表示逻辑函数的一个最小项。 （ 对 ）8、在逻辑运算中，“与”逻辑的符号级别最高。 （ 对 ）9、标准与或式和最简与或式的概念相同。 （ 对 ）10、二极管和三极管在数字电路中可工作在截止区、饱和区和放大区。 （ 错 ）三、选择题1、逻辑函数中的逻辑“与”和它对应的逻辑代数运算关系为（ B ）。A、逻辑加 B、逻辑乘 C、逻辑非2、十进制数100对应的二进制数为（ C ）。A、 B、 C、 D、3、和

5、逻辑式表示不同逻辑关系的逻辑式是（ B ）。A、 B、 C、 D、4、数字电路中机器识别和常用的数制是（ A ）。A、二进制 B、八进制 C、十进制 D、十六进制5、以下表达式中符合逻辑运算法则的是（ D ）。 A、CC=C2 B、1+1=10 C、01 D、A+1=16、A+BC=（ C ）。A、A+B B、A+C C、（A+B）（A+C） D、B+C7、在（ D ）输入情况下，“与非”运算的结果是逻辑0。 A、全部输入是0 B、任一输入是0 C、仅一输入是0 D、全部输入是1四、简述题1、逻辑代数与普通代数有何异同？答：逻辑代数中仅含有0和1两个数码，普通代数含有的数码是09个，逻辑代数是

6、逻辑运算，普通代数是加、减、乘、除运算。2、什么是最小项？最小项具有什么性质？答：一个具有n个逻辑变量的与或表达式中，若每个变量以原变量或反变量形式仅出现一次，就可组成2n个“与”项，我们把这些“与”项称为n个变量的最小项，分别记为mn。最小项具备下列性质：对于任意一个最小项，只有一组变量取值使它的值为1,而变量取其余各组值时，该最小项均为0。任意两个不同的最小项之积恒为0。变量全部最小项这和恒等于1。3、试述卡诺图化简逻辑函数的原则和步骤。答：利用卡诺图化简逻辑函数式的步骤：根据变量的数目，画出相应方格数的卡诺图；根据逻辑函数式，把所有为“1”的项画入卡诺图中；用卡诺圈把相邻最小项进行合并，

7、合并时就遵照卡诺圈最大化原则；根据所圈的卡诺圈，消除圈内全部互非的变量，每一个圈作为一个“与”项，将各“与”项相或，即为化简后的最简与或表达式。 五、计算题1、用代数法化简下列逻辑函数解：解：解： 解：2、用卡诺图化简下列逻辑函数F（A, B, C, D）= m（3, 4, 5, 7, 9, 13, 14, 15）在图中，m5, m7, m13, m15虽然可画成一个圈，但它的每一个最小项均被别的卡诺圈圈过，因此是多余圈。F (A,B,C,D) = m(1,3,5,7,9,11,13)圈零法:本题0的数量远少于1的数量，使用圈零法较简便。3、完成下列数制之间的转换（365）10（ ）2（555

8、 ）8（16D ）16 （11101.1）2（29.5）10（ 35.4）8（1D.8）16 （57.625）10（.101)2=（71.5 ）8（ 39.A ）164、完成下列数制与码制之间的转换（6分）（47）10（ ）8421码 （25.25）10（ . ）8421BCD （31.2）8第2单元 能力训练检测题 一、填空题： 1、基本逻辑关系的电路称为 逻辑门 ，其中最基本的有 与门 、 或门 和 非 门。常用的复合逻辑门有 与非 门、 或非 门、 与或非 门、 异或 门和 同或 门。2、CMOS集成电路是由 增强 型 PMOS 管和 增强 型 NMOS 管组成的互补对称MOS门电路，其

9、中CC4000系列和 高速 系列是它的主要子系列。3、功能为“有0出1、全1出0”的门电路是 与非 门；具有“ 有1出1，全0出0 ”功能的门电路是或门；实际中集成 与非 门应用的最为普遍。4、普通的TTL与非门输出只有 高电平“1” 和 低电平“0” 两种状态；TTL三态与非门除了具有 1 态和 0 态，还有第三种状态 高阻 态，三态门可以实现 总线 结构。5、集成电极开路的TTL与非门又称为 OC 门，其输出可以 “线与 。6、TTL集成电路和CMOS集成电路相比较， TTL 集成门的带负载能力较强， CMOS 集成门的抗干扰能力较强。7、当外界干扰较小时，TTL 与非 门闲置的输入端可以

10、 悬空 处理；TTL 或非 门不使用的闲置输入端应与 地 相接；CMOS门输入端口为“与”逻辑关系时，闲置的输入端应接 高 电平，具有“或”逻辑端口的CMOS门多余的输入端应接 低 电平；即CMOS门的闲置输入端不允许 悬空 。二、判断正误题1、所有的集成逻辑门，其输入端子均为两个或两个以上。 （ 错 ）2、根据逻辑功能可知，异或门的反是同或门。 （ 对 ）3、具有图腾结构的 TTL 与非门可以实现“线与”逻辑功能。 （ 错 ）4、逻辑门电路是数字逻辑电路中的最基本单元。 （ 对 ）5、TTL和CMOS两种集成电路与非门，其闲置输入端都可以悬空处理。 （ 错 ）6、74LS 系列产品是TTL集

11、成电路的主流，应用最为广泛。 （ 对 ）7、74LS系列集成芯片属于TTL型，CC4000系列集成芯片属于CMOS型。 （ 对 ）8、OC门可以不仅能够实现“总线”结构，还可构成与或非逻辑。 （ 对 ）9、CMOS电路的带负载能力和抗干扰能力均比TTL电路强。 （ 错 ）三、选择题1、具有“有1出0、全0出1”功能的逻辑门是（ B ）。A、与非门 B、或非门 C、异或门 D、同或门2、CMOS电路的电源电压范围较大，约在（ B ）。A、5V5V B、318V C、515V D、5V3、若将一个TTL异或门当做反相器使用，则异或门的A和B输入端应：（ A ）。A、B输入端接高电平，A输入端做为反

12、相器输入端B、B输入端接低电平，A输入端做为反相器输入端C、A、B两个输入端并联，做为反相器的输入端D、不能实现4、（ C ）的输出端可以直接并接在一起，实现“线与”逻辑功能。A、TTL与非门 B、三态门 C、OC门 D、异或门5、（ A ）在计算机系统中得到了广泛的应用，其中一个重要用途是构成数据总线。A、三态门 B、TTL与非门 D、异或门 C、OC门 6、一个两输入端的门电路，当输入为1 0时，输出不是1的门电路为（ C ）。A、与非门 B、或门 C、或非门 D、异或门7、一个四输入的与非门，使其输出为0的输入变量取值组合有（ B ）。A、15种 B、1种 C、3种 D、7种四、简述题1

13、、数字电路中，正逻辑和负逻辑是如何规定的？答：数字电路中只有高、低电平两种取值。用逻辑“1”表示高电平，用逻辑“0”表示低电平的方法称为正逻辑；如果用逻辑“0”表示高电平，用逻辑“1”表示低电平，则称为负逻辑。2、你能说出常用复合门电路的种类吗？它们的功能如何？答：常用的复合门有与非门、或非门、与或非门、异或门和同或门。其中与非门的功能是“有0出1，全1出0”；或非门的功能是“有1出0，全0出1”；与或非门的功能是“只要1个与门输出为1，输出为0，两个与门全部输出为0时，输出为1”；异或门的功能是“相异出1，相同出0”；同或门的功能是“相同出1，相异出0”。3、TTL与非门闲置的输入端能否悬空

14、处理？CMOS与非门呢？答：TTL与非门闲置的输入端一般也不要悬空处理，但当外界干扰较小时，就可以把闲置的输入端悬空处理；而CMOS与非门闲置的输入端是不允许悬空处理的。4、试述TTL与非门和OC门、三态门的主要区别是什么？答： TTL与非门采用的推挽输出，通常不允许将几个同类门的输出端并联起来使用，正常情况下，TTL与非门输出对输入可实现与非逻辑；集电极开路的TTL与非门又称为OC门，多个OC门的输出端可并联起来使用，实现“线与”逻辑功能，还可用作与或非逻辑运算等；三态门和TTL与非门相比，结构上多出了一个使能端，让使能端处有效状态时，三态门与TTL与非门功能相同，若使能端处无效态，则三态门

15、输出呈高阻态，这时无论输入如何，输出均为高阻态。5、若把与非门、或非门、异或门当做非门使用时，它们的输入端应如何连接？答：若把与非门做非门使用，只需将与非门的输入端并联起来即可；若把或非门当做非门使用，只需把其它输入端接地，让剩余的一个输入端作非门输入即可；若把异或门当做非门使用，只需把其它输入端接高电平，让剩余的一个输入端作非门输入即可。6、提高CMOS门电路的电源电压可提高电路的抗干扰能力，TTL门电路能否这样做？为什么？答：TTL门电路是不能采取提高电源电压的方式来提高电路抗干扰能力的。因为，TTL集成电路的电源电压是特定的，其变化范围很窄，通常在4.55.5V。五、分析题1、已知输入信

16、号A、B的波形和输出Y1、Y2、Y3、Y4的波形如图2.5.1所示，试判断各为哪种逻辑门，并画出相应逻辑门图符号,写出相应逻辑表达式。ABY1Y3Y2图2.46 2.5.1检测题波形图Y4tttttt解：观察图示波形，判断出Y1是与门；Y2是异或门；Y3是与非门；Y4是同或门。它们相应的图符号如下：&Y1AB&Y3AB=1Y2AB=1Y4ABY3ABY1ABY2ABY4AB 图2.47 题2.5.2电路与波形图LABCD2、电路如图2.47（a）所示，其输入变量的波形如图（b）所示。试判断图中发光二极管在哪些时段会亮。（7分）解：由电路图可得，当L为低电平时，发光二极管会亮，图中列真值表分析：

17、ABCDABCDL0000001000100100100010011010010000101010010110001011000110000011001001101000110110011100100110110011101001111110发光管在t1t2期间、t5t6期间会亮。3、试写出图2.48所示数字电路的逻辑函数表达式，并判断其功能。（8分）解：电路的逻辑函数表达式为：列真值表：ABCF00000010010001111000101111011111输入变量中有两个或两个以上为1时，输出才为1，因此电路功能为多数表决器电路。第3单元 能力训练检测题 一、填空题： 1、能将某种特定信息

18、转换成机器识别的 二进 制数码的 组合 逻辑电路，称之为 编码 器；能将机器识别的 二进 制数码转换成人们熟悉的 十进 制或某种特定信息的 组合 逻辑电路，称为 译码 器。 2、在多数数据选送过程中，能够根据需要将其中任意一路挑选出来的电路，称之为 数据选择 器，也叫做 多路 开关。3、74LS147是 10 线 4 线的集成优先编码器；74LS148芯片是 8 线 3 线的集成优先编码器。4、74LS148的使能端 为低电平 时允许编码；当 1 时各输出端及、均封锁，编码被禁止。5、两片集成译码器74LS138芯片级联可构成一个 4 线 16 线译码器。6、LED是指 半导体 数码管显示器件

19、。二、判断正误题1、组合逻辑电路的输出只取决于输入信号的现态。 （ 对 ）2、3线8线译码器电路是三八进制译码器。 （ 错 ）3、已知逻辑功能，求解逻辑表达式的过程称为逻辑电路的设计。 （ 对 ）4、编码电路的输入量一定是人们熟悉的十进制数。 （ 错 ）5、74LS138集成芯片可以实现任意变量的逻辑函数。 （ 错 ）6、组合逻辑电路中的每一个门实际上都是一个存储单元。 （ 错 ）7、共阴极结构的显示器需要低电平驱动才能显示。 （ 错 ）8、只有最简的输入、输出关系，才能获得结构最简的逻辑电路。 （ 对 ）三、选择题1、下列各型号中属于优先编译码器是（ C ）。A、74LS85 B、74LS1

20、38 C、74LS148 D、74LS482、七段数码显示管TS547是（ B ）。A、共阳极LED管 B、共阴极LED管 C、共阳极LCD管 D、共阴极LCD管3、八输入端的编码器按二进制数编码时，输出端的个数是（ B ）。A、2个 B、3个 C、4个 D、8个4、四输入的译码器，其输出端最多为（ D ）。A、4个 B、8个 C、10个 D、16个5、当74LS148的输入端按顺序输入时，输出为（ C ）。A、101 B、010 C、001 D、1106、译码器的输入量是（ A ）。A、二进制 B、八进制 C、十进制 D、十六进制7、编码器的输出量是（ A ）。A、二进制 B、八进制 C、十

21、进制 D、十六进制四、简述题1、试述组合逻辑电路的特点？答：组合逻辑电路的特点是：任意时刻，电路输出状态仅取决于该时刻的输入状态。2、分析组合逻辑电路的目的是什么？简述分析步骤。答：分析组合逻辑电路，目的就是清楚该电路的功能。分析步骤一般有以下几个步骤：根据已知逻辑电路图写出相应逻辑函数式；对写出的逻辑函数式进行化简。如果从最简式中可直接看出电路功能，则以下步骤可省略；根据最简逻辑式写出相应电路真值表，由真值表输出、输入关系找出电路的功能；指出电路功能。3、何谓编码？二进制编码和二十进制编码有何不同？ 答：编码就是将人们熟悉的十进制数或某个特定信息用相应的高、低电平输入，使输出转换成机器识别的

22、十进制代码的过程。二进制编码就是以自然二进制码进行代码编制，而二十进制编码则是用多位二进制数码表示1位十进制数码的代码编制。4、何谓译码？译码器的输入量和输出量在进制上有何不同？答：译码就是把机器识别的二进制码译为人们熟悉的十进制码或特定信息的过程。以二十进制译码为例，译码器的输入量是十进制代码，输出量是人们熟悉的十进制。五、分析题1、根据表3-15所示内容，分析其功能，并画出其最简逻辑电路图。表3-15 组合逻辑电路真值表输 入输 出A B CF0 0 010 0 100 1 000 1 101 0 001 0 101 1 001 1 11分析：从真值表输入、输出关系可写出相应逻辑函数式为：

23、 显然，电路输入相同时，输出才为1，否则为0。因此该电路是一个三变量一致电路。&1=1AFBCD(a)11&AFBC1(b)图3.45 题3.5.2逻辑电路2、写出图3.45所示逻辑电路的最简逻辑函数表达式。分析：（a）图的逻辑函数式为：（b）图的逻辑函数式为：六、设计题1、画出实现逻辑函数的逻辑电路。设计：对逻辑函数式进行化简： 根据上述最简式可画出逻辑电路为：&1ABC&F2、设计一个三变量的判偶逻辑电路，其中0也视为偶数。设计：根据题目要求写出逻辑功能真值表如下;A B CF0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 110010110根据真值表写出逻辑

24、函数式并化简为最简与或式如下： &1ABCF111&3、用与非门设计一个三变量的多数表决器逻辑电路。（10分）设计：根据题目要求写出逻辑功能真值表如下：A B CF0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 100010111根据真值表写出逻辑函数式并化简为最简与或式如下： 根据上述最简式画出相应逻辑电路图如下：ABC&F&4、用与非门设计一个组合逻辑电路，完成如下功能：只有当三个裁判（包括裁判长）或裁判长和一个裁判认为杠铃已举起并符合标准时，按下按键，使灯亮（或铃响），表示此次举重成功，否则，表示举重失败。设计：根据题意取三个裁判分别为输入变量A、B、C，A

25、为裁判长，设按下按键输入为1，否则为0，举重成功为1，举重失败为0，据题意列出相应真值表如下：A B CF0 0 00 0 10 1 00 1 11 0 01 0 11 1 01 1 100000111根据真值表写出逻辑函数式并化简为最简与或式如下： 根据上述最简式画出相应逻辑电路图如下：ABC&F&第4单元 能力训练检测题 一、填空题1、两个与非门构成的基本RS触发器的功能有 置0 、 置1 和 保持 。电路中不允许两个输入端同时为 低电平 ，否则将出现逻辑混乱。2、通常把一个CP脉冲引起触发器多次翻转的现象称为 空翻 ，有这种现象的触发器是 钟控的RS 触发器，此类触发器的工作属于 电平

26、触发方式。3、为有效地抑制“空翻”，人们研制出了 边沿 触发方式的 主从型JK 触发器和 维持阻塞型D 触发器。4、JK触发器具有 置0 、 置1 、 保持 和 翻转 四种功能。欲使JK触发器实现的功能，则输入端J应接 高电平1 ，K应接 高电平1 。5、D触发器的输入端子有 1 个，具有 置0 和 置1 的功能。6、触发器的逻辑功能通常可用 特征议程 、 状态转换图 、 功能真值表 和 时序波形图 等多种方法进行描述。7、组合逻辑电路的基本单元是 门电路 ，时序逻辑电路的基本单元是 触发器 。8、JK触发器的次态方程为 Qn+1=j Qn+K Qn ；D触发器的次态方程为 Qn+1= Dn

27、。9、触发器有两个互非的输出端Q和，通常规定Q=1，=0时为触发器的 1 状态；Q=0，=1时为触发器的 0 状态。10、两个与非门组成的基本RS触发器，正常工作时，不允许 0 ，其特征方程为 ，约束条件为 。11、钟控的RS触发器，在正常工作时，不允许输入端R=S= 1 ，其特征方程为 ，约束条件为 SR=0 。12、把JK触发器 两个输入端子连在一起作为一个输入 就构成了T触发器，T触发器具有的逻辑功能是 保持 和 翻转 。13、让 T 触发器恒输入“1”就构成了T触发器，这种触发器仅具有 翻转 功能。二、正误识别题1、仅具有保持和翻转功能的触发器是RS触发器。 （ 错 ）2、基本的RS触

28、发器具有“空翻”现象。 （ 错 ）3、钟控的RS触发器的约束条件是：RS=0。 （ 错 ）4、JK触发器的特征方程是：。 （ 错 ）5、D触发器的输出总是跟随其输入的变化而变化。 （ 对 ）6、CP=0时，由于JK触发器的导引门被封锁而触发器状态不变。 （ 对 ）7、主从型JK触发器的从触发器开启时刻在CP下降沿到来时。 （ 对 ）8、触发器和逻辑门一样，输出取决于输入现态。 （ 错 ）9、维持阻塞D触发器状态变化在CP下降沿到来时。 （ 错 ）10、凡采用电位触发方式的触发器，都存在“空翻”现象。 （ 错 ）三、选择题1、仅具有置“0”和置“1”功能的触发器是（ C ）。A、基本RS触发器

29、B、钟控RS触发器 C、D触发器 D、JK触发器2、由与非门组成的基本RS触发器不允许输入的变量组合为（ A ）。A、00 B、01 C、10 D、113、钟控RS触发器的特征方程是（ D ）。A、 B、C、 D、4、仅具有保持和翻转功能的触发器是（ B ）。A、JK触发器 B、T触发器 C、D触发器 D、T触发器5、触发器由门电路构成，但它不同门电路功能，主要特点是具有（ C ）A、翻转功能 B、保持功能 C、记忆功能 D、置0置1功能6、TTL集成触发器直接置0端和直接置1端在触发器正常工作时应（ C ）A、=1，=0 B、=0，=1C、保持高电平“1” D、保持低电平“0”7、按触发器触

30、发方式的不同，双稳态触发器可分为（ C ）A、高电平触发和低电平触发 B、上升沿触发和下降沿触发C、电平触发或边沿触发 D、输入触发或时钟触发8、按逻辑功能的不同，双稳态触发器可分为（ D ）。A、RS、JK、D、T等 B、主从型和维持阻塞型C、TTL型和MOS型 D、上述均包括9、为避免“空翻”现象，应采用（ B ）方式的触发器。A、主从触发 B、边沿触发 C、电平触发10、为防止“空翻”，应采用（ C ）结构的触发器。A、TTL B、MOS C、主从或维持阻塞四、简述题1、时序逻辑电路的基本单元是什么？组合逻辑电路的基本单元又是什么？答：时序逻辑电路的基本单元是触发器，组合逻辑电路的基本单

31、元是门电路。2、何谓“空翻”现象？抑制“空翻”可采取什么措施？答：在时钟脉冲CP1期间，触发器的输出随输入发生多次翻转的现象称为空翻。抑制空翻的最好措施就是让触发器采取边沿触发方式。3、试分别写出钟控RS触发器、JK触发器和D触发器的特征方程。答：钟控RS触发器的特征方程：，SR=0（约束条件）；JK触发器的特征方程：； D触发器的特征方程：Q n +1= D n。4、你能否推出由两个或非门组成的基本RS触发器的功能？写出其真值表。或非门构成的基本RS触发器1门1RS1门2答：由两个或非门组成的基本RS触发器如图所示，其功能与钟控RS触发器相同，所不同点是或非门构成的基本RS触发器是电平触发方

32、式，没有时钟脉冲控制。功能真值表也与钟控RS触发器完全相同。五、分析题1、已知TTL主从型JK触发器的输入控制端J和K及CP脉冲波形如图4.23所示，试根据它们的波形画出相应输出端Q的波形。CPJK图4.23 题4.5.1波形图CPJKQ解：2、写出图4.24所示各逻辑电路的次态方程。解：（a）图： （b）图： （c）图：（d）图： （e）图： （f）图：1D C1QACP（a）1D C1QCP（b）1D C1QCP（c）1J C11KQ1CP（d）图4.24 题4.5.2逻辑图1J C11KQCP（e）1J C11KQCP（f）3、分析图4.25所示逻辑功能。图4.25解：（1） 驱动方程：

33、J0=1 , K0=1= （2）状态方程： （3）输出方程：Y=（4）状态转换图 (右图所示)：（5）功能：同步的、穆尔型的、四进制加法器。4、电路如图4.26所示：(1) 图示电路中采用什么触发方式；(2) 分析下图所示时序逻辑电路，并指出其逻辑功能；(3) 设触发器初态为0，画出在CP脉冲下Q0和Q1的波形。JCPQCQ0Q1KJQCK“1”图4.26 题4.5.4逻辑图解：JK触发器采用的都是边沿触发方式；分析电路：电路驱动方程：J0K01，J1K1Q0，将驱动方程代入触发器的特征方程可得：，。功能真值表：Q1n Q0nQ1n+1 Q0n+10 00 10 11 01 01 11 10

34、0由功能真值表可看出，这是一个2位四进制加计数器。电路初态为0，画出其时序波形图如下：CPQ0Q1第5单元 能力训练检测题 一、填空题1、时序逻辑电路通常由 组合逻辑电路 和 存储电路 两部分组成。2、根据时序逻辑电路按各位触发器接受 时钟脉冲控制 信号的不同，可分为 同 步时序逻辑电路和 异 步时序逻辑电路两大类。3、通常用 驱动方程 、 状态方程 和 输出方程 来描述时序逻辑电路。4、时序逻辑电路按照各位触发器触发器的时钟脉冲是否相同可分为 同步时序逻辑电路 和 异步时序逻辑电路 两大类。5、时序逻辑电路中仅有存储电路输出时，构成的电路类型通常称为 莫尔 型时序逻辑电路；如果电路输出除存储

35、电路输出外，还包含组合逻辑电路输出端时，构成的电路类型称为 米莱 型时序逻辑电路。6、可以用来暂时存放数据的器件称为 寄存器 ，若要存储4位二进制代码，该器件必须有 4位 触发器。7、时序逻辑电路中某计数器中的无效码若在开机时出现，不用人工或其它设备的干预，计数器能够很快自行进入 有效循环体 ，使无效码不再出现的能力称为 自启动 能力。8、若构成一个六进制计数器，至少要采用 三 位触发器，这时构成的电路有 6 个有效状态， 2 个无效状态。9、移位寄存器除有 存储代码 的功能外，还有 移位 功能。10、用四位移位寄存器构成环行计数器时，有效状态共有 4 个；若构成扭环计数器时，其有效状态是 8

36、 个。11、寄存器是可用来存放数码、运算结果或指令的电路，通常由具有存储功能的多位 触发 器组合起来构成。一位 触发 器可以存储1个二进制代码，存放n个二进制代码的寄存器，需用n位 触发 器来构成。12、74LS194是典型的四位 TTL 型集成双向移位寄存器芯片，具有 左移和右移 、并行输入、 保持数据 和 清除数据 等功能。13、通常模值相同的同步计数器比异步计数器的结构 复杂 ，工作速度 快 。二、判断题1、集成计数器通常都具有自启动能力。 （对）2、使用3个触发器构成的计数器最多有8个有效状态。 （对）3、同步时序逻辑电路中各触发器的时钟脉冲CP不一定相同。 （错）4、利用一个74LS

37、90可以构成一个十二进制的计数器。 （错）5、用移位寄存器可以构成8421BCD码计数器。 （错）6、555电路的输出只能出现两个状态稳定的逻辑电平之一。 （对）7、施密特触发器的作用就是利用其回差特性稳定电路。 （错）8、莫尔型时序逻辑电路，分析时可以不写输出方程。 （对）9、十进制计数器是用十进制数码“09”进行计数的。 （错）10、利用集成计数器芯片的预置数功能可获得任意进制的计数器。 （对）三、选择题1、描述时序逻辑电路功能的两个必不可少的重要方程式是（ B ）。A、次态方程和输出方程 B、次态方程和驱动方程 C、驱动方程和时钟方程 D、驱动方程和输出方程2、用8421BCD码作为代码的十进制计数器，至少需要的触发器个数是（ C ）。A、2 B、3 C、4 D、53、按触发器状态转换与时钟脉冲CP的关系分类，计数器可分为（ A ）两大类。A、同步和异步 B、加计数和减计数 C、二进制和十进制4、能用于脉冲整形的电路是（ C ）。A、双稳态触发器 B、单稳态触发器 C、施密特触发器5、由3级触发器构成的环形和扭环形计数器的计数模值依次为（ D ）。A、模6和模3 B、模8和模8 C、模6和模8 D、模3和模66、下列叙述正确的是（ D ）A、译码器属于时序逻辑电路 B、寄存器属于组合逻辑电路