计算机组织与结构复习参考题(共22页).doc

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1、精选优质文档-倾情为你奉上计算机组织与结构复习参考题1 一、 选择题 1. 中央处理器（CPU）是指_。A运算器 B控制器 C运算器和控制器 D运算器、控制器和主存储器2. 假定对字符码ll00101做偶校验，没有数据错误，来用做偶校验的字符码是_。 All B1ll00101 C0ll00101 Dll00l0l03. 补码运算的特点是符号位_。A与数值位分别进行运算 B与数值位一起参与运算 C要舍去 D表示溢出4. EPROM是指_。A.只读存储器 B.读写存储器 C.闪速存储器 D.光擦除可编程只读存储器5. 常用的虚拟存储系统由_两级存储器组成，其中辅存是大容量的磁表面存储器。A.ca

2、che主存 B.主存辅存 C.cache辅存 D.通用寄存器主存6. 关于浮点数加、减法，以下论述正确的是_。A对阶时较小的数进行左移 B对阶时较小的数进行右移 C对阶时大阶向小阶对齐左移 D对阶时小阶向大阶对齐右移7. 假设寄存器R中的数值为200，主存地址为200和300的地址单元中存放的内容分别是300和400，则什么方式下访问到的操作数为200 。 A. 直接寻址200 B. 寄存器间接寻址(R) C. 存储器间接寻址(200) D. 寄存器寻址R8. 有关逻辑左移中，说法正确的是_ 。A数据左移1位，最低位用0补充 B数据左移1位，最低位用1补充 C数据左移1位，最高位用原最低位补充

3、 D数据左移1位，最高位用原最高位补充9. 某计算机字长16位，它的存贮容量是64KB，若按字编址，那么它的寻址范围是_A. 064K B. 064KB C. 032K D. 032kB10. 为确定下一条微指令的地址，通常采用断定方式，其基本思想是_。A.用程序计数器PC来产生后继微指令地址B.用微程序计数器PC来产生后继微指令地址C.通过微指令顺序控制字段由设计者指定或由设计者指定的判别字段控制产生后继微指令地址D.通过指令中指定一个专门字段来控制产生后继微指令地址11. 在流水机器中，控制相关是指_。A由转移指令引起的相关 B先写后读 C资源使用冲突 D先读后写12. 若存储周期250n

4、s，每次读出32位，则该存储器的数据传送率为 。 A. 8106字节/秒 B. 8M字节/秒 C.16106字节/秒 D. 16M字节/秒13. 在一个串行传输系统中，每秒钟可传输80个数据帧，每个数据帧包含1个起始位、8个数据位和2个结束位，其波特率为 _，A. 880B/S B. 640B/S C. 880b/S D. 1640b/S 14. 阵列并行处理机主要实现的是 。A取指级并行 B 译码级并行C执行级并行 D指令内操作步骤并行15. 总线是构成计算机系统的互联机构，是多个系统功能部件之间进行数据传送的_通道。A高速 B专有 C特殊 D公共 二、判断题（正确的在题后括号内划“”，错误

5、的划“”。 ）1. 在机器数中，零的原码表示形式是唯一的（ ）。2. Cache存储器是为解决主存速度满足不了要求发展出来的（ ）。3. 高位多体交叉编址方式:连续地址公布在相同的模块内，而同一模块内的地址都是连续的（ ）。4. 使编码具有检错和纠错能力的代价是增加了冗余位，比如CRC码（ ）。5. 双符号位补码运算的结果符号位为01，则运算结果负溢出（ ）。6. 微程序存放在主存储器中，微地址存放在程序寄存器PC中（ ）。7. 水平型微指令的直接表示法比编码表示法执行速度快（ ）。8. 利用流水技术容易有效减少每一条指令的执行时间（ ）。9. Tomasulo算法能解决数据相关性和控制相关性

6、（ ）。10. 标量流水线方式计算机不能对向量数组进行运算（ ）。三、已知X=（1101）2 , Y=（+0011）2 , 用补码一位乘法（Booth算法 ）计算X*Y补。 五、设有一台计算机的指令系统共有10条指令，他们的使用频率分别为：0280200170100080060050030020011. 用霍夫曼编码设计这10条指令的操作码；2. 若操作码采用固定长度编码，需要多少位？其后继产品需要增加10条指令，并与原来指令保持兼容，操作码应该扩展到多少位？后10条指令应怎样编码？ 六、设一个具有26位地址和16位字长的主存储器，用8M8位的存储芯片构成。地址线A，数据线D，读写控制信号端W

7、E，CE为片选控制端，MREQ为CPU的访存请求信号端。 1. 该主存储器能存储多少字节信息？2. 该主存储器需要由多少个8 M8位存储器芯片构成？ 3. 需要多少位地址作为芯片选择？4. 完整画出用8 M8位存储器芯片构成主存储器的逻辑示意图。用存储器芯片构成主存储器的逻辑示意图七、（9分）某单总线结构计算机的数据通路如图下所示，读存储器数据到寄存器的指令为 LOAD R1 ，mem (其中mem为内存地址)，1.请写出该指令操作在各个机器周期所需的控制信号。2.写出微指令的格式，说明每段代表的含义。 单总线结构计算机的数据通路示意图八、在一个无序执行按序写回的超标量指令流水线中，如下图所示

8、。将指令的执行过程分为取指、译码、执行、写回四个阶段。取指、译码、写回只需1个机器周期完成。加法器完成执行需要2个机器周期，乘法器完成执行需要3个机器周期，给定地址mem1和mem2的访存操作需要1个机器周期。具有相关专用通路。现有如下6条指令序列：LOAD R1，mem1 ；I1 M（mem1）存储单元的内容送入R1ADD R2，R2，R1 ；I2ADD R3，R3，R4 ；I3MULT R4，R4，R5 ；I4LOAD R6，mem2 ；I5MULT R6，R6，R7 ；I61.指出指令序列中的写后读RAW，读后写WAR，写后写WAW数据相关性；2.画出无序执行按序写回的超标量指令流水线时

9、空图。超标量指令流水线模型结构计算机组织与结构复习参考题2 一、选择题（每题1分，共20分）1. 完整的计算机系统是由_组成的。 A主机与外设 BCPU与存储器 CALU与控制器 D硬件系统与软件系统2. 下列数中最小的数为_ 。 ABCD B528 C D233163. 若采用双符号位，则发生负向溢出的特征是：双符号位为_。A、00 B、01 C、10 D、114. 统计计算机性能测试结果有多种方法，其中_最接近CPU的实际性能。 A. 算术性能平均值 B. 几何性能平均值 C. 调和性能平均值 D. 峰值性能指标5. 有关算术右移中，说法正确的是_。 A数据右移1位，最高位用0补充 B数据

10、右移1位，最高位用1补充 C数据右移1位，最高位用原最低位补充 D数据右移1位，最高位用原最高位补充6. 关于浮点数加、减法，以下论述正确的是_。 A对阶时较小的数进行左移 B对阶时小阶向大阶对齐 C对阶时大阶向小阶对齐 D对阶时较大的数进行左移 7. 寄存器间接寻址方式中，操作数处在_。 A通用寄存器 B主存单元 C程序计数器 D堆栈8. 堆栈指针SP的内容是_。A栈顶单元内容 B栈顶单元地址 C栈底单元内容 D栈底单元地址9. 有关高速缓冲存储器Cache的说法，正确的是_。 ACPU内外都可以设置Cache BCache只能在CPU以外C若存在Cache，CPU就不能再访问内存 DCac

11、he只能在CPU以内 10. 存储周期是指_。 A存储器的读出时间 B存储器的写入时间 C存储器进行连续读和写操作所允许的最短时间间隔 D存储器进行连续写操作所允许的最短时间间隔11. PROM是指_。 A随机读/写存储器 B只读存储器 C可编程的只读存储器 D可擦可编程的只读存储器12. 有一个1K*8b存储器，采用单译码方式时需要译码器输入线为_条。A1024 B10 C32 D6413. 程序员编写程序时使用的地址是_。 A逻辑地址 B有效地址 C辅存实地址 D主存地址14. 在CPU中跟踪指令后继地址的寄存器是_。 A主存地址寄存器 B状态条件寄存器 C指令寄存器 D程序计数器15.

12、在流水机器中，真相关是指_。A先读后写相关 B结构相关 C先写后读相关 D有转移指令引起的相关16. 微程序控制器中，机器指令与微指令的关系是_。A. 每一条机器指令由一条微指令来执行B. 每一条机器指令由一段微指令编写的微程序来解释执行C. 每一条机器指令组成的程序可由一条微指令来执行D. 一条微指令由若干条机器指令组成17. 数据总线上的信息可以在两个方向上轮流传输信息的方式称为_。 A单工 B全双工 C半双工 D不可能方式18. 主机、外设不能并行工作的方式是_。 A程序查询方式 B中断方式 CDMA方式 D通道方式19. 阵列计算机属于_结构的计算机。 ASISDI BSIMD CMI

13、SD DMIMD20. 在I/O设备采用统一编址方式下，下面哪一个说法是对的_。 A一个具体地址只能对应输入/输出设备 B一个具体地址只能对应内存单元 C一个具体地址既可对应输入/输出设备又可对应内存单元 D一个具体地址只对应输入/输出设备或者只对应内存单元二、填空题（1. 评价存储器性能的基本要求是大容量、_和低价格。2. 十进制数据7的五位移码表示为_ 。3. 信息码的奇校验编码是_，偶校验编码是_（设校验位在最低位）。 4. 在减法运算中，正数减去_，可能产生溢出，此时的溢出为_溢出。 5. 在一个单地址指令的计算机系统中有一个累加器，（20H）=30H，（30H）=40H，执行指令 l

14、oad #30H 后，累加器中的数值为_；执行指令 load （20H） 后，累加器中的数值为_。6. 段页式虚拟存储器的内部地址表映像机构包含有段基址表、_表和_表三部分。7. 寄存器直接寻址是操作数在_中，寄存器间接寻址是操作数在主存单元中，通用寄存器中的内容作为操作数地址，所以指令执行的速度前者比后者_。 8. 在一个32位总线中，时钟频率为20MHZ，总线数据的传输周期为5个时钟传输4个字的数据块，总线数据的传输速率为_。五、 有一个cache主存存储层次，采用组相联映像。主存共分4096个存储块，Cache为64个存储块，每组包含4个存储块，每块由128个字节组成，访存地址为字节地址

15、。1 写出Cache地址位数和地址格式；2 写出主存地址位数和地址格式；3 画出主存cache空间块的组相联映像对应关系示意图；4 主存地址48AB9H映像到Cache的哪个字块？ 六、 用4M8位的存储芯片构成一个64M16位的主存储器。地址线A，数据线D，读写控制信号端WE，CE为片选控制端，MREQ为CPU的访存请求信号端。5. 计算需要多少个4 M8位存储器芯片。 6. 存储器芯片的片内地址长度是多少位？7. 在下图中标明主存储器地址线和数据线各需要多少位？8. 完整画出用存储器芯片构成主存储器的逻辑示意图。用存储器芯片构成主存储器的逻辑示意图七、 对于单总线CPU结构，指令控制流程如

16、下图所示：1 该指令系统总共有多少条微指令？2 在指令控制流程图中每个方框的左上角标出微地址。3写出微指令的格式，说明每段代表的含义。八、 在一台计算机中，指令的执行分为取指IF、译码ID、执行EX、访存M和写回WB五个阶段，每个阶段在一个机器周期只能接受一个新任务，取指阶段不受指令类型和相关性的影响。具有前向传递专用数据通路，在前向传递专用数据通路不能解决数据相关问题时，这时可以在流水线中插入气泡。对以下指令序列:sub r2,r1,r3 /*s1*/lw r4,20(r2) /*s2*/and r2,r4,r5 /*s3*/and r1,r6,r3 /*s4*/画出有序执行有序写回的时空图

17、，指出所需的执行时间。根据IEEE754标准规定的32位单精度浮点数的表示方法，写出(3.25)10这个数的单精度浮点标准格式（写明解题过程）。假设寄存器R中的数值为2000H，地址为2000H的存储器中存储的数据为3000H，地址为3000H的存储器中存储的数据为2200H，PC的值为4000H，以下寻址方式下访问到的指令操作数是什么？1. 寄存器间接寻址 （R）；2. 存储器间接寻址 2000H；3. 立即数寻址 #2000H；4. 相对寻址 -1000H（PC）；有一个cache主存存储层次。主存共分8个块，Cache为4个块，。采用组相联映像，组内块数为2块，替换算法为近期最少使用法（

18、）。1. 对于如下主存块地址流的访问顺序是：4、1、2、4、3、7、0、7、2、5 cache初始时为空，请列出cache 中各块随时间的使用情况；2. 对于第1问，指出块失效又发生争用（即替换）的时刻；3. 对于第1问，求出此期间cache的命中率。 某单总线结构计算机的数据通路如图6-1所示，请写出指令 1ADD R1，（R2 ）；M(R2)+(R1)=R1 在每个时钟周期内的控制信号。2微指令控制字段的编码顺序如图6-2所示，采用水平型直接表示法，写出T1和T3 周期微操作的控制字。 图6-1图6-2设有一台计算机的指令系统共有10条指令，他们的使用频率分别为：0.19, 0.12, 0

19、.10, 0.13, 0.17, 0.03, 0.02, 0.15, 0.08, 0.01。1. 用霍夫曼编码设计这10条指令的操作码，并计算操作码的平均长度；2. 设计两种编码长度，且平均长度不超过3.2位的等长扩展操作码，并计算操作码平均长；3. 若操作码为固定长度编码，需要多少位？其后继产品需要增加18条指令，并与原来指令保持兼容，操作码应该扩展到多少位？计算机组织与结构复习参考题3 一、选择填空 1.若十进制数为32.75，则相应的十六进制数为( )。A 4.6 B 2.c C 2.6 D 4.c2.若x=+1011，则x补=( )。A 01011 B 1011 C 0101 D 10

20、1013.某机器字长8位，含一位符号位，采用原码表示定点小数，则所能表示的非零最小正数为( )。A 2-9 B 2-8 C 1-2-7 D 2-74. 假定下列字符码中有奇偶校验位，但没有数据错误，来用偶校验的字符码是_。 A ll B C ll00000l D ll00l00l5.一般来讲，直接映像方式常用在( )。A 小容量高速Cache B 大容量高速Cache C 小容量低速Cache D 大容量低速Cache6. 在CPU中跟踪指令后继地址的寄存器是( )。 A 主存地址寄存器 B 程序计数器 C 指令寄存器 D 状态条件寄存器7.采用存储器直接寻址方式，则操作数在( )中。A 主存

21、 B 寄存器 C 直接存取存储器 D 光盘在下列存储器中，( )可以作为主存储器。A 半导体SRAM存储器 B EPROM C PROM D 半导体RAM存储器同步控制是_。 A 只适用于CPU控制的方式 C 只适用于外围设备控制的方式 B 由统一时序信号控制的方式 D 所有指令执行时间都相同的方式采用DMA方式传送数据时，每传送一个数据就要占用_的时间。 A一个指令周期 B一个机器周期 C一个存储周期 D一个总线周期1 响应中断（3 ） 可在任一时钟周期结束时 可在任一工作周期结束时 必须在一条指令执行完毕时 必须在执行完当前程序段时2 外部接口是（2 ）的逻辑部件 CPU与系统总线之间 系

22、统总线与外部设备之间 主存与外围设备之间 运算器与外围设备之间3 串行接口是指（ 2 ） 接口与系统总线之间采取串行传送 接口与外围设备之间采取串行传送 接口与两侧采取串行传送 接口内部只能串行传送4 并行接口是指（2 ） 接口与系统总线之间采取 接口与外围设备之间采取并行传送 系统总线采用并行传送 接口采用中断方式5 下列设备中，哪种适于通过DMA方式与主机进行信息交换（4）。 键盘 电传输入机 针式打印机 磁盘6 中断屏蔽字的作用是（ 2 ） 暂停外设对主存的访问 暂停对某些中断的响应 暂停对一切中断的响应 暂停CPU对主存的访问7 向量中断的向量地址是（3 ） 通过软件查询产生 由中断总

23、服务程序统一产生 由中断源硬件提供 由处理程序直接查表获得8 在打印机接口中，一般采用（1） 中断方式 方式 通道方式 方式9 在磁盘中（4） 只采取查询等待方式只采取程序中断方式 只采取方式既有方式，也有中断方式10 在下列外存储器中，工作速度最快的是（ 3 ）（1）磁带 （2）软盘 （3）硬盘 （4）光盘二、已知：x= 0.1011，y = - 0.0101，求 ： x补， - x 补，y补， - y 补 ，x - y 补 ，并说明 x - y 补 的结果是否溢出。 三、CPU执行一段程序时，cache完成存取的次数为1900次，主存完成存取的次数为100次，已知cache存取周期为50n

24、s，主存存取周期为250ns，求cache/主存系统的效率和平均访问时间。 四、由1K X 4位的动态RAM芯片构成（芯片内是6464 结构），试解答如下问题： （3）采用异步方式，如单元刷新间隔不超过2ms，则刷新信号周期是多少？ （4）如采用集中式刷新方式，存储器刷新一遍最少用多少个读/写周期？五、设有一个cache的容量为2K字，每个块为16字，求(1) 该cache可容纳多少个块？(2) 如果主存的容量是256K字，则有多少个块？(3) 主存的地址有多少位？cache地址有多少位？(4) 在直接映象方式下，主存中的第i块映象到cache中哪一个块中？(5) 进行地址映象时，主存储器的地

25、址分成哪几段？各段分别有多少位？六、指令格式如下所示，OP为操作码字段，试分析指令格式的特点。 15 10 7 4 3 0OP 源寄存器 基值寄存器 位移量（16位） 计算机组织与结构复习参考题41. 运算器的主要功能是进行_ _ 。A、逻辑运算 B、算术运算 C、逻辑运算与算术运算 D、初等函数的运算2. 若定点整数64位，含1位符号位，补码表示，则所能表示的绝对值最大负数为（ ）。A、-264 B、-（264-1） C、-263 D、-（263-1）3. 有关算术右移中，说法正确的是_ _。 A数据右移1位，数据最高位用0补充 B数据右移1位，数据最高位用原最低位补充 C数据右移1位，数据

26、最高位用符号位补充 D数据右移1位，数据最高位用1补充4. 堆栈指针SP寄存器中的内容是_ _。A栈顶单元内容 B栈顶单元地址 C栈底单元内容 D栈底单元地址5. 设形式地址为D，基址寄存器为X，变址寄存器为Y，（X）表示基址寄存器X的内容，基址变址寻址方式的有效地址可表示为_ _。AEA=（X）+（Y）+D BEA=（X+Y）+（D）CEA=（X）+(Y)+D） DEA=（X+Y）+（D）6. 寄存器间接寻址方式中，操作数处在_中。A.通用寄存器 B.主存单元 C.程序计数器 D.堆栈7. 存储周期是指_ _。 A存储器的读出时间 B存储器的写入时间 C存储器进行连续读或写操作所允许的最短时

27、间间隔 D存储器进行连续写或写操作所需的最长时间间隔8. 在下列存储器中，_ _可以作为主存储器。A.半导体SRAM存储器 B.EPROM C.PROM D.半导体DRAM存储器9. 微程序控制器中，机器指令与微指令的关系是_ _。A、每一条机器指令由一段微指令编写的微程序来解释执行B、每一条机器指令由一条微指令来执行C、 每一条机器指令组成的程序可由一条微指令来执行D、 一条微指令由若干条机器指令组成10. 主存储器和CPU之间增加cache的目的是_。A、扩大主存贮器的容量 B、解决CPU和主存之间的速度匹配问题C、扩大CPU中通用寄存器的数量 D、既扩大主存的容量，又扩大CPU通用寄存器

28、的数量11. 在流水机器中，控制相关是指_ _。A、资源使用冲突 B、由转移指令引起的相关 C、先写后读 D、先读后写12. 系统总线中地址线的功能是_。A、选择主存单元地址 B、选择进行信息传输的设备C、选择外存地址 D、指定主存和I/O设备接口电路的地址13. 相联存贮器是按_进行寻址的存贮器。A.地址指定方式 B.堆栈存取方式 C.内容指定方式 D.地址指定与堆栈14. 下面描述的RISC机器基本概念中不正确的句子是_。A.RISC机器不一定是流水CPU B.RISC机器一定是流水CPUC.RISC机器有复杂的指令系统 D.CPU配置很少的通用寄存器15. 主机、外设不能并行工作的方式是

29、_ _。 A程序查询方式 B中断方式 CDMA方式 D通道方式一、 填空题1. 若X补=，则X的十进制数真值是_。2. (-4)10 用四位反码表示为 。3. 在一个32位总线中，时钟频率为20MHZ，总线数据的传输周期为5个时钟传输4个字的数据块，总线数据的传输速率为_。4. 微指令分成水平型微指令和垂直型微指令，_ 型微指令可同时执行若干个微操作。5. 假定对字符码ll00101做偶校验，没有数据错误，偶校验的字符码是 。6. 存储器模块采用多体交叉编址方式:同一模块内的地址都是 。7. DMA技术的出现，可以通过DMA控制器使得_ _ 与_ _之间可以进行直接访问。 8. 在典型的PCI

30、总线中“北桥”是指_ _桥，“南桥”是指_ _桥。二、 计算题 1. 假设X= - 0.1011，Y= 0.0111，采用双符号位法,计算X-Y=？同时指出是否发生“溢出”？上溢出还是下溢出？ 2. 16K8位(1281288位) DRAM芯片，设存储器的读/写周期为0.5s，CPU在1s内至少要访问一次。（1）若采用集中刷新，刷新周期最短是多长时间？（2）若采用异步刷新，刷新周期是2 ms，每隔多长时间对芯片刷新一行？（3）若采用分散式刷新，刷新周期是多长时间？3. 假设X=0.1011，Y=0.1101，用定点原码一位除法不恢复余数(加减交替法)的方法，求X/Y的商和余数。4. 设存储器容

31、量为32字，字长64位，模块数m=4，分别用顺序方式和交叉方式进行组织。存储周期T=200ns，数据总线宽度为64位，总线传送周期=50ns。问顺序存储器和交叉存储器连续读出4个字所需的时间? 三、 某计算机部分的指令助记符和指令格式如下图所示，设机器字长为8位，rs代表源寄存器，rd代表目标寄存器。（1）分析下面指令格式的特点；（2）写出指令MOV R1,R3和 INC R3 的机器指令代码。 四、 有一个cache主存存储层次。Cache为4个块。采用组相联映像，组内块数为2块，替换算法为近期最少使用法（LRU）。 1) 如下表所示，主存块地址流的访问顺序是：4，1，2，4，3，7，0，0

32、，4，7， cache初始时为空，请列出cache 中各块随时间的使用情况；2) 指出访问主存块地址时cache失效又发生争用（即替换）的访问顺序；3) 求出这段访问期间cache的命中率。访问顺序12345678910组号主存块地址4124370047Cache块地址0组1组访问情况五、 流水线结构分为4个段，即取指(IF)段、 译码(ID)段、执行(EX)段和写回(WE)段。IF，ID，WE 段只需1个时钟周期完成。EX段有多个功能部件，其中LOAD/STORE部件完成数据cache访问，只需一个时钟周期；逻辑运算和减法运算完成需2个时钟周期，乘法运算需3个时钟周期，它们都已流水化。 IE

33、段有内部数据定向传送，结果生成即可使用。 现有如下4条指令序列， l I1 LAD R0，A ；M(A)-R0，M(A)是存储器单元l I2 SUB R1，R0 ； (R1) + (R0)-R0 l I3 SHR R0，R2 ；R0的内容逻辑右移R2次再送入R0l I4 MUL R2，R3 ；(R2)(R3)-R2（1）请写出指令流水线的时空图；（2）请写出指令的相关性。 假设某计算机的指令长度为20位，具有双操作数、单操作数和无操作数三类指令形式，每个操作数地址规定用6位表示。（1）若操作码字段固定为8位，现已给出m条双操作数指令，n条无操作数指令。在此情况下，这台计算机最多可以设计出多少条

34、单操作数指令？（2）当双操作数指令条数取最大值，且在此基础上单操作数指令条数也取最大值时，试计算这三类指令最大容许具有的指令条数各是多少？这三类操作数指令编码各是什么范围？一种短浮点数的字长共16位（二进制），从高位到低位分别是：符号1位，阶码7位（包括符号位），尾数8位。尾数用原码、小数表示，阶码用移码、整数表示。尾数和阶码的基值都是2。有如下两个浮点数：A1.0001x22和B-0.11001x2-1。 (1)把这两个数分别表示成规格化浮点数形式。(2)按照浮点数加法运算规则，计算这两个浮点数的和。参考答案1一、 (15*2=30分) CDBDB BDACC ACCCD 二、 （10*1=

35、10分） 三、 （8分）第二种方法好四、 （10分） 五、(10分)1.采用Huffma树（略）、编码法 （6分）频率028020017010008006005003002001代码110110100110011000000100001长度22334445662. （4分） 固定长度4位编码，即00001001 产品再增加10条指令，要用5位编码，即1010011101六、（13分）解：1. 226*2=226*2=227B（2分）2. 需要存储器芯片： （2分）3. 需要3位地址作为芯片选择 （2分）4. 存储器芯片构成主存储器的逻辑示意图如下： （7分）七、（9分）解：（6分）n T1:PCout ,MaRin,PC+1,Readn T2:MDRout,IRinn T3:IRout,MARin,readn T4:MDRout,R1in （3分）控制字BCFBAF控制字：每一位代表一位控制信息；BCF：确定转移条件；BAF：微指令下地址 八、（10分）解：I1 I2 RAW ；I3 I4 WAR ；I5 I6 WAW RAW （4分）无序执行按序写回的超标量指令流水线时空图。（6分）IFIDEXWB