数字逻辑课程设计-电子时钟(共12页).doc
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1、精选优质文档-倾情为你奉上数字逻辑课 程 设 计 报 告题目: 数字电子钟 专业: 网络工程 班级: 14网络工程2班 组长: 钟伟邦(02) 成员: 刘雄锋(23) 惠州学院计算机科学系二一六 年 一 月 七 日目 录1 设计任务书2 总体方案设计2.1 功能和逻辑需求分析2.2 总体方案设计3 单元模块设计3.1 分秒计数器电路设计3.2 时计数器电路设计3.3总体电路设计(画出总体电路图)4 电路调试与测试4.1 时计数器4.2 分秒计数器5 总结附录(参考资料清单及元器件清单)1 设计任务书10数字电子钟(*)设计一台能显示时分、秒的数字电子钟,要求如下:1)秒分为0059六十进制计数
2、器,时为0023二十四进制计数器;2)可手动校正:分别对秒分时进行连续脉冲输入校正(校正时不能输出进位)。本次数字时钟电路设计采用GAL系列芯片来分别实现时、分、秒的24进制和60进制的循环电路,并支持手动校正的功能。2 总体方案设计用集成电路设计一台能自动显示时、分、秒的数字电子钟,只要将开关置于手动位置,可分别对秒、分、时进行手动脉冲输入调整或连续脉冲输入的校正。2.1 功能和逻辑需求分析本电路总共分为三个单元模块,分别为时,分,秒,其功能分别用于电子时钟上的时,分,秒的计算,其中,用GAL22V10设计24进制(十位为2进制,个位为4进制)的计数器用于实现时的计算功能(计数从00到23时
3、清零),用GAL16V8D设计60进制的计数器(十位为6进制,个位为10进制)用于实现分和秒的计算功能(计数从00到59时清零并向前进位),当时钟计数到23时59分59秒时,使计数器的小时部分清零,进而实现整体循环计时的功能。2.2 总体方案设计工作原理:当开关1为高电平时,在时钟信号作用下,时钟正常工作; 当开关1为低电平时,时钟停止(状态保持) 在2状态下,开关2/3/4为高电平时,时钟进入校正状态(通过时钟信号的连续输入进行校正) 3 单元模块设计3.1分、秒计数器电路设计芯片类型:GAL16V8D前后级联系:当秒计数器到达59时,秒计数器的co会输出1,所以,与之连接的时计数器的cen
4、此时输入1(分计数器进入正常工作状态),也就是说在下一个脉冲来临的时候,分计数器上的数字会加1,实现了秒到分的进位。分,秒计数器芯片代码如下:MODULE secTITLE secdeclarations clock PIN 1; cen PIN 2; adj PIN 3; co PIN 19 istype reg; q6.q4 PIN 18.16 istype reg; q3.q0 PIN 15.12 istype reg; T1=q6.q4; T0=q3.q0;equations T1.clk=clock; T0.clk=clock; WHEN cen THEN WHEN (T0=9) T
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- 数字 逻辑 课程设计 电子 时钟 12
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