模拟集成电路版图设计与验证(共5页).doc

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1、精选优质文档-倾情为你奉上电子科技大学微电子与固体电子学院标 准 实 验 报 告（实验）课程名称 模拟集成电路原理 电子科技大学教务处制表电 子 科 技 大 学实 验 报 告学生姓名： 学 号： 指导教师：实验地点：211-606 实验时间：2011-06-14一、 实验室名称：微电子技术实验室二、实验项目名称：模拟集成电路版图设计与验证三、实验学时：4四、实验原理2.2 基于Cadence 平台的电路设计与仿真2.2.1 Cadence 环境的调入1、 在 UNIX 操作系统的Terminal窗口下 setenv DISPLAY 100.100.21:0 (注意：100.100.100.21

2、是本机的IP地址，不同的计算机，IP地址不同，应该根据实际的IP地址来设置。) cd user/userxxx mkdir user/userxxx/Project cd user/userxxx/Project icfb& 或者layoutPlus&2、出现CIW(command Interpreter window)命令解释画面3、点选在CIW窗口的上面工具列ToolsLibrary Manager，会出现LM窗口LM(Library Manager)2.2.2 建立新的Library1. 点选LM窗口上面的工具列FileNewLibrary2. 会产生New Library画面3. 出现

3、右图画面 在name填上Library名称点选下面的OK4、出现Load Technology File窗口，添加工艺文件2.2.3版图设计Layout View Design1、在LM窗口用鼠标左键点选Library的hw1再点选cell的test双击view的layout两次，或是用右键open,即可开启layout窗口2、调入版图编辑器 Layout Editor 因为前面的工艺文件已设置，所以版图层选择窗口LSW应该是看到以上的画面。如果不是的话，则有可能是create library 时 technology file 没有设置对，需要重新配置3、Layout的基本操作（1）设定窗口

4、的点距(Grid)，点选Layout窗口上面的指令选项OptionDisplay（2）设定是否有Gravity的功能，点选Layout窗口的指令列OptionsLayout Editor，依照个人使用习惯与需要来选择是否Gravity On.。一般对于初学者不要设定Gravity On (重力效果)。 Gravity On：当鼠标指针靠近对象时即被吸到该对象的边缘（3）用 ruler 把长度量好, 用右键点选 LSW 中所要用的 layer, 再点选常用功能栏中的 rectangular 或 polygon 来画。（4）如果边长要纠正的话, 可使用stretch 来达成, 或者是用reshap

5、e功能。（5）若要取消指令重选新指令，最好先按Esc键。（6）Layout 时要注意layers 之间的距离(参考design rule)。（7）一段时间后应点选Layout上面的指令DesignSave做储存动作，以免意外掉电、误操作等导致已做的工作丢失。（8）用本层来定义当前层所对应的端点名称，每当打上label时，记得要点选该label，然后按q ,改变该label 的layer成当前所用层。4、NMOS和PMOS晶体管的Layout版图示2.3 版图验证1、设计规则DRC检查与验证当版图绘制完成后，需要调用版图设计规则检查DRC来验证是否违反设计规则。（1）点选Layout窗口上面的指

6、令VerifyDRC（2）出现DRC窗口（3）按OK之后，会开始跑DRC，若有错误，CIW对话框会显示错误并且在Layout窗口也会有光标marker闪烁。（4）可以点选Layout窗口上面的指令VerifyMakersExplain，然后选择Layout窗口中闪动线条，即可知所犯的错误（5）若要消除在Layout窗口闪烁的marker，点选Layout窗口上面的指令VerifyMarkersdelete all，出现下面窗口，再点选OK即可。2、根据与DRC验证类似的步骤进行版图的电气规则ERC检查。注意：如整个版图由多个分图合成，则合并版图后，即使单个的分图均通过DRC/ERC验证，也必须

7、再次进行DRC/ERC检查，往往拼接过程中会引入新的错误。五、实验目的 根据实验任务要求，综合运用课程所学知识自主完成相应的模拟集成电路版图设计，掌握基本的IC版图布局布线技巧。 学习并掌握国际流行的EDA仿真软件Cadence的使用方法，并进行版图的的设计与验证。六、实验内容1、 UNIX操作系统常用命令的使用，Cadence EDA仿真环境的调用。2、根据设计指标要求，自主完成版图设计，并掌握布局布线的基本技巧。3、对所绘制的版图进行DRC、ERC检查验证。4、整理版图生成文件，总结、撰写并提交实验报告。七、实验仪器与器材（1）工作站或微机终端 一台（2）局域网（3）EDA仿真软件 1套八

8、、实验步骤 按照实验原理的步骤进入画版图的界面，参照实验一的运算放大器的电路图进行画版图。九、实验数据及结果分析：1、 通过本次实验掌握了UNIX操作系统常用命令的使用，Cadence EDA仿真环境的调用。达到了实验目的。2、 完成了实验一的放大器的版图设计。十、实验结论：通过这次实验，学习并掌握国际流行的EDA仿真软件Cadence的使用方法，完成了实验一的放大器的版图设计。难点在于版图的格局的分派，使其占用最小的面积。十一、总结及心得体会：通过该实验，使我掌握CMOS模拟IC版图设计的流程，加深对课程知识的感性认识，增强我们的设计与综合分析能力，掌握自主进行模拟集成电路版图设计与验证的基本方法，进而为今后从事科研、开发工作打下良好基础。十二、对本实验过程及方法、手段的改进建议：无 报告评分： 指导教师签字：专心-专注-专业