抢答器设计报告(共15页).doc
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1、精选优质文档-倾情为你奉上课 程 设 计(论文)课程名称_数字电子技术基础_ 题目名称_数字式竞赛抢答器_学生学院_专业班级_ _ 学 号_学生姓名_指导教师_2014年 6 月 22 日数字式竞赛抢答器 课程设计论文一、分析问题二、查阅资料三、模块设计四、组合优化五、软件模拟六、器件选择七、电路焊接八、实验调试九、心得体会十、参考资料一、分析问题:我们共同协商最终选择了抢答器方案。根据抢答器的要求:1) 设计制作一个可容纳四组参赛的数字式抢答器,每组设置一个抢答按钮供抢答时使用且电路具有第一抢答信号的鉴别和锁存功能。2)在主持人将系统复位并发出抢答指令后,用数码管显示倒计时和第一抢答组别且该
2、组别对应指示灯亮,同时电路的自锁功能使别的抢答开关不起作用。3)对提前抢答和超时作答的组别鸣喇叭示警,并由组别电路显示出犯规组别。扩展要求:设置对应的计分(含加分与扣分)电路。 首先是要有抢答功能,这里用非锁死的按键进行抢答,还涉及到了优先编码器,抢答之后要把抢到的组号锁存,这就用到了锁存器,然后通过led灯显示抢答到的组。回答问题需要倒计时,用计数器设计倒计时,然后通过数码管显示。这里需要时钟信号,选用555定时器产生方波信号为整个系统提供时序。用蜂鸣器提示提前抢答和超时发言,并用数码管显示组别。中间还需要大量的逻辑的运算,这里就一一的罗列,因为比较繁琐。这就是大致的方案,接下来就是查资料,
3、实现每个模块。二、查阅资料查相关的芯片资料,方便后面的设计:l 74hc148:首先是在优先编码器电路中,允许同时输入两个以上编码信号。不过在设计优先编码器时,已经将所有的输入信号按优先顺序排了队。在同时存在两个或两个以上输入信号时,优先编码器只按优先级高的输入信号编码,优先级低的信号则不起作用。74hc148是一个八线-三线优先级编码器。74hc148优先编码器为16脚的集成芯片,除电源脚 VCC(16)和GND(8)外,其余输入、输出脚的作用和脚号如图中所标。其中 I 0 I 7为输入信号, A2,A1,A0为三位二进制编码输出信号, EI是使能输入端, EO使能输出端, G S为片优先编
4、码输出端。由74hc148真值表可列输出逻辑方程为:A2 =(I4+I5+I6+I7)EIA1 = (I2I4I5+I3I4I5+I6+7) EIA0 = (I1I2I4I6+I3I4I6+I5I6+I7) EI当使能输入 IE=1时,所有输出端群被封锁在高电平。当使能输入IE=0时,允许编码,在I0I7输入中,输入 I7优先级最高,其余依次为: I6,I5,I4,I3,I2,I1,I0等级排列。使能输出端EO的逻辑方程为:EO =I0 I1 I2 I3 I4 I5 67 EI,此逻辑表达式表明当所有的编码输入端都是高电平(即没有编码输入),且EI=0时,EO才为零;表明EO的低电平输出信号表
5、示“电路工作,但无编码输入。扩展片优先编码输出端 G S的逻辑方程为: GS = (I0+I1+I2+I3+I4+I5+I6+I7) EI此时表明只要任何一个编码输入段有低电平信号输入,且EI=0,GS即为低电平。GS的低电平输出信号表示“电路工作,而且有编码输入。”(GS=0)1l 74ls48 74LS48除了有实现7段显示译码器基本功能的输入(DCBA)和输出(YaYg)端外,7448还引入了灯测试输入端(LT)和动态灭零输入端(RBI),以及既有输入功能又有输出功能的消隐输入/动态灭零输出(BI/RBO)端。 由7448真值表可获知7448所具有的逻辑功能:(1)7段译码功能(LT=1
6、,RBI=1)在灯测试输入端(LT)和动态灭零输入端(RBI)都接无效电平时,输入DCBA经7448译码,输出高电平有效的7段字符显示器的驱动信号,显示相应字符。除DCBA = 0000外,RBI也可以接低电平,见表1中116行。(2)消隐功能(BI=0)此时BI/RBO端作为输入端,该端输入低电平信号时,表1倒数第3行,无论LT 和RBI输入什么电平信号,不管输入DCBA为什么状态,输出全为“0”,7段显示器熄灭。该功能主要用于多显示器的动态显示。(3)灯测试功能(LT = 0)此时BI/RBO端作为输出端, 端输入低电平信号时,表1最后一行,与 及DCBA输入无关,输出全为“1”,显示器7
7、个字段都点亮。该功能用于7段显示器测试,判别是否有损坏的字段。(4)动态灭零功能(LT=1,RBI=1)此时BI/RBO端也作为输出端,LT 端输入高电平信号,RBI 端输入低电平信号,若此时DCBA = 0000,表1倒数第2行,输出全为“0”,显示器熄灭,不显示这个零。DCBA0,则对显示无影响。该功能主要用于多个7段显示器同时显示时熄灭高位的零。l 74ls190:190 的预置是异步的。当置入控制端( LD )为低电平时,不管时钟CP 的状态如何,输出端(Q0Q3)即可预置成与数据输入端(D0D3)相一致的状态。190 的计数是同步的,靠CP 加在4 个触发器上而实现。当计数控制端(C
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