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1、(完好版)24G射频低噪声放大器毕业设计下面文档格式全部为word格式,下载后您能够任意修改编辑。摘要近年来,以电池作为电源的电子产品得到广泛使用,迫切要求采用低电压的模拟电路来降低功耗,所以低电压、低功耗模拟电路设计技术正成为研究的热门。本文主要讨论电感负反应cascode-CMOS-LNA共源共栅低噪声放大器的噪声优化技术,同时也分析了噪声和输入同时匹配的SNIM技术。以噪声参数方程为基础,列出了简单易懂的设计原理。为了实现低电压、低噪声、高线性度的设计指标,在本文中使用了三种设计技术。第一,本文以大量的篇幅推导出了一个理想化的噪声结论,并使用Matlab分析了基于功耗限制的噪声系数,获得
2、最优化的晶体管尺寸。第二,为了实现低电压设计,引用了一个折叠式的共源共栅构造低噪声放大器。第三,通过线性度的理论分析并结合实验仿真的方法,得出了设计一个高线性度的最后方案。另外,为了改善射频集成电路的器件参数选择的灵敏性,在第四章中使用了一种差分构造。所设计的电路用CHARTER公司0.25mCMOS工艺技术实现,并使用Cadence的spectreRF工具进行仿真分析。本文使用的差分电路构造只进行了电路级的仿真,而折叠式的共源共栅电路进行了电路级的仿真、版图设计、版图参数提取、电路版图一致性检查和后模拟,完成了整个低噪声放大器的设计流程。折叠式低噪声放大器的仿真结果为:噪声系数NF为1.30
3、dB,反射参数S11、S12、S22分别为-21.73dB、-30.62dB、-23.45dB,正向增益S21为14.27dB,1dB压缩点为-12.8dBm,三阶交调点IIP3为0.58dBm。整个电路工作在1V电源下,消耗的电流为8.19mA,总的功耗为8.19mW。当前位置:文档视界(完好版)24G射频低噪声放大器毕业设计(完好版)24G射频低噪声放大器毕业设计ABSTRACTInrecentyears,electronicswithbatterysupplyarewidelyused,whichcriesforadoptinglowvoltageanalogcircuitstoredu
4、cepowerconsumption,solowvoltage,lowpoweranalogcircuitdesigntechniquesarebecomingresearchtechniquesforinductivelydegeneratedcascodeCMOSlow-noiseamplifiers(LNAs)withon-chipinductors.Anditreviewsandanalyzessimultaneousnoiseandinputmatchingtechniques(SNIM).Basedonthenoiseparameterequations,thispaperprov
5、idesclearunderstandingofthedesignprinciple.Inordertoachievelow-voltage,lownoise,specifications,inthispaperbythreedesigntechnology.Firstly,usingMatlabtoolanalyzesnoisefigurebasedonpower-constrained,andobtaintheoptimumtransistorsize.Secondly,designafolded-cascode-typeLNAtoreducethepowersupper.Third,th
6、roughtheoreticalanalysisofLinearandcombinesimulationmethods,Iobtainafinaldesignofatheotherside,inordertoimprovetheradiofrequencyintegratedcircuitdeviceparametersofflexibility,thispaperpresentsadifferenceinthestructureinthefourthchapter.Theproposedcircuitdesignisrealizedusingcsm25RF0.25mCMOStechnolog
7、y,simulatedwithCadencespecterRF.Basedoncsm25RF0.25mCMOStechnology,theresultingdifferentialLNAachieves1.32dBnoisefigure,-20.65dBS11,-24dBS22,-30.27S12,14dBS21.TheLNAs1-dBcompressionpointis-13.3dBm,andIIP3is-0.79dBm,withthecorecircuitconsuming8.1mAfroma1Vpowersupply.Keywords:low-noiseamplifier(LNA);no
8、isefigure;lowvoltagelowpower;cascode;当前位置:文档视界(完好版)24G射频低噪声放大器毕业设计(完好版)24G射频低噪声放大器毕业设计目录第一章绪论(1)1.1课题背景(1)1.2研究现状及存在的问题(2)1.3本论文主要工作(3)1.4论文内容安排(3)第二章射频电路噪声理论和线性度分析(4)2.1噪声理论(4)2.1.1噪声的表示方法(4)2.1.2本文研究的器件噪声类型(5)2.1.2.1热噪声(5)2.1.2.2MOS噪声模型(6)2.1.3两端口网络噪声理论(7)2.1.4多级及联网络噪声系数计算(9)2.2MOSFET两端口网络噪声参数的理论分
9、析(10)2.3降低噪声系数的一般措施(13)2.4MOSLNA线性度分析(14)2.4.11dB压缩点(14)2.4.2三阶输入交调点IIP3(16)2.4.3多级及联网络线性度表示方法起最重要作用的线性级(17)2.5小结(18)第三章CMOS低噪声放大器的设计理论推导(20)3.1LNA设计指标(20)3.1.1噪声系数(20)3.1.2增益(20)3.1.3线性度(20)3.1.4输入输出匹配(21)3.1.5输入输出隔离(21)3.1.6电路功耗(21)3.1.7稳定性(21)3.2CMOSLNA拓扑构造分析(21)3.2.1基本构造及比拟(21)3.2.2源极去耦与噪声、输入同时匹配(SNIM)的设计(22)3.2.3共源共栅电路构造cascode(27)3.2.4功率限制的单端分析获得最佳化的宽长比(29)3.3其它改良型电路比拟(31)3.4偏置电路的设计(33)3.5CASCODE设计结论(34)第四章2.4GHZLNA电路设计(35)4.1工艺库的元器件(35)4.2差分CASCODE电路(35)4.2.1差分电路的设计(35)4.2.2差分电路的电路极仿真(37)4.3单端CASCODE电路(39)4.3.1单端电路的设计(39)4.3.2单端电路的电路级仿真(42)此页面能否是列表页或首页?未找到适宜正文内容。
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