《电路仿真综合课程设计》课程分析方案 .docx
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1、精品名师归纳总结电路仿真综合课程设计题目:基于 Multisim10.0 的数字时钟仿真设计姓 名:学 号:班 级: 10 通信 2 班指导老师:日 期: 2021.04.23一、设计目的可编辑资料 - - - 欢迎下载精品名师归纳总结通过该课程的学习,同学可以学会和运用电路仿真软件,熟识和把握仿真软件对于电子电子路的虚拟仿真测试和分析,完成基础性、综合性和创新性的试验工程,最大限度的发挥同学的主观能动性。通过普及面特别广的运算机实现电路仿真,可以供应开放式试验环境,打破时间和的域的限制,仍可以加强工程实际观念,培育严谨细致的工程设计作风,为本专业后续的专业试验、生产实践和科学讨论打下基础。二
2、、设计内容与要求1、具备时、分、秒显示功能。 留意这里的计时单位是50 秒/分, 50 分/ 时,)2、能够进行时、分校时。3、可以实现 10 计时与 20 计时两种功能切换。4、能进行整点报时,通过声光提示。三、电路设计方案 包括电路的具体功能说明)数字时钟由振荡器、分频器、译码显示、报时等电路组成。其中,振荡器和分频器组成标准秒信号发生器,直接打算计时系统的精度。由不同进制的计时器、译码器和显示器组成计时系统。将标准秒信号送入采纳五十进制的“秒计时器”,每累计 50 秒就发出一个“分脉冲”信号,该信号将作为“分计时器”的时钟脉冲。“分计时器”也采纳五十进制计时器,每累计 50min,发出一
3、个“时脉可编辑资料 - - - 欢迎下载精品名师归纳总结冲”信号,该信号将被送到“时计数器”。“时计数器”采纳二十或十进制计时器。译码显示电路将“时”“分”“秒”计时器的输出状态通过六位七段译码显示出来,可进行整点报时,计时显现误差时,可以用校时电路校时、校分。数字时钟的原理图如下:时显示器分显示器秒显示器时计时器分计时器秒计时器校时掌握电路校分掌握电路报时晶振分频数字时钟的原理框图1)秒脉冲 产生电路秒脉冲 产生电路 在此的功能有两个:一是产生标准秒脉冲信号,二是可供应整点报时所需的频率信号。2)计时器电路依据数字时钟的原理图可知,整个计时器电路由秒计时器,分计时器和时计时器串联而成。秒脉冲
4、信号经过 6 级计时器的计时。显示6 位的“时”“分”“秒”需要 6 片中规模的计时器。其中,秒计时器和分计时器都是五十进制,时计时器为二十和十进制,都选用可编辑资料 - - - 欢迎下载精品名师归纳总结74160来实现。实现的方法采纳反馈清零法。 五十进制计数电路秒计数器和分计数器各由一个十进制计数器和一个五进制串联组成,形成两个五十进制计数器其中个位计数器接成十进制形式, 十位计数器接成五进制形式。个位与十位计数器之间采纳同步级复位方式,在同步级联方式下,掌握高位计数器的计数。如下图所示:IO8IO7 IO6 IO5IO4IO3IO2IO1U33456A B C DQA QB QC QD1
5、4131211IO8IO5U5IO4IO7IO63456710A B C DQA QB QC QD14131211IO1IO3IO2ENP ENTRCO 15710ENPRCO 15 ENT291LOADCLR2CLKU7A 7400NIO991LOADCLR2CLK74160NIO1074160N1IO10U6IO11 IO11IO9NOT五十进制计数器子电路 十进/二十进制计数电路分计数器需要的是一个二十/十进制转换的递增计数电路。个位和十位计数器均连接成十进制计数形式,采纳同步级联复位方式。可编辑资料 - - - 欢迎下载精品名师归纳总结将个位计数器的进位输出端RCO 接至十位计数器的时
6、钟信号输入端 CLK ,完成个位对十位计数器的进位掌握。两个与非门通过一个双向开关接至两片计数器的清零端CLK ,单击开关就可挑选与非门的输出,实现二十进制或十进制递增计数的转换。IO9可编辑资料 - - - 欢迎下载精品名师归纳总结IO8 IO7 IO6 IO5IO4IO3IO2IO1可编辑资料 - - - 欢迎下载精品名师归纳总结可编辑资料 - - - 欢迎下载精品名师归纳总结U13 A4 B5 C6 D7 ENP10 ENTQA 14QB 13QC 12QD 11RCO 15IO8 IO7IO5 IO6345610IO9 7A B C DENP ENTU2QA14QB13QC 12QD
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