2022年频率计报告原理部分 .pdf
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1、数字频率计的设计一、设计要求和指标1、可测频率范围为10Hz1MHz 。2、采用数码管显示,显示位数不少于6 位。3、显示时间从27 秒可调。4、输入阻抗大于10K。5、输入信号峰峰电压值在0.520V 范围内可测。二、函数发生器的基本原理一、测量原理频率为单位时间内信号的周期数。对脉冲信号而言,其频率为一秒钟内的脉冲个数;计数器在一秒钟内对脉冲信号进行计数,计数的结果就是该信号的频率。只要计数结果以十进制方式显示出来,就是最简单的频率计。如图2.1.1 所示,被测脉冲信号为X,在 T1时刻出现一个脉冲宽度为一秒的闸门脉冲信号P,用闸门脉冲P取出一秒时间内的输入脉冲信号X 形成计数脉冲Y,计数
2、器对计数脉冲信号Y 进行计数;计数的结果(频率值)在T2时刻被锁存信号S 控制,锁存到寄存器,并通过译码器、显示器把并率显示出来。在T3时刻计数器被清除信号R 清零,准备下一次的计数,一次测量结束。1S1SXYPT1开 始 计 数T2锁 存 显 示T3清 除tttt图 2.1.1 频率器的测量原理显示数值在T2时刻更换, S脉冲信号的周期为显示时间,其大小反映显示值的变化快慢。显示时间Tx 为:Tx=T3-T2+(02) (秒)可见,改变T3-T2的值可调节显示时间,通常T3是通过 T2的延时而得,通过调节延时时间来调节显示时间。二、方案框图频率计的框图如图2.1.2,由六部分组成,以计数器为
3、核心,各部分的功能如下:名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 1 页,共 9 页 - - - - - - - - - 时基电路输入电路译码显示电路控制电路锁存器计数器XPY计数值显示值清除显示控制基准脉冲锁存图 2.1.2 频率计总体框图1、计数器:在规定的时间内完成对被测脉冲信号的计数。由输入电路提供计数脉冲输入,对脉冲进行计数(在规定的测量频率范围内计数无益出)。计数结果一般为十进制,并将计数结果输出送往寄存器,再由控制电路提供的清除信号R 清零。等待下一次计数的开始。
4、该部分主要考虑计数器的工作频率和计数容量问题。2、锁存器:暂存每次测量的计数值。为显示电路提供显示数据。锁存器由控制电路提供的琐存信号 S 控制更换数值。以正确地显示每一次的测量结果。3、译码显示电路:对锁存器的输出数据译码,变为七段数码显示码,并驱动数码显示器显示出十进制的测量结果。包括译码电路和驱动显示电路。4、时基电路:提供电路所需的各种工作脉冲信号。主要由控制电路形成各种控制时序脉冲。频率的稳定和精确是重要考虑的问题,它决定了频率测量的准确程度。5、输入电路:对各种输入信号进行放大处理,产生计数脉冲。该部分要适应各种输入信号,如对小信号进行放大,对大信号进行限幅,对高频信号和低频信号都
5、能形成计数脉冲输出,以激励门电路。6、控制电路:产生有一定的时序要求的锁存信号S、清除信号 R 等控制信号。给基准脉冲控制的闸门脉冲信号给输入电路取出计数脉冲。三、单元电路设计1、输入电路1)原理设计输入电路是对输入信号进行放大或衰减,变成合适的电压范围,同时对输入信号进行隔直、比较、整形,处理成脉冲信号,再通过闸门电路,由基准脉冲选出计数脉冲进入计数器。输入电路首先要隔离直流,然后对信号进行限幅和放大处理。放大电路可采用运算放大器构成。由于输出脉冲要求的幅度较大,要求能够驱动门电路,对运算放大器要求速度较高。图1 是采用高速 CMOS 反相器 74HC04 构成放大电路的输入电路。该集成电路
6、的平均传输延迟时间约9nS。采用三级串接,形成足够的放大倍数,放大电路的输出幅度大。输入端通过电容C 隔离直流。二极管对输入信号进行限幅,使输入信号的电压范围变宽,满足设计要求。二极管最好选用结电容较小、开关速度较高的高频二极管,以免对高频信号造成损失。后两级形成施蜜特触发器对信号进行整形,同时也有一定的放大作用。调节RW 可改变施密特触发器的阀值电压。名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 2 页,共 9 页 - - - - - - - - - R110K12UA74HC0
7、 456UC7 4HC0 434UB7 4HC0 489UD74HC0 41011UE7 4HC0 4D11N41 48D21 N41 48C11uFR2100 KR310MR4200 KR51 MRW4 70 KUi1213UF7 4HC0 4C21uF图 1 是采用 74HC04 构成的输入电路2)电路调试2、时基电路1)原理设计CIN11COUT9COUT10RST12Q47Q55Q64Q76Q814Q913Q1 015Q1 21Q1 32Q1 43U1CD4 06 0327 68 HZ22M100 pF100 pFD5Q1CL K3Q2R4S6U2 ACD4 01 31S图 2 用 C
8、D4060 集成电路的时基产生电路图 3 CD4060 的引脚图如图 2,采用 CD4060 集成电路,它集振荡器和分频器于一体,用32.768KHz 的石英晶体构成振荡器,经内部14 级二进制分频获得2Hz 的脉冲信号,再经一个由D 触发器组成的2 分频电路分频得 1S 的基准脉冲信号,该电路结构最为简单,但只有一个1S 的基准脉冲输出。CD4060 的引脚图如图3 所示。Q1 32Q1 43Q76Q47Q814RST12Q1 21COUT9Vss8CIN11Q913COUT10Q64Q55Q1 015VDD16CD4 060名师资料总结 - - -精品资料欢迎下载 - - - - - -
9、- - - - - - - - - - - - 名师精心整理 - - - - - - - 第 3 页,共 9 页 - - - - - - - - - 2)电路调试3、计数器1)原理设计图 4 是采用三位十进制计数器CD4553 的方案。 CD4553 为三位 BCD 码计数器,该电路的特点是只有一组BCD 码输出端,但通过分时控制可形成三位BCD 码输出,实现动态扫描,可节省译码电路,也简化了电路的逻辑电路设计。该集成电路的最高工作频率可达7MHz 。CLK12LE10DIS11MR13C1A4C1B3Q09Q17Q26Q35OVF14DS12DS21DS315U1CD455 3CLK12LE
10、10DIS11MR13C1A4C1B3Q09Q17Q26Q35OVF14DS12DS21DS315U2CD455 31 00 0p F千、万、十万位BCD码个、十、百位BCD码计数 脉冲Y清除R锁存S图 4 采用 CD4553 构成的六位BCD 码计数器名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 4 页,共 9 页 - - - - - - - - - 扫描振荡扫描器多路转换器锁存锁存锁存整形个位百位十位C RC RC RC1A C1BQ0Q1Q2Q3DS3DS2DS1OVFMRC
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- 2022年频率计报告原理部分 2022 频率计 报告 原理 部分
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