组成原理-超前进位加法器设计.doc
《组成原理-超前进位加法器设计.doc》由会员分享,可在线阅读,更多相关《组成原理-超前进位加法器设计.doc(7页珍藏版)》请在淘文阁 - 分享文档赚钱的网站上搜索。
1、Four short words sum up what has lifted most successful individuals above the crowd: a little bit more.-author-date组成原理-超前进位加法器设计计算机组成原理计算机组成原理 实 验 报 告 专 业: 学 号: 学生姓名: 实验日期: -实 验 二一、 实验名称:超前进位加法器设计二、 实验目的: 1 掌握超前进位加法器的原理及其设计方法。 2 熟悉CPLD 应用设计及EDA 软件的使用。三、 实验设备:PC 机一台,TD-CMA 实验系统一套,排线若干。四、 实验内容:1.了解加法
2、器的工作原理,掌握超前进位产生电路的设计方法. 2.正确将电路原理图下载到试验箱中. 3.正确通过实验箱连线实现4位二进制数的相加并得到正确结果五、 实验原理: 加法器是执行二进制加法运算的逻辑部件,也是CPU 运算器的基本逻辑部件(减法可以通过补码相加来实现)。加法器又分为半加器和全加器(FA),不考虑低位的进位,只考虑两个二进制数相加,得到和以及向高位进位的加法器为半加器,而全加器是在半加器的基础上又考虑了低位过来的进位信号。 表1-2-1 1 位全加器真值表 A、B 为2 个1 位的加数,Ci 为来自低位的进位,S 为和,Co 为向高位的进位,根据表1-2-1所示的真值表,可得到全加器的
3、逻辑表达式为:S = ABCi + ABCi + ABCi + ABCiCo = AB+ ACi + BCi根据逻辑表达式,可得到如图1-2-1 所示的逻辑电路图。有了1 位全加器,就可以用它来构造多位加法器,加法器根据电路结构的不同,可以分为串行加法器和并行加法器两种。串行加法器低位全加器产生的进位要依次串行地向高位进位,其电路简单,占用资源较少,但是串行加法器每位和以及向高位的进位的产生都依赖于低位的进位,导致完成加法运算的延迟时间较长,效率并不高。 C0 = 0Ci+1 = AiBi + AiCi + BiCi = AiBi + (Ai + Bi)Ci设gi = AiBipi = Ai
- 配套讲稿:
如PPT文件的首页显示word图标,表示该PPT已包含配套word讲稿。双击word图标可打开word文档。
- 特殊限制:
部分文档作品中含有的国旗、国徽等图片,仅作为作品整体效果示例展示,禁止商用。设计者仅对作品中独创性部分享有著作权。
- 关 键 词:
- 组成 原理 超前 进位 加法器 设计
限制150内