2022年音乐播放器三汇编 .pdf
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1、a 目录第一章 课程设计的任务和目的 . 01.1 课程设计任务 . 01.2 课程设计目的 . 0第二章 课程设计基础知识 . 12.1 定时/计数器 8253A. 12.2 8253A 内部结构 . 12.3 8253A 外部引脚 . 错误!未定义书签。2.4 计数器内部结构 . 32.5 8253A 端口地址 . 42.6 8253A 功能. 42.7 8253A 控制字 . 52.8 8253A 工作方式 . 5第三章 详细设计 . 73.1 硬件设计 . 73.2 软件设计 . 10第四章 程序调试 . 11第五章 总结 . 11第六章 参考文献 . 12第七章 附录 . 13 7.
2、1 源代码 . 13 7.2 各个音符的对应频率 . 15名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 1 页,共 17 页 - - - - - - - - - a 第一章课程设计的任务和目的1.1 课程设计任务本课程设计题目是:设计并实现一个音乐播放器。1.自己选用芯片和其它的硬件。2.自行设计电路并使用汇编语言编写程序完成音乐播放器功能。3.利用 8253 作为音阶频率发生器,对一段音乐进行编码后存入音符表,程序中可调用音符表自动播放音乐,从中了解音乐播放的原理。4.利用 82
3、53A 和 PC 机,设计并实现简易音乐播放器5.使用汇编语言编写音乐播放程序。6.上机调试程序并联机,利用试验箱提供的扬声器发声。7.完成实验报告。1.2 课程设计目的本课程设计注重提高学生应用能力、创新能力。在掌握了基本的实验方法和实验技能且理论教学完成的基础上,要求学生通过一周的集中工作,初步锻炼综合运用所学知识的能力,通过讨论与合作, 完成一项完整的设计工作。更深入的了解微机芯片的用法和程序的完成过程,调试方法及技巧。通过这个环节来加深对微机原理与接口技术所学内容的理解和融会贯通。设计音乐播放器主要目的:通过 D/A 装换器产生模拟信号,在实验平台上实现简易音乐播放器。了解利用数模转换
4、器产生音乐的基本方法。掌握定时 / 计数器 8253A 的使用。名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 2 页,共 17 页 - - - - - - - - - a 第二章课程设计基础知识2.1 定时 /计数器 8253A 在微机及控制系统中,经常要用到定时信号。如系统的日历时钟,动态存储器刷新。对外部执行机构控制时也需要定时中断、定时检测、定时查询等。定时的方法主要是两种:软件定时:利用指令的执行时间设计循环程序,使CPU 执行延迟子程序的时间就是定时时间。缺点:执行延迟时
5、,CPU 一直被占用,降低了CPU 的效率。硬件定时:用计数器/定时器作为主要硬件,在软件简单指令的控制下产生精确的时间延迟。 突出优点为计数时不占用CPU 时间, 如利用定时器 /计数器产生中断信号,可建立多作业环境,提高了CPU 效率。主要功能:(1)每片上有3 个独立的16 位的减计数器通道。(2)对于每个计数器,都可以单独作为定时器或计数器使用,并且都可以按照二进制或十进制来计数。(3)每个通道都有6 种工作方式,都可以通过程序设置或改变。(4)每个计数器的速率可高达2MHz 。最高的计数时钟频率为26MHz 。2.2 8253A内部结构8253 的内部结构如图所示,它主要包括以下几个
6、主要部分:图 2 1 8253 的内部结构名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 3 页,共 17 页 - - - - - - - - - a (1) 数据总线缓冲器实现 8253 与 CPU数据总线连接的8 位双向三态缓冲器, 用以传送 CPU向 8253 的控制信息、数据信息以及CPU从 8253 读取的状态信息,包括某时刻的实时计数值。(2) 读 /写控制逻辑控制 8253 的片选及对内部相关寄存器的读/ 写操作,它接收CPU发来的地址信号以实现片选、内部通道选择以及对
7、读/ 写操作进行控制。(3) 控制字寄存器在 8253 的初始化编程时,由 CPU写入控制字, 以决定通道的工作方式,此寄存器只能写入,不能读出。(4) 计数通道0#、1#、2#:这是三个独立的,结构相同的计数器/ 定时器通道,每一个通道包含一个16 位的计数寄存器,用以存放计数初始值,一个16 位的减法计数器和一个16 位的锁存器,锁存器在计数器工作的过程中,跟随计数值的变化,在接收到CPU发来的读计数值命令时,用以锁存计数值,供CPU读取,读取完毕之后,输出锁存器又跟随减1 计数器变化。2.3 8253A外部引脚8253 芯片是具有24 个引脚的双列直插式集成电路芯片,其引脚分布如图所示。
8、8253芯片的 24 个引脚分为两组,一组面向CPU ,另一组面向外部设备,各个引脚及其所传送信号的情况,介绍如下:(1) D7D0:双向、三态数据线引脚,与系统的数据线连接,传送控制、数据及状态信息。(2) RD:来自于CPU的读控制信号输入引脚,低电平有效。(3) WR:来自于CPU的写控制信号输入引脚,低电平有效。(4) CS:芯片选择信号输入引脚,低电平有效。图 21 8253 的引脚(5) A1、A0:地址信号输入引脚,用以选择8253 芯片的通道及控制字寄存器。(6) VCC及GND :+5V电源及接地引脚(7) CLKi:i=0,1,2,第 i 个通道的计数脉冲输入引脚,8253
9、 规定,加在CLK引脚的输入时钟信号的频率不得高于2.6MHZ ,即时钟周期不能小于380ns。(8) GATEi:i=0,1,2,第 i 个通道的门控信号输入引脚,门控信号的作用与通道的工作方名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 4 页,共 17 页 - - - - - - - - - a 式有关。(9) OUTi:i=0,1,2,第 i 个通道的定时/ 计数到信号输出引脚,输出信号的形式由通道的工作方式确定,此输出信号可用于触发其它电路工作,或作为向CPU发出的中断请求
10、信号。2.4 计数器内部结构每个计数器由一个16 位可预置的减1 计数器组成,计数初值可保存在16 位的锁存器中,该锁存器只写不能读。在计数器工作时,初值不受影响,以便进行重复计数。图中每个计数器有一个时钟输入端CLK作为计数脉冲源,计数方式可以是二进制,计数范围110000H,也可以是十进制,计数范围165536。门控端 GATE 用于控制计数开始和停止。输出 OUT 端当计数器计数值减到零时,该端输出标志信号。图 22 计数器内部结构名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第
11、 5 页,共 17 页 - - - - - - - - - a 2.5 8253A端口地址图 23 8253A 端口地址2.6 8253A功能8253 A 既可作定时器又可作计数器:( 1)计数:计数器装入初值后,当GATE 为高电平时,可用外部事件作为CLK 脉冲对计数值进行减1 计数,每来一个脉冲减1,当计数值减至0 时,由 OUT 端输出一个标志信号。( 2) 定时:计数器装入初值后,当GATE 为高电平时,由CLK 脉冲触发开始自动计数,当计数到零时,发计数结束定时信号。除上述典型应用外,8253A 还可作频率发生器、分频器、实时钟、单脉冲发生器等。名师资料总结 - - -精品资料欢迎
12、下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 6 页,共 17 页 - - - - - - - - - a 2.7 8253A控制字图 24 8253A 控制字说明:( 1) 8253 A 每个通道对输入CLK 按二进制或二十进制从预置值开始减1 计数,减到0时从 OUT 输出一个信号。( 2) 8253 A 编程时先写控制字,再写时间常数。2.8 8253A工作方式( 1)方式 0:计数结束产生中断方式当写入控制字后,OUT 变为低电平,当写入初值后立即开始计数,当计数结束时,变成高电平。 ( 2)方式 1:可编程
13、单次脉冲方式当初值装入后且GATE 由低变高时, OUT 变为低电平,计数结束变为高电平。 ( 3)方式 2:频率发生器方式当初值装入时,OUT 变为高;计数结束,OUT 变为低。该方式下如果计数未结束,但GATE 为低时,立即停止计数,强制OUT 变高,当GATE 再变高时,便启动一次新的计数周期。( 4)方式 3:方波发生器名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 7 页,共 17 页 - - - - - - - - - a 当装入初值后,在GATE 上升沿启动计数,OUT
14、 输出高电平;当计数完成一半时,OUT 输出低电平。图 25 方波图方式 3 与方式 2 的工作方式类似, 也是在初始化完成后能重复循环计数,只是输出的波形不同。 计数过程当把方式3 的控制字写入控制字寄存器后,输出端OUT 变成高电平,作为初始电平。再将计数初值写入计数初值寄存器CR 中,再经过一个时钟周期,计数初值被移入计数执行单元 CE 中,从下一个时钟脉冲开始作减1 计数,方式3 的计数过程分为两种情况:第一种情况: 计数初值为偶数, 当作减 1 计数减到 N/2 时,输出端 OUT 端变成低电平,减到 0 时,输出端 OUT 变成高电平,并重新从初值开始新的计数过程。若GATE 为高
15、电平,则一直重复同样的计数过程。可见,输出端OUT 输出连续的方波,故称方波发生器。第二种情况:计数初值为奇数,当作减1 计数减到( N+1)/2 以后,输出端OUT 变成低电平,减到0 时,输出端OUT 又变成高电平。并重新从初值开始新的计数过程。这时输出端的波形为连续的近似方波。门控信号的影响工作在方式3 时,门控信号GATE 的功能与工作方式2 一样,即GATE 为高电平时,允许计数; GATE 为低电平时停止计数。GATE 引脚上的信号从低电平跳到高电平时,将会重新把计数初值寄存器CR 中的内容移入计数执行单元CE 中,并以新装入的值重新开始计数。名师资料总结 - - -精品资料欢迎下
16、载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 8 页,共 17 页 - - - - - - - - - a 新的计数初值对计数过程的影响如果在计数过程中写入新的初值,而GATE 信号一直维持高电平,则新的初值不会影响当前的计数过程,只有在计数结束后的下一个计数周期,才按新的初值计数。若写入新的初值后, 遇到门控信号的上升沿,则结束现行的计数过程,从下一个时钟脉冲下降沿开始按新的计数初值进行计数。可见,工作在方式3 时,当计数初值为偶数,OUT 端输出连续的标准方波;当计数初值为奇数,在每个计数周期内,有(N+1)/2
17、个周期输出高电平, (N-1)/2 个时钟周期输出低电平, OUT 端输出连续的近似的方波。第三章详细设计3.1 硬件设计音乐播放器用到相关硬件:(本课程设计主要在DVCC 598JH微机仿真实验系统实现)1.定时 / 计数器 8253A2.扬声器和喇叭驱动模块3.频率发生芯片74LS393 硬件连接:定时 /计数器 8253A芯片模块的CLK2接时钟频率选择模块74LS393 的 T7 端口,分频器的频率源为5000HZ。定时 /计数器 8253A芯片模块的GATE2接 5V,提供高电平。定时 /计数器 8253A芯片模块的OUT2 接喇叭驱动驱动模块的SIN 端口。喇叭驱动驱动模块的J5插
18、座接扬声器的J5 插座。8253A 的 CLK2 接分频器74LS393 (右上方)的 T7 插孔,分频器的频率源为5000。图 31 硬件连接框架图名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 9 页,共 17 页 - - - - - - - - - a 图 32 扬声器电路图 33 扬声器 J5 插口如图 3 2为音响电路的控制输入插口SIN,控制输入信号经放大后接喇叭。图 34 74LS393 引脚图名师资料总结 - - -精品资料欢迎下载 - - - - - - - - -
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