2022年Debussy教程部分 .pdf

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1、热门搜索： 单片机 15V/6A 开关电源 usb USB 15V/6A 的开关电源arm 报警加入收藏网站地图网站留言繁體中文首页嵌入式系统EDA 技术电子制作PCB技术综合技术电路图源码资料会员共享导航:FPGA/CPLDVerilogVHDLModelSimProteusDebussy 仿真快速上手教程时间:2006-12-31 来源: 作者: 点击： 16780 字体大小 :【大 中 小】Debussy 介绍 Debussy 是NOVAS Software, Inc( 思源科技 )发展的 HDLDebug & Analysis tool，这套软体主要不是用来跑模拟或看波形，它最强大的功

2、能是：能够在HDL source code、schematic diagram、waveform 、state bubble diagram之间，即时做 trace ，协助工程师debug 。可能您会觉的：只要有simulator 如ModelSim就可以做debug 了，我何必再学这套软体呢? 其实 Debussy v5.0以后的新版本，还提供了nLint - check coding style &synthesizable ，这蛮有用的，可以协助工程师了解如何写好coding style ，并养成习惯。下图所示为整个Debussy 的原理架构，可归纳几个结论： Debussy有四个主要单

3、元(component)，nTrace 、nWave 、nSchema 、nState nTrace - Hypertext source code analysis and browse tool (为% Debussy &所开启的主画面) nWave - Waveform analysis tool (可由 nTrace 内开启，或直接% nWave &开启) nSchema - Hierarchy schematic generator nState - Finite State Machine Extraction and analysis tool Debussy本身不含模拟器(si

4、mulator) ，必须呼叫外部模拟器(如Verilog-XL or ModelSim) 产生 FSDB file，其显示波形的单元nWave 透过读取 FSDB file，才能显示波形或讯号值的变化快速上手五部曲： (Debussy v.5.2) 1. Import Files and generate FSDB file 2. Trace between hierarchy browser and source code 3. Trace between hierarchy browser、source code and schematic 4. Trace between hierarc

5、hy browser、source code 、schematic and waveform 5. nLint (nState 本文没介绍，有兴趣的读者，请依文后的连结，自行下载CIC所提供的 NOVAS原厂编写教材参考)推荐文章 Proteus 与单片机实时动态仿真 基于FPGA/CPLD设计与实现 UART(VHDL 基于VHDL 的全数字锁相环的设计 如何仿真 IP核（建立 modelsim 仿真库 Modelsim 包会教程 IIR滤波器matlab源程序 使用 FPGA 控制 VGA 显示 Nios II的Boot 过程分析 Proteus 常见问题答疑 ModelSim SE操作指

6、南 FIR 滤波器 FAQ Modelsim 初学者心得 Proteus ISIS 常见问题 FAQ VHDL秒表计时器 用verilog编写的多功能数字钟热门文章 FPGA实现串行接口 RS232 Xilinx ISE 使用入门 Debussy 仿真快速上手教程 静态时序分析（ Static Timing Anal Quartus II 与 ModelSim 功能仿真与 基于MATLAB的IIR数字滤波器的设计 Proteus 虚拟串口调试心得 用MATLAB信号处理工具箱进行 FIR滤 Verilog学习笔记 Modelsim 包会教程 ModelSim,synplify,ISE 后仿真流

7、程 Nios II的Boot 过程分析 proteus VSM 常见问题 FAQ 用 proteus软件建立单片机仿真虚拟 创建基于 DLL的Proteus VSM 仿真模型您的位置 ：电子开发网 EDA技术2011-7-8Debussy 仿真快速上手教程-电子开发网 /1316.html1/5名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 1 页，共 5 页 - - - - - - - - - 1. Import Files and generate FSDB file 1-1 启

8、动Debussy ：% Debussy & (此处的 D大小写都可以，但其它指令的大小写可能就有差别)开启nTrace window如下，此时工作目录下会新建一个DebussyLog目录 1-2 Import Files：File Import Design.结果如下图所示：nTrace 视窗中，含有三个区域，Hierarchical Brower 、Source code window、Messagewindow 。 ( 如果不想看波形，只想查看source code 与schematic 的关係，您可以直接跳到step 2-1)2011-7-8Debussy 仿真快速上手教程-电子开发网

9、/1316.html2/5名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 2 页，共 5 页 - - - - - - - - - 此时 DebussyLog 目录内会有 Debussy.cmd 、turbo.log 、compiler.log 三个档案。Debussy.cmd 纪录所有import的档案与之后所有的执行程序。我们可以直接引用这个档案来执行上一次我们做过的一连串程序(referto 1-5) 。 1-3 设定外部模拟器，藉其產生FSDB file ： Tools Opt

10、ions Preferences.1-4 切换到 Interactive Mode：Tools Interactive Mode (此时 ToolBar 上会出现 Simulation 选单 )开始执行模拟：Simulation Run/Continue (模拟结束工作目录下就会產生dump_i.fsdb )2011-7-8Debussy 仿真快速上手教程-电子开发网 /1316.html3/5名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 3 页，共 5 页 - - - - - -

11、 - - - Tags：仿真debussy上一篇：CPLD开发板和FPGA开发板的区别下一篇： 从FPGA或PLD转换到门阵列 串扰仿真的疑问 常用的微波 EDA仿真软件介绍 怎样用modelsim 做后仿真 使用 ModelSim 进行设计仿真 Modelsim的功能仿真和时序仿真 ISE仿真中需要注意的问题Source code 目录下，要有先前ModelSim 所建立的此 project 的work library ，不然会有错误讯息：Failed toaccess library work at work。另外，你不能只是开一个work 资料夹，而是要真的用ModelSim 產生wor

12、klibrary ，并且把 design compile to the work library后， step 1-4 才会正确动作。1-5 结束程式：File Exit 1-6 快速启动执行序把DebussyLog 目录下的指令记录档Debussy.cmd复制到目前工作目录下，重新编辑此档 (删掉最后一行的debExit然后储存 )，引用它来开启Debussy 可重复之前同样的动作程序% Debussy -play Debussy.cmd & ( 结果相当於从步骤1-1做到 1-4)1-7 其他启动Debussy的方法 % Debussy -f xxx.f (类似开启一个事先编写的批次档，可

13、以同时一次载入多个.v) % Debussy -vhdl -f xxx.f (类似开启一个事先编写的批次档，可以同时一次载入多个.vhd)以上都是属於Import design from file的方法，另外还有一种方法是Import design from library。两者的差异在於： Import design from file是将 design compile to RAM，而 Import design from library则是将 design compileto library (default lib. is work)。对於比较大的project ，為了避免每次使用De

14、bussy 都要花时间 compile ，建议採用 Import design fromlibrary 的方法，而且 mixed-language design一定要用 Import design from library的方法。 Ex. for Verilog files： %vericom -inc -f run.f %Debussy -lib work -top xxx & Ex. for VHDL files： %vhdlcom -93 -f run.f %Debussy -lib work -top xxx &共4页: 1234下一页2011-7-8Debussy 仿真快速上手教程-

15、电子开发网 /1316.html4/5名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 4 页，共 5 页 - - - - - - - - - debussy 和modelsim 协同仿真(VHDL) modelsim 仿真 ROM关于本站 - 联系我们 - 鲁ICP备06020214 号 - 网站地图 - 网站留言 - 返回顶部Copyright ? 2006-2008 电子开发网 All rights reserved.2011-7-8Debussy 仿真快速上手教程-电子开发网 /1316.html5/5名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 5 页，共 5 页 - - - - - - - - -