2022年2022年计算机组成原理与操作系统 .pdf
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1、第 1 页共 7 页考生注意:答案必须写在统一配发的专用答题纸上!(共两部分,满分150 分)计算机组成原理部分(共五大题,满分75 分)一、 (20 分) 填空题1计算机的主要技术指标有(1)(计量单位一般为兆赫MHz ) 、 (2) (计量单位一般为MIPS 、MFLOPS 、CPI 等) 、(3)(通常以计算机处理信息时直接处理的二进制信息位数来定义)、 (4)(通常以字节个数来描述)、存取周期等。2计算机的运算器由很多部件组成,但其核心部件是(5)。3BCD 码中,每一位十进制数字由(6)位二进制码组成,ASCII 码中表示一个字符需要(7)位二进制码。4已知 X 补=FF00H,则
2、2X 补=(8) ;X/2 补=(9)。5若采用偶校验,数据0010 1010 1001 的校验位为:(10)。6衡量存储器的性能指标主要有三个方面:(11)、 (12) 和价格 /位。7建立高速缓冲存储器的理论依据是(13)。8三级存储器系统中,采用Cache主存层次是为弥补(14)的不足,采用主存辅存层次是为了弥补( 15)的不足。9 CPU 和 Cache 之间以( 16)为单位进行数据传送;Cache和主存之间以(17)为单位进行传送。10设基址寄存器内容为4000H,变址寄存器的内容为0020H,指令地址码为0EH,则采用变址加基址寻址方式时,操作数的有效地址为:(18)。11目前世
3、界上最快的计算机是(19) (国家)的(20) (型号)计算机。二、 (20 分) 选择题 (1-17 为单选, 18-20 为多选 ) 1冯 诺依曼计算机中指令和数据均以二进制形式存放在存储器中,CPU 区分它们的依据是() 。A:指令操作码的译码结果B:指令和数据的寻址方式C:指令周期的不同阶段D:指令和数据所在的存储单元名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 1 页,共 7 页 - - - - - - - - - 第 2 页共 7 页2.假定基准程序A 在某计算机上的运
4、行时间为100 秒,其中90 秒为 CPU 时间,其余为 I/O 时间。若CPU 速度提高 50%,I/O 速度不变,则运行基准程序A 所耗费的时间是()A:55 B:60 C:65 D:70 3.一个 C 语言程序在一台32 位机器上运行。程序中定义了三个变量x、y、 z,其中x 和 z 是 int 型, y 为 short 型。当 x=127、y=-9 时,执行赋值语句z=x+y 后, x、y、z 的值分别是() 。A:X=0000007FH ,y=FFF9H , z=00000076H B:X=0000007FH ,y=FFF9H , z=FFFF0076H C:X=0000007FH
5、,y=FFF7H , z=FFFF0076H D:X=0000007FH ,y=FFF7H , z=00000076H 4.某字长为8 位的计算机中, 已知整型变量x、y 的机器数分别为x补=1 1110100,y补=1 0110000。若整型变量z=2*x+y/2 ,则 z 的机器数为() 。A:1 1000000 B: 0 0100100 C:1 0101010 D:溢出5.用海明码对长度为8 位的数据进行检/纠错时,若能纠正一位错。则校验位数至少为() 。A:2 B:3 C:4 D: 5 6.某计算机存储器按字节编址,主存地址空间大小为64MB ,现用 4M*8 的 RAM 芯片组成 3
6、2M 主存储器,则存储器的地址寄存器MAR 的位数至少为() 。A:22 位B:23 位C:25 位D:26 位7.下列关于闪存(Flash Memory )的叙述中,错误的是() 。A:信息可读可写,并且读、写速度一样快B:存储元由MOS 管组成,是一种半导体存储器C:掉电后信息不丢失,是一种非易失性存储器D:采用随机访问方式,可替代计算机外部存储器8.假设某计算机的存储系统由Cache 和主存组成,某程序执行过程中访存1000 次,其中访问 Cache 缺失(未命中)50 次,则 Cache的命中率是() 。A:5% B:9.5% C:50% D: 95% 9.某机器字长16 位,主存按字
7、节编址,转移指令采用相对寻址,由两个字节组成,第一字节为操作码字段,第二字节为相对位移量字段。假定取指令时,每取一个字节PC自动加 1。若某转移指令所在主存地址为2000H,相对位移量字段的内容为06H,则该转移指令成功转以后的目标地址是() 。A:2006H B:2007H C:2008H D:2009H 10.下列不会引起指令流水阻塞的是() 。名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 2 页,共 7 页 - - - - - - - - - 第 3 页共 7 页A:数据旁路
8、B:数据相关C:条件转移D:资源冲突11.假定不采用Cache和指令预取技术,且机器处于 “ 开中断 ” 状态, 则在下列有关指令执行的叙述中,错误的是() 。A:每个指令周期中CPU 都至少访问内存一次B:每个指令周期一定大于或等于一个CPU 时钟周期C:空操作的指令周期中任何寄存器的内容都不会被改变D:当前程序在每条指令执行结束时都可能被外部中断打断12.相对于微程序控制器,硬布线控制器的特点是() 。A:指令执行速度慢,指令功能的修改和扩展容易B:指令执行速度慢,指令功能的修改和扩展难C:指令执行速度快,指令功能的修改和扩展容易D:指令执行速度快,指令功能的修改和扩展难13.某磁盘的转速
9、为10000 转/分,平均寻道时间是6 ms,磁盘传输速率是20 MB/s ,磁盘控制器延迟为0.2 ms,读取一个4 KB 的扇区所需的平均时间约为() 。A:9 ms B:9.4 ms C:12 ms D:12.4 ms 14.假定一台计算机的显示存储器用DRAM芯片实现,若要求显示分辨率为1600*1200,颜色深度为24 位,帧频为 85Hz,显示总带宽的50%用来刷新屏幕, 则需要的显存总带宽至少约为() 。A:245 Mbps B:979 Mbps C:1958 Mbps D:7834Mbps 15.为实现 CPU 与外部设备并行工作,必须引入的硬件是() 。A:缓冲区B:通道C:
10、时钟D:仲裁逻辑16.下列关于DMA 和中断 I/O 方式的叙述中,错误的是() 。A:中断 I/O 方式请求的是CPU 处理时间B:中断响应发生在一条指令执行结束后C:DMA 方式下数据传送由硬件完成D:DMA 方式仅适用于快速外部设备17.设总线频率为100MHz ,宽度为 32 位,地址 /数据线复用, 每传输一个地址或数据占用一个时钟周期。若该总线支持突发(猝发)传输方式,则一次“ 主存写 ” 总线事务传输 128 位数据所需要的时间至少是() 。A:20ns B:40ns C:50ns D: 80ns 18.假定变量 I、f、d 数据类型分别为int、float 和 double(i
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