2022年南京信息工程大学数电期末报告 .pdf
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1、数字逻辑电路实验期末考试实验报告题目用 JK触发器设计两位二进制同步计数器专业_电子信息工程 _学生姓名 _张迟犇 _ 学号_20131305028_任课老师裴晓芳二 14 年 12 月 10 日名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 1 页,共 9 页 - - - - - - - - - 第一章主要设计要求1. 用双边沿 JK触发器 74LS76设计一个两位二进制同步加法计数器。要求完成的主要任务:1. 给出设计过程2. 画出设计电路3. 利用数电实验箱验证设计结果第二章电
2、路设计和原理分析加法器的简介:加法器是产生数的和的装置。加数和被加数为输入,和数与进位为输出的装置为半加器。若加数、被加数与低位的进位数为输入,而和数与进位为输出则全加器。常用作计算机算术逻辑部件,执行逻辑操作、移位与指令调用。在电子学中,加法器是一种数位电路,其可进行数字的加法计算。在现代的电脑中,加法器存在算术逻辑单元(ALU )之中。 加法器可以用来表示各种数值,如:BCD、加三码,主要的是二进制运算。实验所用芯片引脚图及如下图所示:名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - -
3、第 2 页,共 9 页 - - - - - - - - - 真值表名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 3 页,共 9 页 - - - - - - - - - 74LS00引脚图名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 4 页,共 9 页 - - - - - - - - - 实验中的二进制同步加法计数器实在加法器的基础上产生的。而所谓的同步计数器,其特点是,
4、计数脉冲同时接于各位触发器的时钟脉冲输入端,当计数脉冲到来时,各触发器同时被触发 , 应该翻转的触发器是同时翻转的,没有各级延迟时间的积累问题。同步计数器也可称为并行计数器。在同步二进制加法计数器电路设计中,J-K触发器是同步二进制加法器实现的主要触发器,主从J-K 触发器,简称 JK触发器。其逻辑符号如图所示。名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 5 页,共 9 页 - - - - - - - - - 时钟 C端加小圆圈,表示C脉冲下降沿触发翻转。当输入 JK=00时不管
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