2022年2022年静态时序分析的背景 .pdf
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1、静态时序分析的背景出自易达百科跳转到:导航, 搜索高性能 集成电路 通常根据其工作的 时钟频率 来描述其特性。评定一个集成电路在特定速度上的工作能力要求能够在设计过程中测量它在几个处理阶段上的延时。此外,计算延时 必须在设计的不同阶段与时序优化相结合,例如逻辑综合 、版图设计( 布局和布线),以及在设计周期后期进行的适当优化。尽管这样的时序测量在理论上能够使用仿真来实现,但仿真的方法在实际使用中非常耗时。静态时序分析在快速而又精确地测量电路时序方面扮演着重要的角色。简化的时序模型使得静态时序分析的速度相对较快,但静态时序分析在考虑信号间逻辑交互的影响方面受到了一定的限制。目录 隐藏 1 动态仿
2、真存在的缺陷2 静态时序分析的优点3 静态时序分析的缺点4 静态时序分析的应用o4.1 基于静态时序分析的Sign-Off动态仿真存在的缺陷传统上,人们使用动态仿真来验证整个设计或部分设计的功能和时序。动态时序仿真需要专门设计的仿真向量来检验设计中的时序关键路径和时序信息。这种方法根据芯片的动态时序行为使用输入向量来检验功能路径。基于动态仿真的方法既能够验证设计的功能也能够验证设计的时序,这是一种非常流行的时序验证策略。当今,设计人员在整个设计周期中需要花费50% 的时间来执行设计的功能和时序验证。设计人员必须为验证创建独立时序向量和功能向量。创建能够彻底地检验设计中每一条路径的时序向量是非常
3、困难的。随着设计尺寸和复杂性的增加,并且由于上市时间的压力导致整个设计计划缩短,向量产生问题逐渐爆发出来。 现存的仿真工具并没有足够的性能和能力对几百万门的设计进行完整的时序名师资料总结 - - -精品资料欢迎下载 - - - - - - - - - - - - - - - - - - 名师精心整理 - - - - - - - 第 1 页,共 3 页 - - - - - - - - - 仿真。更大设计的出现以及庞大的向量集合使得动态仿真在设计流中成为一个严重的瓶颈。上市时间的压力、 芯片的复杂度、 传统仿真器速度和能力上的限制都促进了时序分析技术向静态时序分析技术迁移。静态时序分析的优点静态时
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