逻辑电路预习资料.docx
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1、74LS00构造一个基本RS锁存器的逻辑图约束条件RS=O 真值表S（置T端）R（置。端）Q*（次态）Q*（次态）00QQ1010010111不稳定状态2、74LS74 资料74LS74内含两个独立的D二升沿双d触发器.每个触发器数M输入Dj、/的输入（斗）空位强入（&D ）、时冲输入（CP，和数辆输出（Q、） . 与、*D的低电中使输Hi段皆或清衿.而与其它输入端的电中无差。N 腔、&Q均无效岛电丫式）时，符合4。时间的。敏推4CP上 开沿作用下传迂到输出端。74IS74功能表：除入也出St)%CPDQn+1Qn+101XX1010XX0100XX中P11111011100111IXQnQn
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