数字电子技术基础试题及复习资料.docx
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1、系别 专业(班级) 姓名 学号 密封装订线数字电子技术根底期末考试试卷课程名称数字电子技术根底 A卷考试形式 闭 卷考核类型 考试本试卷共 4 大题,卷面满分100分,答题时间120分钟。题号一二三四总分复核人得分得分评卷人一、填空题:(每小题2分,共10分)1二进制数(1011.1001)2转换为八进制数为(13.41),转换为十六进为B9。2数字电路根据是否具有记忆功能通常可分为两类:组合逻逻辑电路、时序逻辑电路。3已知逻辑函数FAB,它的及非-及非表达式为,或及非表达式为。45个变量可构成32个最小项,变量的每一种取值可使1个最小项的值为1。5555定时器构成的施密特触发器,若电源电压V
2、CC12V,电压限制端经0.01F电容接地,则上触发电平UT+V,下触发电平UTV。得分评卷人密封装订线二、化简题:(每小题10分,共20分)1用代数法将下面的函数化为最简及或式:F=C+(B+C)D2. 用卡诺图法将下列函数化简为最简及或式:F(A、B、C、D)=m(0,2,4,5,7,13)+d(8,9,10,11,14,15)得分评卷人三、分析题:(每小题10分,共40分)1试分析题1图所示逻辑电路,写出逻辑表达式和真值表,表达式化简后再画出新的逻辑图。题1图密封装订线274161组成的电路如题 2 图所示,分析电路,并答复以下问题: (1)画出电路的状态转换图(Q3Q2Q1Q0); (
3、2)说出电路的功能。(74161的功能见表) 题 2 图3分析如题3图所示由边沿JK 触发器组成的时序逻辑电路,写出电路的驱动方程、状态方程,画出状态转换图。 题3图密封装订线4. 图4是用555定时器构成的压控振荡器,试分析输入限制电压和振荡频率之间的关系。当上升时输出的频率是上升还是降低?题4图得分评卷人四、设计题:(每小题10分,共30分)1.请用一片4线-16线译码器74154和适量的及非门设计一个能将8421BCD码转换为2421BCD码的码转换器。(2421BCD码的编码表和74154的逻辑符号如下图所示)2.设计一个同步时序电路,只有在连续两个或者两个以上时钟作用期间两个输入信号
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