学习verilog DHL问题笔记——Quartus常见错误(2页).doc
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1、-我初学verilog语言,很多细节都没注意,按着自己的思想就写了,编译的时候才发现各种问题。这些都是我在学习中遇到的问题,还是很常见的。1.Error (10028): Cant resolve multiple constant drivers for net 解析:不能在两个以上always内对同一变量赋值,这个细节一般看书看资料会看到,但是编程时,就是没想到。2.Error (10158): Verilog HDL Module Declaration error at clkseg.v(1): port XXXX is not declared as port解析:大意了,端口类型还
2、没定义啊!3.Error (10110): variable en has mixed blocking and nonblocking Procedural Assignments - must be all blocking or all nonblocking assignments解析:en在程序中有时用非阻塞赋值,有时用阻塞赋值,这是禁止的。在初学的时候,可能分得不是很清楚,所以在检查时,一定要一步步观察慢慢来。4.Error (10161): Verilog HDL error at clkseg.v(36): object count is not declared解析:这个错误
3、应该很明显啦,只要能读得懂。5.Error (10170): Verilog HDL syntax error at clkseg.v(37) near text *; expecting ;解析:意思应该也很简单,就是检查的时候要细心点。6.Error (10171): Verilog HDL syntax error at ir_ctrl.v(149) near end of file ; expecting an identifier, or endmodule, or a parallel statement解析:最后上了endmodule。一般编程的程序长了,到最后也就容易忘记。7.
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- 学习verilog DHL问题笔记Quartus常见错误2页 学习 verilog DHL 问题 笔记 Quartus 常见 错误
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