计算机组成原理实验报告5.doc

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1、计算机组成原理实验5【实验环境】1. Windows 2000 或 Windows XP2. QuartusII9.1 sp2、DE2-115计算机组成原理教学实验系统一台，排线若干。【实验目的】1、熟悉VHDL语言的编写。 2、验证计数器的计数功能。【实验要求】本实验要求设计一个4位二进制计数器。要求在时钟脉冲的作用下，完成计数功能，能在输出端看到0-9，A-F的数据显示。（其次要求下载到实验版实现显示）【实验原理】 名词解释1.计算机系统：由硬件和软件两大部分组成，有多种层次结构。2.主机：CPU、存储器和输入输出接口合起来构成计算机的主机。3.主存：用于存放正在访问的信息4.辅存：用于存

2、放暂时不用的信息。5.高速缓存：用于存放正在访问信息的付本。6.中央处理器：是计算机的核心部件，由运算器和控制器构成。7.硬件：是指计算机实体部分，它由看得见摸得着的各种电子元器件，各类光、电、机设备的实物组成。软件：指看不见摸不着，由人们事先编制的具有各类特殊功能的程序组成。8.系统软件：又称系统程序，主要用来管理整个计算机系统，监视服务，使系统资源得到合理调度，高效运行。应用软件：又称应用程序，它是用户根据任务需要所编制的各种程序。9.源程序：通常由用户用各种编程语言编写的程序。目的程序：由计算机将其翻译机器能识别的机器语言程序。10.总线：是连接多个部件的信息传输线，是各部件共享的传输介

3、质。11.系统总线：是指CPU、主存、I/O设备（通过I/O接口）各大部件之间的信息传输线。通信总线：是指用于计算机系统之间或者计算机系统与其他系统（如控制仪表、移动通信）之间的通信的线路。按传送方式分并行和串行。串行通信是指数据在单条1位宽的传输线上，一位一位的按顺序分时传送。并行通信是指数据在多条并行1位宽的传输线上，同时由源传送到目的地。12.带宽：单位时间内可以传送的最大的信息量。13.机器字长：是指CPU一次并行处理数据的位数，通常与CPU的寄存器位数有关。14.主存容量：是指主存中存放二进制代码的总位数。15.机器数：符号位数字化，0代表正数，1代表负数。16.定点数：小数点固定在

4、某一位位置的数。17.浮点数：小数点的位置可以浮动的数。18.补码：带符号数据表示方法之一，正数的反码和原码相同，负数的反码是将二进制按位取反后在最低位再加1.19.溢出：在计算机中，超出机器字长，发生错误的结果。20.非编码键盘：采用软件判断键是否按下及设键、译键、计算键值的方法的键盘。21.A/D转换器：它能将模拟量转换成数字量，是计算机的输入设备。22.I/O接口：指主机与I/O设备之间设置的一个硬件电路及器相应的软件控制。23.端口：指接口电路中的一些寄存器，用来存放数据信息、控制信息和状态信息。24.中断：计算机在执行程序的过程中，当出现异常情况或特殊请求时，计算机停止现行程序的运行

5、转向对这些异常情况或特殊请求处理，处理结束后再返回到现行程序的间断处，继续执行源程序。25.中断源：凡能向CPU提出中断请求的各种因素统称为中断源。26.中断嵌套：计算机在处理中断的过程中，有可能出现新的中断请求，此时CPU暂停现行中断服务程序，转向新的中断请求，这种现象称为中断嵌套。27.优先级：为使系统能及时响应并处理发生的所有中断，系统根据引起中断事件的重要性和紧迫程度，硬件将中断源分为若干个级别。28.DMA方式：用硬件在主存与外设之间直接进行数据传送，不须CPU，用软件控制。29.指令系统：将全部机器指令的集合称为机器的指令系统。30.寻址方式：是指确定本条指令的数据地址以及下一条将

6、要执行的指令地址的方法，它与硬件结构紧密相关，而且直接影响指令格式和指令功能。31.指令周期：完成一条指令的时间，由若干机器周期组成。机器周期：完成摸个独立操作，由若干时钟周期组成。时钟周期：最基本时间单位，由主频决定。32.微操作：在微程序控制器中，执行部件接受微指令后所进行的最基本的操作。33.微指令：控制器存储的控制代码，分为操作控制部分和顺序控制部分，由微命令组成。34.微程序：存储在控制存储器中的完成指令功能的程序，由微指令组成。35.控制存储器：CPU内用于存放实现指令系统全部指令的微程序的只读存储器。二、计算3.14. 设总线的时钟频率为8MHZ，一个总线周期等于一个时钟周期。如

7、果一个总线周期中并行传送16位数据，试问总线的带宽是多少？解：由于：f=8MHz,T=1/f=1/8M秒，因为一个总线周期等于一个时钟周期所以：总线带宽=16/（1/8M） = 128Mbps=16MBps3.15. 在一个32位的总线系统中，总线的时钟频率为66MHZ，假设总线最短传输周期为4个时钟周期，试计算总线的最大数据传输率。若想提高数据传输率，可采取什么措施？解：总线传输周期=4*1/66M秒总线的最大数据传输率=32/(4/66M)=528Mbps=66MBps若想提高数据传输率，可以提高总线时钟频率、增大总线宽度或者减少总线传输周期包含的时钟周期个数。3.16. 在异步串行传送系

8、统中，字符格式为：1个起始位、8个数据位、1个校验位、2个终止位。若要求每秒传送120个字符，试求传送的波特率和比特率。解：一帧包含：1+8+1+2=12位故波特率为：（1+8+1+2）*120=1440bps比特率为：8*120=960bps4.5. 什么是存储器的带宽？若存储器的数据总线宽度为32位，存取周期为200ns，则存储器的带宽是多少？解：存储器的带宽指单位时间内从存储器进出信息的最大数量。存储器带宽 = 1/200ns 32位 = 160M位/秒 = 20MB/秒（注：1ns=10-9s）4.7. 一个容量为16K32位的存储器，其地址线和数据线的总和是多少？当选用下列不同规格的

9、存储芯片时，各需要多少片？1K4位，2K8位，4K4位，16K1位，4K8位，8K8位解：地址线和数据线的总和 = 14 + 32 = 46根；选择不同的芯片时，各需要的片数为：1K4：（16K32） / （1K4） = 168 = 128片2K8：（16K32） / （2K8） = 84 = 32片4K4：（16K32） / （4K4） = 48 = 32片16K1：（16K32）/ （16K1） = 132 = 32片4K8：（16K32）/ （4K8） = 44 = 16片8K8：（16K32） / （8K8） = 24 = 8片6.4. 设机器数字长为8位（含1位符号位在内），写出对应

10、下列各真值的原码、补码和反码。 -13/64，-87解：真值与不同机器码对应关系如下：仙女屋真值-13/64-87原码1.001 10101，101 0111补码1.11001101，0101001反码1.11001011，01010006.5. 已知x补，求x原和x。x1补=1.1100; x2补=1.1001; x4补=1.0000;x5补=1,0101; x6补=1,1100; x8补=1,0000; 解：x补与x原、x的对应关系如下：真值-1/4-7/16-1-11-4-16x补1.11001.10011.00001,01011,11001,0000x原1.01001.0111无1,1

11、0111,0100无x-0.0100-0.0111-1.0000-1011-0100-100006.9. 当十六进制数9B和FF分别表示为原码、补码、反码、移码和无符号数时，所对应的十进制数各为多少（设机器数采用一位符号位）？ 解：真值和机器数的对应关系如下：原码补码移码无符号数9BH-27-101+27155原码补码移码无符号数FFH-128-1+1282566.12. 设浮点数格式为：阶码5位（含1位阶符），尾数11位（含1位数符）。写出-27/1024、-86.5所对应的机器数。要求如下：（1）阶码和尾数均为原码。（2）阶码和尾数均为补码。（3）阶码为移码，尾数为补码。 解：据题意画出该

12、浮点数的格式：阶符1位阶码4位数符1位尾数10位将十进制数转换为二进制: x1= -27/1024= -0.0000011011B = 2-5*(-0.11011B）x3=-86.5=-1010110.1B=27*(-0.10101101B)则以上各数的浮点规格化数为：（1）x1原=1，0101；1.110 110 000 0x3原=0，0111；1.101 011 010 0（2）x1补=1，1011；1.001 010 000 0x3补=0，0111；1.010 100 110 0（3）x1移补=0，1011；1.001 010 000 0 x3移补=1，0111；1.010 100 11

13、0 06.19. 设机器数字长为8位（含1位符号位），用补码运算规则计算下列各题。（2）A=19/32，B=-17/128，求A-B。（4）A=-87，B=53，求A-B。解：（2）A=19/32= 0.100 1100B, B= -17/128= -0.001 0001BA补=00.100 1100, B补=11.110 1111 , -B补=00.001 0001A-B补=A补+-B补=00.1001100 + 00.0010001=00.1011101 无溢出A-B= 0.101 1101B = 93/128B（4）A= -87= -101 0111B, B=53=110 101BA补=

14、11, 010 1001, B补=00, 011 0101, -B补=11, 100 1011A-B补=A补+-B补= 11,0101001 + 11,1001011= 10,1110100 溢出6.21. 用原码加减交替法和补码加减交替法计算xy。（2）x=-0.10101， y=0.11011；（4）x=13/32， y= -27/32。（2）x原=1.10101 x*=0.10101 X*补=1.01011 XfYf=10.10101+1.001011.1101001.10100+0.11011 0.0111100.11110+1.001010.000110110.00110+1.001

15、011.0101101100.10110+0.110111.10001011001.00010+0.110111.11101011000y原=0.11011 y*=0.11011 Y*补=0.11011 -y*补=1.00101x/y原=1.11000（4）做法相同，打表格太累，仅给出结果。x/y原=1.01111三、应用4.14. 某8位微型机地址码为18位，若使用4K4位的RAM芯片组成模块板结构的存储器，试问：（1）该机所允许的最大主存空间是多少？（2）若每个模块板为32K8位，共需几个模块板？（3）每个模块板内共有几片RAM芯片？（4）共有多少片RAM？（5）CPU如何选择各模块板？解

16、：（1）该机所允许的最大主存空间是：218 8位 = 256K8位 = 256KB（2）模块板总数 = 256K8 / 32K8 = 8块（3）板内片数 = 32K8位 / 4K4位 = 82 = 16片（4）总片数 = 16片8 = 128片（5）CPU通过最高3位地址译码输出选择模板，次高3位地址译码输出选择芯片。地址格式分配如下： 4.29. 假设CPU执行某段程序时共访问Cache命中4800次，访问主存200次，已知Cache的存取周期为30ns，主存的存取周期为150ns，求Cache的命中率以及Cache-主存系统的平均访问时间和效率，试问该系统的性能提高了多少倍？解：Cache

17、被访问命中率为：4800/(4800+200)=24/25=96%则Cache-主存系统的平均访问时间为：ta=0.96*30ns+(1-0.96)*150ns=34.8nsCache-主存系统的访问效率为：e=tc/ta*100%=30/34.8*100%=86.2%性能为原来的150ns/34.8ns=4.31倍，即提高了3.31倍。例7.2设相对寻址的转移指令占3个字节，第一字节为操作码，第二，三字节为相对位移量（补码表示）。而且数据在存储器中采用以低字节地址为字地址的存放方式。每当CPU从存储器取出一个字节时，即自动完成（PC）+1 PC。（1）若PC当前值为240（十进制），要求转移

18、到290（十进制），则转移指令的第二、三字节的机器代码是什么？（2）若PC当前值为240（十进制），要求转移到200（十进制），则转移指令的第二、三字节的机器代码是什么？解:（1）PC当前值为240，该指令取出后PC值为243，要求转移到290，即相对位移量为290-243=47，转换成补码为2FH。由于数据在存储器中采用以低字节地址为字地址的存放方式，故该转移指令的第二字节为2FH，第三字节为00H。（2）PC当前值为240，该指令取出后PC值为243，要求转移到200，即相对位移量为200-243=-43，转换成补码为D5H。由于数据在存储器中采用以低字节地址为字地址的存放方式，故该转移指

19、令的第二字节为D5H，第三字节为FFH。例7.3一条双字长直接寻址的子程序调用指令，其第一个字为操作码喝寻址特征，第二个字为地址码5000H。假设PC当前值为2000H，SP的内容为0100H，栈顶内容为2746H，存储器按字节编址，而且进栈操作时执行（SP）-P，后存入数据。试回答下列几种情况下，PC、SP及栈顶内容各为多少？（1）CALL指令被读取前。（2）CALL指令被执行后。（3）子程序返回后。解CALL指令被读取前，PC=2000H，SP=0100H，栈顶内容为2746H。（1）CALL指令被执行后，犹豫存储器按字节编制，CALL指令供占4个字节，故程序断电2004H进栈，此时SP=

20、（SP）-2=00FEH，栈顶内容为2004H，PC被更新为子程序入口地址5000H。（2）子程序返回后，程序断点出栈，PC=2004H，SP被修改为0100H，栈顶内容为2746H。7.6某指令系统字长为16位，地址码取4位，试提出一种方案，使该地址系统有8条三地址指令、16条二地址指令、100条一地址指令。解：OPA2A1A0三地址指令8条00000111OPA1A0二地址指令16条1000000010001111OPA0一地址指令100条1100000000001100011000117.7设指令字长为16位，采用扩展操作码技术，每个操作码的地址为6位。如果定义了13条二地址指令，试问还

21、可安排多少条一地址指令。解：（24-3）*26=3*64=192条7.8某机指令字长16位，每个操作数的地址码为6位，设操作码长度固定，指令分为零地址，一地址和二地址三种格式，若零地址指令有M种，以抵制指令有N种，则二地址指令最多有几种？若操作码位数可变，则二地址指令最多允许有几种？解：1）若采用定长操作码时，二地址指令格式如下：OP（4位）A1（6位）A2（6位）设二地址指令有K种，则：K=24-M-N当M=1（最小值），N=1（最小值）时，二地址指令最多有：Kmax=16-1-1=14种2）若采用变长操作码时，二地址指令格式仍如1）所示，但操作码长度可随地址码的个数而变。此时，K= 24

22、-（N/26 + M/212 ）；当（N/26 + M/212 ）1时（N/26 + M/212 向上取整），K最大，则二地址指令最多有：Kmax=16-1=15种（只留一种编码作扩展标志用。）9.5设机器A的CPU主频为8MHz，机器周期为4个时钟周期，且该机的平均指令执行速度是0.4MIPS，试求该机的平均指令周期和机器周期，每个指令周期中含几个机器周期？如果机器B的CPU主频为12MHz，且机器周期也含有4个时钟周期，试问B机的平均指令执行速度为多少MIPS?A.CLK=8MHz T=1/8MHz=0.125us机器周期=4*T=0.5us因为执行速度为0.4MIPS 所以平均指令周期=

23、1/0.4MIPS=2.5us2.5us/0.5us=5个 所以每个指令含有5条机器指令B.T=1/f=1/12MHz=1/12us 机器指令=4*T=1/3us 指令周期=5*1/3=5/3us平均指令执行速度 1/(5/3)=0.6MIPS9.6设某计算机的CPU主频为8MHz，每个机器周期平均含2个时钟周期，每条指令平均有4个机器周期，试问该计算机的平均指令执行速度为多少MIPS?若CPU主频不变，但每个机器周期平均含4个时钟周期，每条指令平均有4个机器周期，试问B机的平均指令执行速度为多少MIPS?1.CLK=8MHz 平均指令执行速度1/(1/8M*2*4)=1MIPS2.指令周期=

24、4*4*1/8=2us 执行速度=1/(1/8M*4*4)=0.5MIPS9.7某CPU的主频为10MHz，若已知每个机器周期平均含有4个时钟周期，该机的平均指令执行速度为1MIPS，试求该机的平均指令执行速度为多少MIPS?若CUP主频不变，但每个机器周期平均含有4个时钟周期，每条指令平均有4个机器周期，则该机的平均指令执行速度又是多少MIPS？由此可得出什么结论1.平均指令周期=1/1MIPS=1us T=1/f=0.1us T机=4*T=0.4us因为1us/0.4us=2.5 所以每个指令包含2.5个机器周期2.T=0.4us 速度=1/(0.4*2.5*4)=0.25MIPS3.因为

25、速度=0.8MIPS 所以T指=1/0.8us因为T指=4*2.5*T 所以T=1/8us 所以 f=1/T=8MHz 四、简答1.冯诺依曼机主机主要特点。1计算机由运算器、存储器、控制器、输入设备和输出设备五大部件组成。2.指令和数据一同等地位存放于存储器内，并可按地址寻访。3.指令和数据均用二进制表示。4.指令由操作吗和地址码组成，操作码用来表示操作的性质，地址码用来表示操作数在存储器中的位置。5.采用存储控制原理，指令在存储器内按顺序存放。通常指令是顺序执行的，在特定条件下，可根据运算结果或根据设定的条件改变执行顺序。6.机器以运算器为中心，输入输出设备与存储器间的数据传说通过运算器完成

26、。2.计算机硬件主要技术指标，软件定义与分类。计算机硬件主要技术指标：机器字长、存储容量、运算速度、主频等。软件定义：看不见摸不着，由人们事先编制的具有各类特殊功能的程序组成。分类：系统软件和应用软件。3.计算机组成部分与个部分作用。运算器：用来完成算术运算和逻辑运算，并将运算的中间结果暂存在运算器内。存储器：用来存放数据和程序。控制器：用来控制、指挥程序和数据的输入、运行以及处理器运算结果。输入设备：用来将人们熟悉的信息形式转换为机器能识别的信息形式，常见的有键盘、鼠标等。输出设备：可将机器运算结果转换为人们熟悉的信息形式，如打印机输出，显示器输出等。4.总线定义与分类方法，系统总线定义与分

27、类方法。总线定义：总线是连接多个部件的信息传输线，是各部件共享的传输介质。分类：片内总线 系统总线 通信总线系统总线定义：系统总线是指CPU、主存、I/O设备（通过I/O接口）各大部件之间的信息传输线。分类： 数据总线 地址总线 控制总线5.什么是总线标准，目前流行的总线标准有哪些。所谓总线标准可视为系统与各模块，模块与模块之间的一个互连的标准界面。ISA总线、EISA总线、PCI总线、RS232C总线、IEEE-488(并行通信总线又称GP-IP总线)USB总线。6.三级存储器系统中各级存储器特点与用途，分哪两个层次。1主存 特点：随机访问、速度快。容量大。用途：存放CPU使用的程序和数据。

28、辅存 特点：容量大、速度慢、价格低、可脱机保存信息。用途：存放大量后备数据缓存 特点：速度快、容量小、价格高 用途：用于主存与辅存之间作为缓冲，正在使用的程序和数据的付本。2缓存-主存层次和主存-辅村层次。7.半导体存储器RAM与ROM特点与用途。RAM特点：可读可写掉电后信息丢失，存临时信息。用途：主要做内存ROM特点：只读不写掉电后信息不丢失，存长期信息。用途：主要做控制存储器8.动态RAM与静态RAM特点与用途，DRAM刷新方式与主要优点。静态RAM特点：信息读出后，仍保持其原有状态，不需要再生。用途：用于Cache动态RAM特点：靠电容存储电荷的原理来寄存信息。用途：组成内存/主存。D

29、RAM刷新方式集中刷新：集中刷新是在规定的一个刷新周期内对全部存储单元集中一段时间逐行进行刷新，此刻必须停止读写操作。分散刷新：分散刷新是指对每行存储单元的刷新分散到每个存储周期内完成。异步刷新：异步刷新是前两种方式的结合，它即可缩短“死时间”，又充分利用最大刷新间隔2ms的特点。优点：单个MOS管组成，集成度高，速度较SRAM慢，价格低，9.Cache工作原理特点，地址映射方式与替换算法。原理：利用程序访问的局部性，近期用到信息存于cache。地址映射方式：直接映射、全相联映射、组相联映射、替换算法：先进先出算法（FIFO）、近期最少使用算法（LRU）、随机法。10.主机与外设交换信息采用中

30、断与DMA方式特点与应用场合。中断方式：特点：CPU与外设并行工作，效率高应用场合：管理多种外设并行工作、进行实时处理、进行故障自动处理DMA方式：特点：1从数据传送看，程序中断方式靠程序传送，DMA方式靠硬件传送。2从CPU响应时间看，程序中断方式是在一条指令执行结束时响应，而DMA方式可在指令周期内的任一存取周期结束时响应。3程序中断方式有处理异常事件能力，DMA方式没有这种能力，主要用于大批数据的传送，如硬盘存取、图像处理、高速数据采集系统等，可提高数据吞吐量。4程序中断方式需要中断现行程序，故需保护现场；DMA方式不中断现行程序，无须保护现场。5DMA的优先级比程序中断的优先级高。应用

31、场合：高速设备 如硬盘11.I/O端口与接口的区别，I/O接口分类方法。端口：接口内部寄存器有I/O地址号。一般分为数据口、命令口和状态口。接口：若干端口加上相应的控制电路组成。接口分类：按数据传送方式分串行接口和并行接口按功能选择的灵活性分为可编程接口和不可编程接口按通用性分为通用接口和专用接口按数据传送的控制方式分为程序型接口和DMA接口。12.中断处理过程分成哪两个阶段各完成哪些任务响应阶段：关中断、保护断点地址、转入中断服务入口地址处理阶段：保护现场、执行用户编写的中断服务程序、恢复现场。13.与中断方式比较MDA方式主要特点是什么。1从数据传送看，程序中断方式靠程序传送，DMA方式靠

32、硬件传送。2从CPU响应时间看，程序中断方式是在一条指令执行结束时响应，而DMA方式可在指令周期内的任一存取周期结束时响应。3程序中断方式有处理异常事件能力，DMA方式没有这种能力，主要用于大批数据的传送，如硬盘存取、图像处理、高速数据采集系统等，可提高数据吞吐量。4程序中断方式需要中断现行程序，故需保护现场；DMA方式不中断现行程序，无须保护现场。5DMA的优先级比程序中断的优先级高。14.什么是寻址方式，数据寻址方式有哪几种。寻址方式：是指确定本条指令的数据地址以及下一条将要执行的指令地址的方法，它与硬件结构紧密相关，而且直接影响指令格式和指令功能。数据寻址方式：立即寻址、直接寻址、隐含寻

33、址、间接寻址、寄存器寻址、寄存器间接寻址、基址寻址、变址寻址、相对寻址、堆栈寻址。15.RISC主要特点与CISC相比较RISC主要优点。特点：选用使用频率较高的一些简单指令以及一些很有用但又不复杂的指令，让复杂指令的功能由频度高的简单指令的组合来实现；指令长度固定指令格式种类少，寻址方式种类少；只有取数/存数指令访问存储器，其余指令的操作都在寄存器内完成；采用流水线技术，大部分指令在一个时钟周期内完成；控制器采用组合逻辑控制，不用微程序控制；采用优化的编译程序。1充分利用VLSI芯片的面积。2提高计算机运算速度。3便于设计可降低成本提高可靠性。4有效支持高级语言程序。16.组合逻辑与微程序设

34、计主要特点与应用。组合逻辑：特点：速度快、复杂不灵活。应用：适用于RISC机。微程序：特点：引入程序设计与存储逻辑技术，硬件软化，把一条机器指令用一段微程序来实现，存放控制存储器CM中。应用：系列机。17.什么是指令周期、机器周期、时钟周期 三者的关系如何。指令周期：完成一条指令的时间，由若干机器周期组成。机器周期：完成摸个独立操作，由若干时钟周期组成。时钟周期：最基本时间单位，由主频决定。关系：时钟周期是最基本时间单位，由若干时钟周期组成机器周期，由若干机器周期组成指令周期。【实验步骤】1.1 顶层VHDL文件设计1.1.1 创建工程和编辑设计文件 首先建立工作库，以便设计工程项目的存储。任

35、何一项设计都是一项工程（Project），都必须首先为此工程建立一个放置与此工程相关的所有文件的文件夹，此文件夹将被EDA软件默认为工作库（Work Library）。 在建立了文件夹后就可以将设计文件通过QuartusII的文本编辑器编辑并存盘，详细步骤如下： 首先新建一个文件夹。利用资源管理器，新建一个文件夹,如：d : li1 。注意，文件夹名不能用中文。1、创建一个工程(1) 、双击桌面上的图标 ，打开Quartus II 软件。 （2）、再开始建立新项目工程。点击：【File】菜单，选择下拉列表中的【New Project Wizard.】命令，打开建立新项目工程的向导对话框。点击n

36、ext.（3）出现对话框，让你选择项目工程保存位置、定义项目工程名称以及设计文件顶层实体名称。如图：第一栏选择项目工程保存的位置，方法是点击 按钮，选择到刚才我们在第一步建立的文件夹。第二栏用于指定项目工程名称。项目名可以取任意名字，也可以直接用顶层文件名作为项目名（建议使用）。第三栏用于指定顶层文件的实体名称。软件会默认为与之前建立的项目工程名称一致。没有特别需要，我们一般选择软件的默认，不必特意去修改。需要注意的是：以上名称的命名中不能出现中文字符，否则软件的后续工作会出错。完成以上命名工作后，点击Next，进入下一步。（4）这一步的工作是让你将之前已经设计好的工程文件添加到本项目工程里来

37、，我们之前若没有设计好的文件，就不用理它，跳过这一步，直接点Next，再进入下一步。如下图对话框：（5）这一步的工作是让你选择好设计文件下载所需要的可编程芯片的型号，实验中我们所用的实验平台是DE2-115开发板，因此我们选择Cyclone IV E,EP4CE115F29C7。点击Next，进入下一步。如下图对话框：（6）这一步是让你选择第三方开发工具，我不需要，直接点击Next，进入下一步。出现下图页面（7）以上页面显示刚才我们所做的项目工程设置内容的“报告”。点击Finish，完成新建项目工程的任务。 2、输入源程序。 （1）新建一个VHDL项目文件。 打开QuartusII，选择菜单“

38、File”“New”，在New窗中的“ Design Files”中选择编译文件的语言类型，选“VHDL File”（如图所示）。 图 选择编辑文件的语言类型（2）然后在VHDL文本编译窗中键入VHDL程序。VHDL语言的程序代码如下图所示： 其中，CLK是时钟信号，CQ是4位数据输出端。每当检测到CLK出现一个上升沿时，计数器就自加1并输出结果。（3）键入程序后，点击保存，选择默认保存名。1.1.2 编译文件。在【Processing 】菜单下，点击【Start Compilation】命令，或直接点击常用工具栏上的 按钮，开始编译我们的项目。编译成功后，点击 确定 按钮。点击Process

39、ing-Start Compilation，如下图： 1.1.3 波形仿真仿真是指利用QuartusII软件对我们设计的电路的逻辑功能进行验证，看看在电路的各输入端加上一组电平信号后，其输出端是否有正确的电平信号输出。因此在进行仿真之前，我们需要先建立一个输入信号波形文件。方法和步骤如下：（1） 新建一个波形仿真文件 在【File】菜单下，点击【New】命令。在随后弹出的对话框中，选择【Verification/Debugging Files】模块，选中【Vector Waveform File】选项，点击 OK 按钮。（2）在【Edit】菜单下，点击【Insert Node or Bus】命

40、令，或在下图Name列表栏下方的空白处双击鼠标左键，打开编辑输入、输出引脚对话框。弹出Insert Node or Bus对话框，如图所示：（3）在上图新打开的对话框中点击【Node Finder】按钮，打开【Node Finder】对话框。点击【List】按钮，列出电路所有的端子。点击 按钮，全部加入。点击 OK 按钮，确认。点击OK回到 Insert Node or Bus 对话框，再点击 OK 按钮，确认。 （4）图中带有符号的，都是输入信号，需要对其进行设置；带图标的都是输出信号，需要对其仿真以后的结果进行观察。 选中 CLK 信号，在 Edit 菜单下，选择【Value = Cloc

41、k】命令。或直接点击左侧工具栏上的（时钟按钮）按钮。在随后弹出的对话框的 Period 栏目中设定参数为20ns，点击 OK 按钮QuartusII软件集成了电路仿真模块，电路有两种模式：时序仿真和功能仿真，时序仿真模式按芯片实际工作方式来模拟，考虑了元器件工作时的延时情况，而功能仿真只是对设计的电路其逻辑功能是否正确进行模拟仿真。在验证我们设计的电路是否正确时，常选择“功能仿真”模式。（5） 将软件的仿真模式修改为“功能仿真”模式，操作方法如下图所示：（6） 选择好“功能仿真”模式后，需要生成一个“功能仿真的网表文件”，方法如图，选择【Processing】菜单，点击【Generate Fu

42、nctional Simulation Netlist】命令。 此后需要保存该波形文件，如图，选择默认文件名。软件运行完成后，点击确定。（7）开始功能仿真，在【Processing】菜单下，选择【Start Simulation】启动仿真工具，或直接点击常用工具栏上的按钮。仿真成功后，点击确认按钮。（8）观察仿真结果，对比输入与输出之间的逻辑关系是否符合电路的逻辑功能。仿真结果截图如图所示，时钟每经过一个上升沿，输出加1，达到设计效果。1.2 下载验证要将设计文件下载到硬件芯片中，我们事先一定要准备好一块装有可编程逻辑器件的实验板（或开发板）和一个USB下载工具，如下图ED2-115数字电子技

43、术实验板。由于不同的可编程逻辑器件的型号及其芯片的引脚编号是不一样的，因此在下载之前，我们先要对设计好的数字电路的输入、输出端根据芯片的引脚编号进行配置。在我们以后所做的实验中经常会用到的电路部分是拨动开关、按钮开关、二极管部分（如图所示）。芯片的部分引脚分配列表见附录1。1） 检查项目工程支持的硬件型号在开始引脚配置之前，先检查一下我们在开始建立项目工程时所指定的可编程逻辑器件的型号与实验板上的芯片型号是否一致，假如不一致，要进行修改，否则无法下载到实验板的可编程逻辑器件中。修改的方法如下：点击常用工具栏上的 按钮，打开项目工程设置对话框，如下图所示。（目标芯片的选择也可以这样来实现：选择“

44、Assignmemts”菜单中的“settings”项，在弹出的对话框中选“Compiler Settings” 项下的Device，首先选目标芯片：Cyclone IVE 中的EP4CE115F29C7（此芯片已在建立工程时选定了）)。如上图方法，选好芯片型号后，点击OK，即修改完成。修改完硬件型号后，最好重新对项目工程再编译一次，以方便后面配置引脚。编译的方法与上面所叙一样，简单来说，只要再点击一下常用工具栏上的 按钮，编译完成后，点击【确定】即可。2） 给设计好的原理图配置芯片引脚配置芯片引脚就是将原理图的输入端指定到实验板上可编程芯片与按钮相连的引脚编号，将输出端指定到实验板上可编程芯片与LED发光二极管相连的引脚编号。方法如下：点击常用工具栏上的 按钮，打开芯片引脚设置对话框，如下图： 根据图中提示完成引脚锁定。 芯片的引脚分配列表见附录表一。 本试验中，CLK连接到KEY1号按键，每按一下KEY1按键，都会产生一个脉冲，计数加1输出。CQ0-CQ3分别连接到LEDR0-LEDR3这4个红色二极管上，以二进制数输出0-15（0-1111）。 配置好引脚以后，再编译一次。