计算机组成原理课程设计讲义精选PPT.ppt
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1、计算机组成原理课程设计讲义第1页,此课件共31页哦课程设计目的l l掌握整机动态工作过程l l了解微程序控制器的设计,构建指令系统l l组建模型机,编写应用程序进行调试第2页,此课件共31页哦设计内容和要求1.设计内容设计内容(1)设计指令系统)设计指令系统(2)编写微程序)编写微程序(3)实验接线)实验接线(4)编写应用程序,选择实现下列要求的一种功能)编写应用程序,选择实现下列要求的一种功能输入两个一位十进制数,计算两数之和,并以输入两个一位十进制数,计算两数之和,并以BCD码输出码输出输入一个两位十进制数,求其负值的补码输入一个两位十进制数,求其负值的补码输入几个数,统计奇数和偶数的个数
2、输入几个数,统计奇数和偶数的个数2.设计要求设计要求(1)指令在)指令在8条以上条以上(2)寻址方式包括:寄存器寻址、直接寻址、立即数寻址)寻址方式包括:寄存器寻址、直接寻址、立即数寻址(3)数据由键盘输入)数据由键盘输入(4)由数码管显示结果)由数码管显示结果第3页,此课件共31页哦报告要求l l手写l l统一封面l l第一页为任务书l l内容包括:设计目的、设计器材、设计要求、模型机结构、指令编码、微程序、应用程序、接线图、调试、结果分析、总结等。l l收报告截止日期:17周周五第4页,此课件共31页哦EL-JY-组成原理实验仪介绍组成原理实验仪介绍 第5页,此课件共31页哦底板布局 第6
3、页,此课件共31页哦模型机结构框图 由4片74181构成16位ALUS3 S2 S1 S0 M Cn选择运算功能ALU_G为三态门输出控制信号,低电平可输出LT1、LT2为数据暂存器,各由2片74273构成LDR1、LDR2两个暂存器接数控制,高电平有效由Ax、Bx、Cx 构成寄存器堆 LRi为寄存器堆的写控制,高电平有效 RiG为寄存器输出控制,低电平有效 M S0 S1为移位寄存器功能选择,与ALU使用相同的控制信号 G-299为移位寄存器输出控制信号,低电平有效 在开关方式下,输入设备由16位电平开关及两个74244构成当DIJ-G为低电平时将16位开关状态送上数据总线 在键盘方式或联机
4、方式下,数据可由键盘或串口线输入,可以不用数据输入电路。输出设备由底板上的四个LED数码管及其译码、驱动电路构成 当D-G和W/R均为低电平时将数据总线的数据送入数码管显示 存储器部分由两片6116构成16位存储器,地址总线只用低八位CE为片选信号,低电平有效WE为读写信号,低电平写,高电平读LAR为地址寄存器的锁存控制,高电平有效LOAD为程序计数器的置数控制,高电平有效LPC为程序计数器的时钟控制,高电平有效PC-G为程序计数器的输出控制,低电平有效LDIR为指令寄存器的锁存控制,高电平有效第7页,此课件共31页哦工作原理 1数据格式本实验计算机采用定点补码表示法表示数据,字长为16位,其
5、格式如下:其中第16位为符号位,数值表示范围是:-32768X32767 1514 13 0符号尾 数第8页,此课件共31页哦2指令格式(1)算术逻辑指令设计9条单字长算术逻辑指令,寻址方式采用寄存器直接寻址。其格式如下 7 6 5 43 21 0OPrsrd第9页,此课件共31页哦其中OP为操作码,rs为源寄存器,rd为目的寄存器,并规定:OP011110001001 101010111100110111101111指令CLRMOV ADD SUBINCAND NOTRORROLrs或rd选定寄存器00Ax01Bx10Cx第10页,此课件共31页哦(2)存储器访问及转移指令 存储器的访问有两
6、种,即存数和取数。它们都使用助记符MOV,但其操作码不同。转移指令只有一种,即无条件转移(JMP)。指令格式如下:7 65 43 21 000MOPrdD第11页,此课件共31页哦其中OP为操作码,rd为寄存器。M为寻址模式,D随M的不同其定义也不相同,如下表所示:OP000110指令说明写存储器读存储器转移指令寻址模式M有效地址ED定义说 明00E=(PC)+1立即数立即寻址10E=D直接地址直接寻址11E=100H+D直接地址扩展直接寻址第12页,此课件共31页哦(3)I/O指令 输入(IN)和输出(OUT)指令采用单字节指令,其格式如下:其中,当OP=0100且addr=10时,从“数据
7、输入电路”中的开关组输入数据;当OP-CODE=0100且addr=01时,将数据送到“输出显示电路”中的数码管显示。7 6 5 43 21 0OPaddrrd第13页,此课件共31页哦3指令系统含14条基本指令,其中算术逻辑指令8条,访问内存指令和程序控制指令4条。输入输出指令2条。第14页,此课件共31页哦汇编符号指令的格式功 能MOV rd,rs1000 rs rdrsrdADD rd,rs1001 rs rdrs+rdrdSUB rd,rs1010 rs rdrd-rsrdINC rd1011 rd rdrd+1rdAND rd,rs1100 rs rdrsrdrdNOT rd1101
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