双稳态触发器和时序逻辑电路.ppt

《双稳态触发器和时序逻辑电路.ppt》由会员分享，可在线阅读，更多相关《双稳态触发器和时序逻辑电路.ppt（46页珍藏版）》请在淘文阁 - 分享文档赚钱的网站上搜索。

1、双稳态触发器和时序逻辑电路现在学习的是第1页，共46页 时序逻辑电路与输出状态不仅与输入变时序逻辑电路与输出状态不仅与输入变量有关，而且还与系统先前的状态有关。量有关，而且还与系统先前的状态有关。时序逻辑电路的特点：时序逻辑电路的特点：包括组合逻辑电路和具有记忆功能的电路包括组合逻辑电路和具有记忆功能的电路或反馈延迟电路。或反馈延迟电路。输入、输出之间至少有一条反馈路径。输入、输出之间至少有一条反馈路径。触发器是时序逻辑电路的基本单元，是一种触发器是时序逻辑电路的基本单元，是一种具有记忆功能的逻辑电路。能够储存一位二值信具有记忆功能的逻辑电路。能够储存一位二值信号。号。第一节第一节 基本基本双

2、稳态触发器双稳态触发器现在学习的是第2页，共46页双稳态触发器的特点：双稳态触发器的特点：具有两个能自行保持的稳定状态；具有两个能自行保持的稳定状态；根据不同的输入信号可以置成根据不同的输入信号可以置成“1”状态或状态或“0”状态；状态；在输入信号消失后，如果没有新的信号输入，在输入信号消失后，如果没有新的信号输入，能够保持原状态，直至下一个新的信号输入为止。能够保持原状态，直至下一个新的信号输入为止。现在学习的是第3页，共46页 基本基本RS 触发器触发器RD SD Q 0 1 1 0 1 1 0 0Q0110两个输出端反相，规定两个输出端反相，规定Q的状态为触发器的状态。的状态为触发器的状

3、态。即即Q0，Q=1时，称触发时，称触发器为器为0态，又称态，又称复位复位；Q1，Q=0时，称触发器时，称触发器为为1态，又称态，又称置位置位。不不 变变*不不 定定RD0，SD=1 触发器复位为0态，称RD为复位端；RD1，SD=0 触发器置位为1 态，称SD为置位端。ABQSDRDQRD、SD同为1，触发器保持原状态；RD、SD同为0，触发器状态无法确定，此情况应避免。现在学习的是第4页，共46页 与非门组成的与非门组成的RS触发器为负脉冲有效。触发器为负脉冲有效。基本基本RS触发器的约束条件是触发器的约束条件是 RDSD1逻辑符号逻辑符号QRDSDQ负脉冲有效 基本基本RS触发器的优点：

4、触发器的优点：结构简单，具有记忆功能。结构简单，具有记忆功能。基本基本RS触发器的缺点：触发器的缺点：输出直接受输入控制，具输出直接受输入控制，具 有不有不定状态。定状态。现在学习的是第5页，共46页第二节第二节 钟控钟控双稳态触发器双稳态触发器 钟控钟控RS 触发器触发器 J K 触发器触发器 D触发器触发器 TT 触发器触发器 触发器逻辑功能的转换触发器逻辑功能的转换 触发器应用触发器应用现在学习的是第6页，共46页一、钟控一、钟控RS 触发器触发器 为使触发器能按要求在某一时间翻转，外加为使触发器能按要求在某一时间翻转，外加一时钟脉冲一时钟脉冲CP来控制。来控制。BAQQ SDRDCDC

5、PRSR S Qn+1 0 0 0 1 1 0 1 1 10不定不定CP=0，CP=1，Qn C、D门门 被封锁；被封锁；复位端复位端RD、置位端、置位端SD负脉冲负脉冲有效，不受有效，不受CP控制控制。现在学习的是第7页，共46页 CP1时，触发器才能翻转。时，触发器才能翻转。CP控制触发器的翻转时刻，控制触发器的翻转时刻，R、S控制触发控制触发器的翻转状态。器的翻转状态。钟控钟控RS 触发器为正脉冲有效。触发器为正脉冲有效。逻辑符号逻辑符号 钟控钟控RS触发器的约束条件是触发器的约束条件是 RS0QRDSDQS RC现在学习的是第8页，共46页例：例：已知钟控已知钟控RS触发器（正脉冲有效

6、）的输触发器（正脉冲有效）的输入信号入信号RD、R、S波形如图，试画出波形如图，试画出Q的波形。的波形。CPQ1234RSRD现在学习的是第9页，共46页例：例：由钟控由钟控RS触发器组成的触发器组成的T触发器如图所示，触发器如图所示，可完成计数功能，试分析其逻辑功能。可完成计数功能，试分析其逻辑功能。解：解：RQ 可见，可见，CP脉冲来一个，触发器翻转一次，即脉冲来一个，触发器翻转一次，即T触发器可记录触发器可记录CP脉冲个数。脉冲个数。要求要求CP脉冲宽度要小于触发器翻转所需时间，脉冲宽度要小于触发器翻转所需时间，否则在一个否则在一个CP作用期间，触发器可能翻转多次，作用期间，触发器可能翻

7、转多次，即即“空翻空翻”。QRDSDQSR C 钟控RS触发器的CP对触发器 的控制是在一个时间间隔内，而不是 控制在某一时刻。现在学习的是第10页，共46页二二、主从型主从型J K 触发器触发器QQRDSDCPC主主触触发发器器JKSSRRC从从触触发发器器 主从型主从型J K 触发器由主触发器由主触发器和从触发器组成，触发器和从触发器组成，主触发器和从触发器时主触发器和从触发器时钟信号反相钟信号反相.当当CP上升沿上升沿 到来到来时，主触发器发生翻时，主触发器发生翻转，当转，当CP下降沿下降沿 到到来时，从触发器翻转，来时，从触发器翻转，从而保证在一个从而保证在一个CP周周期中，触发器的输

8、出期中，触发器的输出只改变一次。只改变一次。显然，输出状态在CP下降沿到达时改变。因此，这种触发器为下降沿触发。现在学习的是第11页，共46页J K Qn+1 0 0 0 1 1 0 1 1 01Qn Qn QQRDSDC主主触触发发器器JKSSRRC从从触触发发器器复位端复位端RD、置位端、置位端SD负脉负脉冲有效，不受冲有效，不受CP控制控制。现在学习的是第12页，共46页 主从型主从型J K 触发器将触发器的翻转控制在触发器将触发器的翻转控制在CP下降沿这一时刻。下降沿这一时刻。主从型主从型J K 触发器无不定状态，组成计数电路，触发器无不定状态，组成计数电路，可克服空翻。可克服空翻。主

9、从型主从型J K 触发器存在一次翻转的问题。即主触发器存在一次翻转的问题。即主触发器在触发器在CP1 期间只能翻转一次，要求期间只能翻转一次，要求J、K 状状态在态在CP1期间不能变化。期间不能变化。逻辑符号逻辑符号负脉冲有效下降沿触发QRDSDQJKC现在学习的是第13页，共46页例：例：已知已知JK触发器（下降沿触发）的输入信号触发器（下降沿触发）的输入信号J、K 波形如图，试画出波形如图，试画出Q的波形（的波形（Q初始状态为初始状态为0）。）。CPQ1234JK现在学习的是第14页，共46页三、三、D触发器触发器&1&4&3&2CPDQQDDDSDRD置置1阻塞线阻塞线置置0阻塞线阻塞线

10、置置0维持线维持线置置1维持线维持线&6&5D Qn+1 0 1 01 D触发器仅在触发器仅在CP前沿到达时前沿到达时翻转，是边沿触发器。翻转，是边沿触发器。现在学习的是第15页，共46页 D CPSDRDQQ逻辑符号逻辑符号 D 触发器无不定触发器无不定状态；克服空翻、一状态；克服空翻、一次翻转现象。次翻转现象。Q例：例：试画出试画出D触发器的输出波形（触发器的输出波形（Qn=0）。）。CPD123 D触发器的输出状态仅取决于CP上升 沿到达时刻输入的状态。现在学习的是第16页，共46页 四、四、TT 触发器触发器 T触发器触发器 CPSDRDQQ T 触发器触发器 CP TSDRDQQT

11、Qn+1 0 Qn 1 现在学习的是第17页，共46页五、触发器逻辑功能的转换五、触发器逻辑功能的转换 JK D 触发器触发器 JK T 触发器触发器CPJQKDD J K Qn+1 0 0 1 0 1 1 0 1CPJQKTT J K Qn+1 0 0 0 Qn 1 1 1 Qn现在学习的是第18页，共46页 D T触发器触发器DQC D JK 触发器触发器J K D Qn+1 0 0 0 1 1 0 1 1 01Qn Qn 01Qn Qn DQC&K J现在学习的是第19页，共46页例：例：已知各触发器的初态均为已知各触发器的初态均为0，A、B、C 波形波形如图，试画出如图，试画出Q波形。

12、波形。JQCP1ABCK11CPABC B C K 0 0 1A B C J0 1 0 1 0 1 1 11 0 1 11 1 0 1 1 1 1 1JKQ现在学习的是第20页，共46页第三节第三节 寄存器寄存器 数码寄存器数码寄存器 移位寄存器移位寄存器现在学习的是第21页，共46页一、数码寄存器一、数码寄存器 寄存器是用于存放各种数码和指令的时序电路寄存器是用于存放各种数码和指令的时序电路。由。由N个触发器组成的寄存器，能存储个触发器组成的寄存器，能存储N位二进位二进制代码。制代码。按功能分为数码寄存器和移位寄存器。按功能分为数码寄存器和移位寄存器。数码寄存器寄存数码时是从存入端同时数码寄

13、存器寄存数码时是从存入端同时存入，取出时又同时从取出端取出，所以又存入，取出时又同时从取出端取出，所以又称为并行输入并行输出寄存器。称为并行输入并行输出寄存器。现在学习的是第22页，共46页1011清零清零寄存寄存取出取出0000101101001011现在学习的是第23页，共46页二、移位寄存器二、移位寄存器 移位寄存器按移位方向不同又分为左移、右移位寄存器按移位方向不同又分为左移、右移和双向移位三种。移和双向移位三种。110100111101现在学习的是第24页，共46页 74LS194 四位双向移位寄存器 74LS164 八位串入并出移位 寄存器 74LS395四位移位寄存器常用寄存器集

14、成电路常用寄存器集成电路现在学习的是第25页，共46页第四节第四节 计数器计数器 异步二进制计数器异步二进制计数器 同步二进制计数器同步二进制计数器 十进制计数器十进制计数器现在学习的是第26页，共46页 计数器是统计输入脉冲个数的逻辑部件。除用计数器是统计输入脉冲个数的逻辑部件。除用于直接计数外，还可以用于定时、分频、产生节拍于直接计数外，还可以用于定时、分频、产生节拍脉冲以及进行数字运算等等。脉冲以及进行数字运算等等。按计数功能分类按计数功能分类加法计数器加法计数器减法计数器减法计数器可逆计数器可逆计数器按数制分类按数制分类二进制计数器二进制计数器二十进制计数器二十进制计数器按触发器翻转次

15、序分类按触发器翻转次序分类同步式计数器同步式计数器异步式计数器异步式计数器现在学习的是第27页，共46页一、异步二进制计数器一、异步二进制计数器 异步二进制加法计数器异步二进制加法计数器F1JQCPKQ0Q2F0JQKF2JQKQ10012345670计数顺序计数顺序等效十等效十进制数进制数Q2 Q1 Q0 0 00010 1 011111 0000011100 0 011J0K01J1K11J2K21CP1Q0CP2Q112345678 状状态态表表现在学习的是第28页，共46页CP 时序图时序图12345678Q2Q0Q1 若若CP的频率为的频率为f0，则，则Q0、Q1、Q2的频率的频率分

16、别为分别为f02，f04，f08。所以计数器有分频。所以计数器有分频作用。作用。现在学习的是第29页，共46页 一个触发器可表示一位二进制数，一个触发器可表示一位二进制数，N个触个触发器可表示发器可表示N位二进制数，构成位二进制数，构成N位二进制计数位二进制计数器，也可称为器，也可称为2N进制计数器。可计进制计数器。可计（2N1）个脉冲，实现个脉冲，实现2N分频。分频。如：四触发器构成的计数器，称为如：四触发器构成的计数器，称为2N16进制进制计数器。可计计数器。可计15个脉冲，实现个脉冲，实现16分频。分频。D触发器构成的异步二进制加法计数器触发器构成的异步二进制加法计数器F1QCPDQ0Q

17、2F0QDF2QDQ1现在学习的是第30页，共46页 异步二进制减法计数器异步二进制减法计数器F1JQCPKQ0Q2F0JQKF2JQKQ1J0K01J1K11J2K21CP1Q0CP2Q10076543210计数顺序计数顺序等效十等效十进制数进制数Q2 Q1 Q0 101 1 1101 00 1010 00 00010 0 0112345678 后端触发器的后端触发器的CP引自前端的引自前端的Q,故前端触发器故前端触发器由由 01时，后端时，后端才发生翻转。才发生翻转。101 状态表状态表现在学习的是第31页，共46页 时序图时序图CP12345678Q2Q0Q1思考题：思考题：若用若用D触

18、发器组成异步二进制减法触发器组成异步二进制减法计数器，应如何连接计数器，应如何连接现在学习的是第32页，共46页二、同步二进制计数器二、同步二进制计数器F1JQCPKQ0Q2F0JQKF2JQKQ1J0K01J1K1Q0J2K2 Q0 Q1翻转条件：翻转条件：Q01，F1翻转翻转Q0 Q1 1，F2翻转翻转 触发器在满足翻转条件的情况下，触发器在满足翻转条件的情况下，CP脉冲脉冲到来时可同时翻转，其速度比异步式快。到来时可同时翻转，其速度比异步式快。现在学习的是第33页，共46页三、十进制计数器三、十进制计数器F1JQCPKQ0Q2F0JQKF2JQKQ1Q3F3JQK 异步十进制计数器异步十

19、进制计数器J0K01J2K21J1 Q3 K11J3 Q2 Q1 K31CP1 CP3 Q0CP2Q1现在学习的是第34页，共46页00 0 0000 0 1 010 10 1 110 1 0000 01 100 0 0 01112345678 状态表状态表910010111 0 0 0000CP Q3 Q2 Q1 Q0 J3=Q2Q1 J2=K2=1 J1=Q3 J0=K0=1 K3=1 K1=1 CP1 CP3 Q0CP2Q101111111111111111111111111111111111111111111111111111111111110000011001111111100现在学

20、习的是第35页，共46页CP 时序图时序图Q2Q0Q112345678910Q3现在学习的是第36页，共46页 同步十进制计数器同步十进制计数器F1JQCPKQ0Q2F0JQKF2JQKQ1Q3F3JQKJ0K01J2K2 Q0 Q1J1 Q0 Q3 K1Q0J3 Q2 Q1 Q0 K31现在学习的是第37页，共46页例：例：在图示电路中，试列出状态表，并分析其在图示电路中，试列出状态表，并分析其逻辑功能。（原状态逻辑功能。（原状态000）F1JQ1CPKF0JQ0KF2JQ2KJ1 Q0图示电路为同步计数器图示电路为同步计数器K0Q1J0 Q1 Q2J2 Q0 Q1K1Q2K2Q10011

21、010010 0 0111234500CPQ2 Q1 Q0 J2 K2 J1 K1 J0 K0 01100001100000010011100111100010 06 状状态态表表010100000电路为同步电路为同步六进制计数六进制计数器器现在学习的是第38页，共46页例：例：在图示电路中，试列出状态表，并分析其逻在图示电路中，试列出状态表，并分析其逻辑功能（原状态辑功能（原状态000）F1JQCPKQ0Q2F0JQKF2JQKQ1J1K11J2Q0Q1 K21J0 Q2 K01CP0 CP2 CPCP1Q0图示电路为异步计数器图示电路为异步计数器CPQ2 Q1 Q0 J2 K2 J1 K1

22、 J0 K0 状状态态表表0001 0100 0 0111234010111111111111111111110010111100 00050电路为异步五进制加法计数器电路为异步五进制加法计数器现在学习的是第39页，共46页第五节第五节 集成计数器集成计数器 T4293 T4290现在学习的是第40页，共46页 T4293（二八十六进制计数器）（二八十六进制计数器）RDJQCP0KQ1Q2RDJQKRDJQKQ0RDJQKCP1&R01R02Q3R01 R02 Q3 Q2 Q1 Q0 1 1 0 0 0 0 0 计数计数 0 计数计数CP0、CP1为时钟输入端，为时钟输入端，R01、R02为复

23、位端，当为复位端，当R01 R0211时，计数器时，计数器清零。清零。GNDQ1123414131211+5V1098567T4293R01Q2R02Q0Q3CP0CP1八进制八进制二进制二进制十六进制十六进制现在学习的是第41页，共46页例：例：用用T4293分别接成五、九进制计数器。分别接成五、九进制计数器。当用当用N进制计数器来完成进制计数器来完成M进制计数功能时进制计数功能时(NM)，将输出端信号反馈到复位端，强迫计数，将输出端信号反馈到复位端，强迫计数器在顺序计数过程中越过器在顺序计数过程中越过(NM)个状态。个状态。五进制五进制选用选用CP1为输入，为输入，Q3Q1为输出。为输出。

24、000001010 011 000 100 101Q3接接R01，Q1接接R02Q3 Q2 Q1101，R01 R021，复位，复位 Q3 Q2 Q1 Q0 T4293 CP1 R02 R01 CP0九进制九进制 00001000计数至计数至1001，复位，复位 选用选用CP0为输入，为输入，Q3Q0为输出。为输出。Q3接接R02，Q0接接R01、CP1，Q3 Q011，R01 R021，复位，复位 Q3 Q2 Q1 Q0 T4293 CP1 R02 R01 CP0现在学习的是第42页，共46页 T4290（二五十进制计数器）（二五十进制计数器）GNDQ1123414131211+5V1098

25、567T4290R01Q2R02Q0Q3CP0CP1S91S92 CP0、CP1为时钟输入为时钟输入端，端，R01、R02为复位端，为复位端，S91、S92为置为置9端。端。当当R01R0211时，计数器时，计数器清零；当清零；当S91S92 11时，时，计数器置计数器置9。脉冲由脉冲由CP0输入，输入，Q0输出，为二进制；输出，为二进制；脉冲由脉冲由CP1输入，输入，Q3 Q1输出，为五进输出，为五进制；制；脉冲由脉冲由CP0输入，输入，Q3 Q0输出，输出，CP1与与Q0相接，为十进制。相接，为十进制。现在学习的是第43页，共46页常用计数器集成电路常用计数器集成电路（TTL）74LS16

26、0同步十进制计数器 74LS161同步二进制计数器 74LS190同步可逆十进制计数器 74LS293异步四位二进制计数器 74LS390 双十进制计数器现在学习的是第44页，共46页 Q3 Q2 Q1 Q0 74LS90 CP1 R02 R01 S92 S91 CP0 Q3 Q2 Q1 Q0 74LS90 CP1 R02 R01 S92 S91 CP0例：用例：用T4290设计一个设计一个40进制计数器进制计数器40410CP十进制十进制四进制四进制现在学习的是第45页，共46页例：用例：用T4290设计一个设计一个48进制计数器进制计数器 Q3 Q2 Q1 Q0 74LS90 CP1 R02 R01 S92 S91 CP0 Q3 Q2 Q1 Q0 74LS90 CP1 R02 R01 S92 S91 CP0个位个位8，十位，十位4CP个位个位十位十位现在学习的是第46页，共46页