输入输出接口与控制.ppt
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1、天津大学天津大学天津大学天津大学计算机科学与技术学院计算机科学与技术学院计算机科学与技术学院计算机科学与技术学院第第 9 章章 输入输出接口与控制计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础 本章全面、系统的介绍了微机系统的输入输出接口及其技术。首先,从宏观和理论的角度,系统说明了输入输出接口在微机系统中的角色和地位,接口的基本功能、CPU和接口的数据传输方式等技术基础。通过对可编程中断控制器 82C59A和并行接口82C55这两个芯片介绍,描述了实际的输入输出控制。介绍了两个实际的串行接口,并将目前常用的串行数据的传送方式、串行接口标准等知识给于描述。然后,将被广
2、泛应用的SCSI接口以及所采用的技术进行了描述,知识新而实用。最后以实例介绍了常用的数模(D/A)转换器和模数(A/D)转换器及其所采用的技术。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础 9 91 1 接口技术基础接口技术基础 接口电路又称为I/O接口。I/O接口就是为了解决CPU与外设之间信息的交换问题,I/O接口是CPU与外设之间传输信息的部件,每个外设都通过I/O接口与CPU相连。如图所示。CPUI/O接口外设计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础911 接口的基本功能接口的基本功能 I/O接口应具有以下主要功能:1。信号转
3、换。2。数据缓冲。3。地址译码和设备选择逻辑。4。CPU与外设之间传输数据所需的控制逻辑和状态信号。5。校验和检查。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础接口上的信息交换接口上的信息交换 通常,输入/输出设备接收或发送信息的速度与CPU的操作速度相比相差甚远。所以对输入/输出设备的控制可以采用信号交换(或查询)的方法。图所示为输入/输出接口的逻辑原理框图。控制数据总线数据CPU外围设备 数据端口 状态端口 控制端口 地址总线控制总线状态输入/输出接口电路计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础接口部件的I/O端口及其编址方式 1
4、.I/O端口 在输入输出接口中,可以通过CPU进行读/写的寄存器又叫端口。存放数据的叫数据端口。存放外设外设状态信息的寄存器叫状态端口,2.I/O端口的编址方式 每个端口都有一个端口地址,端口地址的编址方式有两种:统一编址方式和独立编址方式。统一编址方式是把每一个I/O端口地址看成是一个存储器单元地址。独立编址方式计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础 CPU和接口的数据传输方式和接口的数据传输方式 CPU与外设之间的数据传输方式主要有:程序控制方式、中断控制方式、直接存储器存取(DMA)方式 通道控制方式。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基
5、础计算机硬件技术基础程序控制方式程序控制方式 程序控制方式数据传输是指在程序控制下进行信息传送,程序控制方式又分为无条件传输方式和查询工作方式。1.1.无条件传输方式无条件传输方式 所谓无条件传输是指CPU不用查询外设的状态而直接进行信息传输。2.2.查询传输方式查询传输方式 查询传输方式也叫有条件传输方式。因为CPU与外设的工作是异步的,不能保证CPU执行输入操作时,外设已经处于“准备好”状态,而CPU执行输出操作时,外设已处于“空闲”状态。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础中断传输方式中断传输方式 所谓中断是CPU在执行程序的过程中,由于某种外部或内部
6、事件的发生,强迫CPU停止当前正在执行的程序,转去执行为该事件服务的特殊程序,在对该事件服务结束后,再自动返回到被中断的程序继续执行。中断过程如图所示。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础DMADMA传输方式传输方式 与条件查询方式比起来,利用中断方式传送数据可以大大提高CPU的效率。但是在中断方式下每进行一次传送数据,都必须通过CPU执行一次中断处理程序,而且每次中断CPU都要保护断点和现场,执行完中断程序后,都要恢复断点和现场等,这都要花费CPU大量的时间。这对于一个传输速度较高、数据传输来较大的I/O设备(如硬盘)来说,就显得速度太慢了。为了解决这个问
7、题,就需要改变数据的传输方式,这就是不仅可以按字节而且可以按数据块进行传输,即直接存储器存取方式(Direct Memory Access),简称DMA方式。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础I/O通道控制方式 对于有大量I/O设备的微机系统,采用通道技术是一种更理想方法。通道是一个用来控制外设工作的硬件机制,通道是独立于CPU的专门负责输入输出工作的处理机,它具有自己的指令,包括读、写、控制、转移、结束和空操作等指令。它对外设统一管理,代替CPU对输入输出操作进行控制计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础9.2 输入输出
8、控制输入输出控制 在微机系统中,外围设备越来越多,其功能也越来越强,控制起来也就更加复杂,输入/输出控制技术通常也就采用硬件技术与软件相结合的方法来实现,所以,输入/输出控制技术是硬件和软件结合在一起的一项综合技术。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础1.可编程中断控制器可编程中断控制器 82C59A芯片芯片 82C59A是为简化微机系统中断接口而设计的LSI外围芯片。通常把该电路称为可编程中断控制器(PIC),它是一种高性能的CHMOS优先权中断控制器。经级联可接受8至64个中断输入,可实现多种优先权策略。计算机硬件技术基础计算机硬件技术基础计算机硬件技术
9、基础计算机硬件技术基础 82C59AVccGND处理机接口D0D7RDWDCSA0INTINTA级联接口CAS0CAS2SP/EN中断输入IR0IR7可编程中断控制器82C59A 的引线信号示意图 计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础 82C59A的内部体系结构的内部体系结构 82C59A内部体系结构是由八个功能部件构成,它们分别是:数据总线缓冲器 读/写逻辑 控制逻辑 中断服务寄存器(ISR)中断请求寄存器(IRR)优先级仲裁器 中断屏蔽寄存器(IMR)以及级联缓冲器/比较器计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础 数据 总
10、线缓冲器 控制逻辑读/写逻辑 级联缓冲器/比较器 中断屏蔽寄存器(IMR)中断 服务 寄存器 ISR 中断 优先级 仲裁器PR 中断 请求 寄存器 IRRIR2IR1IR3IR5IR4IR7IR6IR0A0CSCAS0CAS1CAS2SP/ENRDWRINTAINTD7D0内部总线82C59A内部体系结构 计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础 1.数据总线缓冲器与读/写逻辑 这两个部件均允许微处理器访问内部寄存器,且还提供中断类型号,以及到达微处理器的路径。2.终端控制逻辑 1)中断请求寄存器IRR 2)中断屏蔽寄存器IMR 3)优先级仲裁器PR 4)中断服
11、务寄存器ISR 3.级联缓冲器/比较器 级联缓冲器/比较器提供主控设备芯片与从属设备芯片82C59A之间的接口。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础 82C59A的中断程序设计的中断程序设计 82C59A的工作方式由软件程序所决定。有两组寄存器,一组寄存器用于存放CPU写入的初始化命令字(ICW1 ICW4),另一组寄存器存放操作命令字(OCW1OCW3)。1.初始化命令字初始化命令字 初始化编程时,可供写入的命令字有ICW1 ICW4。1)ICW1 ICW1的格式和各位功能如图示。1:需要ICW40:不需ICW41:单片方式0:级联方式1:调用间隔为40:
12、调用间隔为81:电平触发输入0:边沿触发输入中 断 向 量 地 址 的A7A5(MCS80/85)0=不需ICW4D0D2D1D3D4D5D6D7标志位:1A7A5A61ADILTIMSNGLIC4计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础2.操作命令字操作命令字 控制82C59A操作的操作命令字有三个:OCW1OCW3。这些命令允许中断启动后进一步修改中断接口操作。1)OCW1 OCW1为中断屏蔽字,写入到断屏蔽寄存器IMR中,对外部中断请求信号IRi进行屏蔽。OCW1的格式如图所示。D0D2D1D3D4D5D6D7M7M5M6M4M2M3M0M1计算机硬件技术
13、基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础3.82C59A的程序设计 82C59A的初始化编程要写入命令字ICW1ICW4,ICW1ICW4使用了两个端口:ICW1使用A0=0的端口,ICW2ICW4使用A0=1的端口。初始化程序应该按系统规定的顺序写入,先写ICW1,再写ICW2ICW4。图的流程图描述了用ICW命令初始化82C59A时所发生的事件序列。ICW1 ICW2级联方式中SNGL=0?ICW3需ICW4 ICW4 准备接受 中断请求否(SNGL=1)是(SNGL=0)是(IC4=1)否(IC4=0)计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术
14、基础 并行接口并行接口82C55芯片芯片 可编程控制的并行I/O外设接口,Intel 82C55A芯片是一个流行的、成本低且与Intel系列32位微处理器一起使用的通用I/O接口。182C55A体系结构体系结构 下图为82C55A的内部逻辑框图,它由以下几个部分组成。(1)数据总线缓冲器 数据总线缓冲器是个三态双向8位缓冲器,它是82C55A与系统数据总线的接口。(2)读写控制逻辑 读写控制逻辑接收来自CPU的地址总线抵制和控制信号 (3)A组控制电路和B组控制电路 A组控制电路控制端口A和端口C的上半部(PC7PC4),B组控制电路控制端口B和端口C的下半部(PC3PC0)。(4)数据端口
15、82C55A有三个8位的数据端口A、B、C,都可以选择作为输入和输出,各端口的功能不同。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础A组控制电路B组控制电路A组端口C高4位数据总线缓冲器 读写 控制 逻辑B组端口C低4位A组端口A8位B组端口B8位D7D0RDWRA1A0RESETCSI/OPA7PA0I/OPC7PC4I/OPC3PC0I/OPB7PB08位内部数据总线82C55A的内部逻辑结构计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础3.82C55A控制字及其工作方式 82C55A可以通过控制字设置它的工作方式。82C55A有方式选
16、择控制字和C端按位置1/置0控制字。(1)82C55A控制字 图是方式选择控制字各位的功能。方式字特征值恒为1端口C(低4位)1:输入0:输出端口B(4位)1:输入0:输出方式选择1:方式10:方式2端口C(高4位)1:输入0:输出端口B(4位)1:输入0:输出方式选择00:方式001:方式10 x:方式2 D7D5D6D4D2D3D0D1计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础82C55A82C55A的工作方式的工作方式 从方式控制字可以看出B口有方式0和方式1两种工作方式,而A口有方式0、方式1和方式2三种工作方式。1.方式0 方式0也称为基本输入/输出工作
17、方式。2.方式1 方式1也称为选通输入输出方式。3.方式2 为选通式双向传输方式。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础9 93 3 串行接口串行接口 串行I/O接口是广泛应用于微系统的一种通用接口。所谓串行接口,就是将要传送的数据以逐位传送的方式进行操作。在进行数据的传送操作时,先将并行的字节信息转换成串行的位,并且逐位的进行发送操作。而接收设备在进行接收操作时,再将逐位收到的数据拼装成字节。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础串行数据的传送方式串行数据的传送方式 在串行通信中,通常是在两个(像CPU、终端设备)设备之间进
18、行数据的传送操作。将串行数据的传送方式分成单工、半双工和全双工三种基本的传送方式。单工传送方式单工传送方式 所谓单工传送方式就是数据只能从甲方单方向地传送到乙方或者相反。比如像CPU与打印机的通信线路就仅需支持一个方向上的通信。甲乙方只需一方设置一个发送器,而另一方设置一个接收器即可实现通信,如图所示。甲方发送器 乙 方 接收器发送线计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础半双工传送方式半双工传送方式 这种传送方式,只设一条通信线路,数据既可以从甲方传送到乙方,又可以从已方传送到甲方。由于只有一条通信线路,就不能同时进行两个方向的数据传送操作,只能分时进行数据的
19、传送操作的情况下。半双工方式要求甲、乙双方要分别设置一套发送器和接收器,如图所示。甲方发送器 乙 方发送/接收线接收器发送器接收器计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础全双工传送方式全双工传送方式 全双工传送方式可以使甲、乙双方既可以同时发送数据,也可以同时接收数据,这就要求甲、乙双方要分别设置一套发送器和接收器,并需要两条独立的通信线路,如图所示。甲 方 发送器 乙 方发送线 接收器 发送器 接收器接收线计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础 串行接口标准串行接口标准 欲在一个CPU系统内实施串行通信,有两个问题需要解决;一
20、是在CPU与外备之间要共同遵守某种约定,也就是要共同遵守物理接口标准,像电缆的机械特性、电气特性、信号功能以及传送过程的定义等。二是按照接口标准来设置CPU与外设之间进行串行通信的接口电路。串行通信按信息格式分为两种通信方式:同步通信和异步通信。计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础计算机硬件技术基础(1)同步数据通信)同步数据通信 所谓同步通信,是指通信设备双方的发送器和接收器必须同步地运行。因此,图所示的接口中,除包括有发送数据线,接收数据线以及信号地线外,还有一条时钟信号线,数据的发送和接收就是用这个时钟信号来进行同步的。系统1 系统2接收数据发送数据时钟信号地计算机硬件
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- 关 键 词:
- 输入输出 接口 控制
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