2022年计算机组成原理试题.docx

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1、精选学习资料 - - - - - - - - - 名师整理 优秀资源本科生期末试卷（二）一、挑选题（每道题 1 分,共 15 分）1 冯 诺依曼机工作的基本方式的特点是（B ）；A 多指令流单数据流B 按地址拜访并次序执行指令C 堆栈操作 D 存贮器按内容挑选地址2 在机器数（B ）中,零的表示形式是唯独的； A 原码 B 补码 C 移码 D 反码3 在定点二进制运算器中,减法运算一般通过（D ）来实现；A 原码运算的二进制减法器B 补码运算的二进制减法器C 原码运算的十进制加法器 D 补码运算的二进制加法器4 某运算机字长 32 位,其储备容量为 256MB,如按单字编址,它的寻址范围是（A

2、 ）； A 0 64MB B 0 32MB C 0 32M D 0 64M 名师归纳总结 5主存贮器和 CPU之间增加 cache 的目的是（ A ）；第 1 页,共 6 页A 解决 CPU和主存之间的速度匹配问题B 扩大主存贮器容量C 扩大 CPU中通用寄存器的数量 D 既扩大主存贮器容量,又扩大CPU中通用寄存器的数量- - - - - - -精选学习资料 - - - - - - - - - 名师整理 优秀资源6 单地址指令中为了完成两个数的算术运算,除地址码指明的一个操作数外,另一个常需采纳（C ）；A 堆栈寻址方式 B 立刻寻址方式）；7 C 隐含寻址方式 D 间接寻址方式同步掌握是（

3、C ）；A 只适用于 CPU掌握的方式B 只适用于外围设备掌握的方式C 由统一时序信号掌握的方式8 D 全部指令执行时间都相同的方式描述 PCI 总线中基本概念不正确的句子是（ D A PCI 总线是一个与处理器无关的高速外围设备B PCI 总线的基本传输机制是猝发式传送C PCI 设备肯定是主设备 D 系统中只答应有一条 PCI 总线9 CRT的辨论率为 1024 1024 像素,像素的颜色数为 256,就刷新储备器的容量为（）； A 512KB B 1MB C 256KB D 2MB 10 为了便于实现多级中断,储存现场信息最有效的方法是采纳（B ）； A 通用寄存器 B 堆栈 C 储备器

4、 D 外存11 特权指令是由（A ）执行的机器指令； A 中断程序 B 用户程序 C 操作系统核心程序 D I/O 程序12 虚拟储备技术主要解决储备器的（）问题； A 速度 B 扩大储备容量 C 成本 D 前三者兼顾名师归纳总结 - - - - - - -第 2 页,共 6 页精选学习资料 - - - - - - - - - 13名师整理优秀资源引入多道程序的目的在于（）；A 充分利用 CPU,削减等待 CPU时间资源重复 D 流水 +B 提高实时响应速度C 有利于代码共享,削减主辅存信息交换量14 D 充分利用储备器 64 位双核安腾处理机采纳了（）技术； A 流水 B 时间并行 C 资源

5、重复15 在安腾处理机中,掌握估计技术主要用于解决（）问题；A 中断服务B 与取数指令有关的掌握相关C 与转移指令有关的掌握相关 D 与存数指令有关的掌握相关二、填空题（每道题 2 分,共 20 分）1 在运算机术语中,将 ALU掌握器和（）储备器合在一起称为（）；2 数的真值变成机器码可采纳原码表示法,反码表示法,（补码 ）表示法,（移码 ）表示法；3 广泛使用的（SRAM ）和（ DRAM ）都是半导体随机读写储备器；前者的速度比后者快,但集成度不如后者高；4 反映主存速度指标的三个术语是存取时间、（储备周期）和（储备器带宽）；名师归纳总结 5形成指令地址的方法称为指令寻址,通常是（次序

6、）寻址,遇到转移第 3 页,共 6 页指令时（跳动 ）寻址；6 CPU从（内存 ）取出一条指令并执行这条指令的时间和称为（指令周期）；- - - - - - -精选学习资料 - - - - - - - - - 名师整理 优秀资源7 RISC 指令系统的最大特点是：只有（存数）指令和（取数）指令拜访存 储器,其余指令的操作均在寄存器之间进行；8 微型机的标准总线, 从带宽 132MB/S的 32 位（）总线进展到 64 位的（）总线；9 IA-32 表示（）公司的（）位处理机体系结构；10 安腾体系机构采纳显示并行指令运算技术,在指令中设计了（）字）执行；段,用以指明哪些指令可以（三、简答题（每

7、道题 8 分,共 16 分）1 简述 64 位安腾处理机的体系结构主要特点；2 画出分布式仲裁器的规律示意图；四、运算题（ 10 分）已知 x=-0.01111 ,y=+0.11001, 求： x 补,-x 补,y 补,-y 补； x+y,x-y, 判定加减运算是否溢出；五、设计题（ 12 分）用 2M 8 位的 SRAM芯片,设计 8M 32 位的 SRAM储备器；六、分析题（ 12 分）参见图 1,这是一个二维中断系统,请问： 在中断情形下, CPU和设备的优先级如何考虑？请按降序排列各设 备的中断优先级； 如 CPU现执行设备 C的中断服务程序,IM2,IM1,IM0 的状态是什么？假如

8、 CPU执行设备 H的中断服务程序, IM2,IM1,IM0的状态又是什么？每一级的 IM 能否对某个优先级的个别设备单独进行屏蔽？假如不 能,实行什么方法可达到目的？名师归纳总结 - - - - - - -第 4 页,共 6 页精选学习资料 - - - - - - - - - 此要求？名师整理优秀资源如设备 C一提出中断恳求, CPU立刻进行响应,如何调整才能满意七、设计题（ 15 分）图 2 所示为双总线结构机器的数据通路,IR 为指令寄存器, PC为程序计数器（具有自增功能）,M为主存（受 R/W#信号掌握）, AR为地址寄存器, DR为数据缓冲寄存器, ALU由加、减掌握信号打算完成何

9、种操作,掌握信号 G掌握的是一个门电路；另外,线上标注有小圈表示有掌握信号,例中 yi 表示 y 寄存器的输入掌握信号, R1o为寄存器 R1的输出掌握信号,未标字符的线为直通线,不受掌握；“ ADD R2,R0” 指令完成 R0+R2 R0的功能操作,画出其指令周期流程图,假设该指令的地址已放入 PC中；并在流程图每一个 CPU周期右边列出相应的微操作掌握信号序列；如将（取指周期）缩短为一个CPU周期,请先画出修改数据通路,然后画出指令周期流程图；名师归纳总结 - - - - - - -第 5 页,共 6 页精选学习资料 - - - - - - - - - 名师归纳总结 名师整理优秀资源第 6 页,共 6 页- - - - - - -