微机原理与接口技术第五章习题解答.pdf

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1、其身正，不令而行；其身不正，虽令不从。论语我尽一杯，与君发三愿：一愿世清平，二愿身强健，三愿临老头，数与君相见。白居易微机原理与接口技术（楼顺天第二版）习题解答 第 5 章 总线及其形成 微处理器的外部结构表现为 数量有限的输入输出引脚，它们构成了微处理器级总线。微处理器级总线经过形成电路之后形成了 系统级总线。答：总线是计算机系统中模块（或子系统）之间传输数据、地址和控制信号的公共通道，它是一组公用导线，是计算机系统的重要组成部分。采用标准化总线的优点是：简化软、硬件设计。简化系统结构。易于系统扩展。便于系统更新。便于调试和维修。答：在微型计算机应用系统中，按功能层次可以把总线分成：片内总线

2、、元件级总线、系统总线和通信总线。答：RESET 为系统复位信号，高电平有效，其有效信号至少要保持四个时钟周期，且复位信号上升沿要与 CLK 下降沿同步。系统复位后的启动地址为 0FFFF0H。即：（CS）=0FFFFH，（IP）=0000H。8086CPU 复用的引脚有 AD15AD0、A16/S3、A17/S4、A18/S5、A19/S6、BHE/S7。8088CPU 复用的引脚有 AD7AD0、A16/S3、A17/S4、A18/S5、A19/S6、BHE/S7。答：设置引脚复用主要是可以减少引脚数量。CPU 通过分时复用解决地址线和数据线的复用问题。ALE 为地址锁存使能信号在总线周期

3、的 T1 周期有效，BHE为高 8 位数据线允许，在T1 周期有效，需要锁存器锁存，在需要使用高 8 位数据线时使用。答：高阻态可做开路理解。可以把它看作输出（输入）电阻非常大。答：RESET（Reset）：复位信号，输入，高电平有效。CPU 收到复位信号后，停止现行操作，并初始化段寄存器 DS、SS、ES，标志寄存器 PSW，指令指针 IP 和指令队列，而使 CS=FFFFH。RESET 信号至少保持 4 个时钟周期以上的高电平，当它变成低电平时，CPU 执行重启动过程，8086/8088 将从地址 FFFF0H 开始执行指令。READY（Ready）：准备就绪信号，输入，高电平有效。在 T

4、3 状态结束后 CPU 插入一个或几个 TW 暂停状态，直到 READY 信号有效后，才进入 T4 状态，完成数据传送过程。TEST（Test）：测试信号，输入，低电平有效。TEST 信号与 WAIT 指令结合起来使用，CPU 执行 WAIT 指令后，处于等待状态，当 TEST 引脚输入低电平时，继续执行被暂停的指令。P159-160 P170 P162 8086 CPU 的IOM/信号在访问存储器时为 高 电平，访问 I/O 端口时为 低 电平。答：8086CPU 有 20 条地址线和 16 条数据线，为了减少引脚，采用了分时复用，共占了 20条引脚。这 20 条引脚在总线周期的 T1 状态

5、输出地址。为了使地址信息在总线周期的其他 T状态仍保持有效，总线控制逻辑必须有一个地址锁存器，把 T1 状态输出的 20 位地址信息进行锁存。根据传送信息的种类不同，系统总线分为 数据总线、地址总线 和 控制总线。三态逻辑电路输出信号的三个状态是 高电平、低电平 和 高阻态。在 8086 的基本读总线周期中，在1T状态开始输出有效的 ALE 信号；在2T状态开始输出低人人好公，则天下太平；人人营私，则天下大乱。刘鹗一寸光阴一寸金，寸金难买寸光阴。增广贤文电平的RD信号，相应的DEN为_低_电平，RDT/为_低_电平；引脚 AD15 AD0上在1T状态期间给出地址信息，在4T状态完成数据的读入。

6、H E 存储器读、存储器写、I/O 读、I/O 写。RD,WR,MEMW,IOR,IOW 存储器读，I/O 写 地 高，FFFFH，0000H，FFFF0H ALE，地；R/DT，DEN 一，一，两 T3，高，Tw 8288 总线控制器 B,C 人人好公，则天下太平；人人营私，则天下大乱。刘鹗人不知而不愠，不亦君子乎？论语 答：（1）没有等待的 8086 最小方式时序如图(1)所示。T1T2T4T3一个基本的总线周期CLKBHEAD15AD0ALEM/IORDDT/RDENA19A16BHEA15A0S6S3状态输出D15D0数据输入 图(1)没有等待的 8086 最小方式时序（2）有一个等待

7、周期的 8086 最小方式时序图如图(2)所示。T1T2TWT3插入一个TW的总线周期CLKT4A19/S6A16/S3BHEAD15AD0ALEM/IORDDT/RDENA19A16BHEA15A0S6S3状态输出D15D0数据输入 图(2)有一个等待周期的8086 最小方式时序图 以家为家，以乡为乡，以国为国，以天下为天下。管子牧民大丈夫处世，不能立功建业，几与草木同腐乎？罗贯中（1）因为 DATA 为偶地址，则 DATA+1 为奇地址。故要完成本条指令，需要两个总线周期。时序图如图(1)所示 图(1)执行 MOV DATA+1，AX 指令的时序参考图（2）DATA+1 虽然为奇地址，但是 AL 为八位存储器，故本条指令需用一个总线周期，时序图如图(2)所示。图(2)执行 MOV DATA+1，AL 指令的时序参考图（3）执行 OUT DX，AX（DX 的内容为偶数）指令的时序图如图(3)所示。万两黄金容易得，知心一个也难求。曹雪芹其身正，不令而行；其身不正，虽令不从。论语 图(3)执行 OUT DX，AX 指令的时序参考图（4）执行 IN AL，0F5H 指令的时序图如图(4)所示。图(4)执行 IN AL，0F5H 指令的时序参考图 T1，高，IOM/，T1，低，T2