触发器及时序逻辑电路-(2)上课讲义.ppt

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1、触发器及时序逻辑电路-(2)解 移位寄存器B的Q3B接DOB，数码在CP 作用下不断地循环，Q3B的状态依次为101110111.。移位寄存器A的输入状态 DOA=Q3A Q3B，根据给定的初态值，在CP的作用下，Q3A的状态依次是101010101。YC的波形由Q3A与 Q3B相“与”后决定。触发器FD是下降沿触发的JK触发器，QD的波形将随YC的状态变化，并滞后YC的波形半个CP周期。所求波形如图 14-2所示。QDFDKJYC7&CQ3Q3ABDODOCP图14-1 例14-1图12435678CPQ3A图14-2 例14-1解图QDYCQ3B 例 14-2 图14-3是 由三个移位寄存

2、器SRG4（1）、SRG4（2）、SRG4（3）和一个全加器 （包括进位触发器C）构成的串行加法器，它可实现两个4位二进制数相加，试分析 其工作过程。&S1S1CPCPCPSRG4（1）S2S2QDQDSRG4（2）ARDQDCBADCBCPSRG4(3)SiA2A1C1CI-1BiAi全加器A4A3(加数)送数脉冲送数脉冲置数脉冲置数脉冲11进位触发器进位触发器C(被加数)B1B2B3B4移位脉冲移位脉冲取数脉冲取数脉冲高高低低输出 解 4位二进制串行加法计数器的工作过程如下：1）进行运算之前，先将各寄存器、触发器清零。2）令SRG4（1）、SRG4（2）处于并行输入状态 即 S1=S2=1

3、，利用送数脉冲将加数A3 A2 A1 A0 和被加数B3 B2 B1 B0分别送入相应的寄存器中。3）令SRG4（1）、SRG4（2）、SRG4（3）中 S1=0、S2=1，寄存器处于右移状态，在移位脉 冲作用下，SRG4（1）、SRG4（2）中的数据逐 位右移（低位在前，高位在 后）至全加器，并在 全加器中逐位相加。4）每次相加结果，本位和SI存入寄存器SRG4（3）中，进位位存入进位触发器C中，供下一位相加时 使用。5）4位数据逐拍加完后，最后结果用取数脉冲由 SRG4（3）中取出。需注意的是，计算结果的最 高位由进位触发器C的输出端Q取出。例例14-3 现有两个现有两个D触发器，两个触发

4、器，两个JK触发器。其逻辑符号如图触发器。其逻辑符号如图14-4a所示。用它们组成异步所示。用它们组成异步4位二进制加法计数器，试画出正确位二进制加法计数器，试画出正确的连接线路图。的连接线路图。解：首先要把解：首先要把D D，JKJK触发器连成计数形式的触发器连成计数形式的T T 触发器触发器,即即Q Qn+1n+1=D=Q=D=Qn n；而；而J=K=1J=K=1。其次。其次D D触发器的触发器的CPCP脉冲无圆圈是上升沿触发，当前脉冲无圆圈是上升沿触发，当前一级的一级的Q Q从从1010进位时应取进位时应取Q Q为进位为进位CPCP端，而端，而JKJK触发器的触发器的CPCP脉冲脉冲有圆

5、圈是下降沿触发，应接前一级的有圆圈是下降沿触发，应接前一级的Q Q段端。再次，置段端。再次，置“0”“0”端，端，有圆圈平时接高电平有圆圈平时接高电平“1”“1”，无圆圈的应该低电平，无圆圈的应该低电平“0”“0”才能正才能正常工作。连接图如图常工作。连接图如图14-4b14-4b所示。所示。Q4RdRdQ1Q2Q3RdRdRdRdRdQQQQQKJJKQQQQQKDDa)Qb)DF1F2F3FdJCP1111图图14-4 例例14-3图图例14-4 分析图14-5电路实现何种逻辑功能，其 中 X是控制端，对X=0和X=1分别分析，假定 初始状态为Q2=1，Q1=1。CPX=1=111K1Q2

6、Q1Q2Q2J2K2Q1Q1J1Rd解 从图14-5可见,X是控制端,CP是时钟脉冲输入端,无数据 输入端,该时序电路 属于计数器.对其功能分析如下:1)时钟方程CP1=CP2=CP,是同步工作方式。2）驱动方程为：J1=X+Q2 K1=1 ；J2=X+Q1 K2=1 3）列状态转换表如表14-1所示。4)由真值表可知，当X=0时，是同步三进制加法计数器；当X=1时，是同步三进制减法计数器。无效状态Q2 Q1=11在上述两种情况下只需一个CP就进入有效状态，因而能自启动。总之，该时序电路 是同步三进制可逆计数器，并且能自启动。CPX0000000000000000000111100000000

7、0011111111111111111111111111111111111221314111134Q1Q2J1=X+Q2J2=X+Q1K2=1K1=1 解 1）由表14-2可见，CC40161（CC40160）的Cr可直接进行复位操作，与CP信号无关，这与教材上介绍的T1161（T4161、CC40162、CC40 163）需在CP控制下复位，即同步复位有所不同（其他功能相同）。利用Cr端的功能，采用复位法可构成六进制计数器如图14-6a所示。采 用同样的方法可构成十、十二进制计数器，只要将与非门的输入端分别接至10、12所对应的状态输出端即可。图略。2）用低位（片1）的进位输出端C1连接高位

8、（片2）的使能端EP2、ET2，两片的CP共同。清零后第15个CP有效边沿到来时，C1输出为1，EP2=ET2=1，片（2）进入计数状态，当第16个CP到来时，片（1）复位归零，片（2）记1个输入脉冲，完成一个进位 过程。两个4位二进制计数器级联构成的8位二进制计数器如图14-6所示。3）采用进位输出置数法构成一个183进制计数器。将两个芯片的进位输出端通过一个与与非门产生LD所需的置数脉冲，预置数N=256-183=73，将73所对应的输入信号端接高电平1，其余输入端接低电平0，即将1A（2O）、1D（23）、2C（26）接高电平，其余接地，如图14-7所示。例14-5 CMOS器件CC40

9、161；TTL器件T1161、T4161及国外件 74LS161、74LS163等都是同步4位二进制加法计数器，具有 同步预置数、清零和保持功能。其功能表如下：cpcrLD EPEr功能清零计数保持置数输入1111011001oooooooo 这些件均是双列直插式16脚。其中第16脚电源第8脚接地，第1脚清零Cr，第2脚时钟CP，第15脚为进位输出。试解答下列问题：1）用一片CC40161构成六进制、十进制、十二进制计数器？2）用两片CC40161构成8位二进制加法计数器。3）用两片CC40161构成一百八十三进制计数器。l例14-6 CMOS中规模集成电路芯片CC40160是输出8421BC

10、D码的同步十进制加法计数器，它的其他功能和例14-5中的CC40161 芯片相同。与CC40160功能相同的TTL芯片有 T1160、T4160、T1162、T4162、74LS160、74LS162等。试用CC40160芯片构成二十四、六十进制的计数器。画 出连线图，标明计数输入端和进位输入端。进位输出CP计数输出111Q1EPETEPQ4Q3Q2Q1Q4Q3Q2ETCPCPCCLDLDCrCr&解 用复位法将24所对应的输出状态经过一个“与非 门”产生复位脉冲,送给Cr,这样每输入24个CP,芯 片(1)、（2）全回零态。连线图如14-8所示。同理，若接成六十进制计数器，只要将图14-8中

11、的“与非”门 输入端改接到十位（片2）的Q3、Q2端即可。111111111&CP2A1D1C1B1ACPCPCPCP2D2C2BCCCC&QAQ3Q2Q1Q4Q3Q2Q1Q4Q3Q2Q1ETEPETCP计数输入计数输入EPETQDQCQBQAETQDQCQBCC40161(2)CC40161(1)CPQ4Q1Q2Q3Q4Q1Q2Q3Q4CPLDCrEPET图14-7（2）（1）LDLDLDEPCrCrCrCra)b)图14-613-1 同步 RS 触发器的特性方程是（）a)=S+RQnb)c)=S+RQn-b13-2 D 触发器的特性方程是（）a)Qn+1=D b)Qn+1=D c)=Da1

12、3-3 JK触发器的特性方程是（）a)Qn+1=KQn+JQn b)Qn+1=JQn+1 +KQn c)Qn+1=JQn+KQnc13-4 仅具有“置0”“置1”功能的触发器叫（）a)JK触发器 b)RS触发器 c)D触发器c13-5 仅具有“保护”“翻转”功能的触发器叫（）a)JK触发器 b)T触发器 c)D触发器b13-6 具有“置0”“置1”“保护”和“计数翻转”功能的触发起叫（）a)JK触发器 b)D触发器 c)T触发器a13-7 仅具有“翻转”功能的触发器叫（）a)JK触发器 b)T触发器 c)D触发器b13-8 JK触发器用做T触发器时，控制端J,K 正确接法是（）a)J=Qn K

13、=Qn b)J=K=1 c)J=Qn K=Qnb13-9 D触发启用做T触发器时，控制端D正确接法时（）a)D=Qn b)D=Qn c)D=1b13-10 触发器由门电路构成，但它不同门电路功能，主要特点是（）a)和门电路功能一样 b)有记忆功能 c)没有记忆功能b 13-11 TTL型触发器的直接置0端Rd、置1端Sd正确用法是（）a)都接高电平“1”b)都接低电平“0”c)有小圆圈时，不用时接高电平“1”；没有小圆圈时，不用时接低电平“0”c13-12 TTL型和CMOS型触发器使用方法正确的是（）a)电源电压一样时，可以兼容；但TTL型不用的控制端可以悬空为“1”；CMOS型的不用控制端

14、不可以悬空，必须通过电阻接电源为“1”b)只要电源电压一致可随意使用 c)电源电压不同也可互换使用a13-13 按结构分双稳态触发器的类型有（）a)基本，同步b)主从型，维持阻塞型等c)前两者都包括c13-14 按触发方式双稳态触发器可分为（）a)高电平和低电平触发b)上升沿和下降沿触发c)电平触发、主从触发和边沿触发c13-15 按导电机理分双稳态触发器的类型有（）a)双极型b)单极型c)双极型和单极型c 13-16 按逻辑功能分双稳态触发器有（）a)RS、JK、D、T 等型 b)TTL、MOS 型c)主从和维持阻塞型a13-17 同一种导电类型和电路结构的触发器可否用不同的导电类型和不同的

15、结构来实现（）a)可以b)不可以a13-18 同一种导电类型和电路结构的触发器可否做成不同的逻辑()a)可以 b)不可以a13-19 接成计数状态存在空翻问题的触发器是（）a)D触发器 b)钟控RS触发器 c)主从RS触发器b13-20 存在一次翻转问题的是（）触发器a)主从型 b)JK c)RS 和 JKa13-21 为防止空翻，应采用（）结构的触发器a)CMOS b)TTL c)主从或维持阻塞c13-22 为避免一次翻转现象，应采用（）的触发器。a)主从触发 b)边沿触发 c)电平触发b例 13-5 TTL 主从JK触发器2072组成图13-7a所示的电路，输入波形如图13-7b所示，设个

16、触发器初态为0，画出 Q1 、Q2 端波形。解 根据图示电路和已知条件，可画出Q1 Q2端波形，如图13-8所示。=1J1C1K1Q1Q1F1J2C2K2Q2Q2F2ACPa)“1”612345CPAQ1Q2图 13-8612345CPAb)图 13-7 13-6 维持阻塞D 触发器CT4074和边沿JK触发器组成图13-9a所示电路，输入波形如图13-9b所示，设各触发器的初态为0，试画出Q1、Q2波形。解 根据图示电路和已知条件，可画出Q1、Q2端波形，如图13-10所示。Q1Q1F1J2C2K2Q2Q2F2DCPa)D1C1一一b)图 13-9 612345CP7D612345CP7DQ

17、1Q2图 13-10 第十四章 时序逻辑电路 1 时序电路可以由（）组成。A 门电路 B 触发器或门电路 C 触发器或触发器和门电路的组合C2 时序电路输出状态的改变（）。A 仅与该时刻输入信号的状态有关 B 仅与时序电路的原状态有关 C 与A，B皆有关C3 寄存器在电路组成上的特点是（）。A 有CP输入端，无数码输入端 B 有CP输入端和数码输入端C 无CP输入端，有数码输入端B4 通常寄存器应具有（）功能。A 存数和取数 B 清零和置数 C 两者皆有C5 按数码的存取方式，寄存器可分为（）。A 数码寄存器，移步寄存器 B 同步寄存器，异步寄存器C 双向移位寄存器A6 移位寄存器可分为（）。

18、A 左移位寄存器 B 右移位寄存器 C 左，右移位和双向移位寄存器C7 数码可以并行输入，并行输出的寄存器有（）。A 数码寄存器 B 移位寄存器 C 二者皆可C8 数码寄存器串行输入，串行输出的寄存器有（）A 数码寄存器 B 移位寄存器 C 二者皆可B9 下列各种类型触发器，能组成移位寄存器的是（）A 基本RS触发器 B 同步RS触发器 C 主从结构触发器D 维持阻塞结构触发器 E 边沿触发器CDE10 计数器在电路组成上的特点是（）A 有CP输入端，无数码输入端 B 有CP输入端和数码输入端C 无CP输入端，有数码输入端A11 通常计数器应具有（）功能A 清零，置数，累计CP个数 B 存，取

19、数码 C 两者皆有A12 按各触发器的状态转换与CP的关系分类，计数器可分为（）计数器。A 加法，减法及加减可逆 B 同步和异步 C 二，十和M进制B13 按计数器状态变化的规律分类，计数器可分为（）计数器A 加法，减法及加减可逆 B 同步和异步 C 二，十和M进制A14 按计数器的进位制（或循环模数）分类，计数器可分为（）计数器A 加法，减法及加减可逆 B同步和异步 C 二，十和M进制C15 M进制计数器状态转换的特点是设初态后，每来（）个CP时，计数器又重回初态。A M-1 BM+1 C MC16 经过有限个CP，可由任意一个无效状态进入有效状态的计数器是（）自启动的计数器。A 能 B 不

20、能 C 不一定能A17 利用中规模集成计数器构成任意进制计数器的方法有（）。A 复位法 B 预置数法 C 级联复位法ABC18 复位法是利用计数器芯片的（）构成任意进制计数器的方法。A 复位法 B 预置数法 C 进（借）位输出端A19 在CP的控制下实现预置数功能的计数器称为同步预置数计数器。属于这种计数器的有（）。A CC40192 B CC40193 C T1160 D T1161CD20 不需CP控制的直接实现预制数功能的计数器称为异步预制数计数器。属于这种计数器的是（）A CC40192 B CC40193 C T1160 D T1161 A B21 不产生多余状态的计数器是（）A 同

21、步预制数计数器 B 异步预制数计数器 C 复位法构成的计数器A22 将计数器的状态译码后控制端构成任意进制计数器的方法称为（）A 进位输出置数法 B 状态译码置数器 C 复位法B23 用进位输（或借位输出）信号驱动预制数端构成任意进制计数器的方法称为（）A 进位（或借位）输出置数法 B 状态译码置数法C 复位法 A24 用复位法或预制数法构成的单片“任意”进制计数器，级联后构成M进制计数器的方法称为（）A 级联复位法 B 预制数法 C 复位级联法C25 现有两片T4290芯片，欲构成具有8421BCD码输出的二十四进制加法计数器，应采用的连接方法是（）A 级联复位法 B 级联复位法 C 预置数

22、法 A C26 用复位法构成M进制计数器，应将（）所对应的状态译码后驱动复位端。A M B M-1 C M+1A27 用同步状态译码预制数法构成M进制加法计数器，若预制数据为0，则应将（）所对应的状态译码后驱动预制数控制端。A M B M-1 C M+1B28 用同步状态译码预置数法构成M进制加法计数器，若预制数据为N，则应将（）所对应状态译码后驱动预制数控制端。29 对异步预置数计数器，用状态译码计数器构成进制加法计数器，若预制数据为，则应将（）所对应的状态译码后驱动预制数控制端。30 对异步预制数计数器，用状态译码置数法构成进制加法计数器，若预制数据为，则应将（）所对应的状态译码后驱动预置

23、数控制端。31 将两片同步位二进制加法计数器芯片用进位输出置数法构成任意进制计数器，其最大计数值是（）32 将两片同步4位二进制加法计数器级联后，用进为输出置数法构成 M进制计数器,预制数端的数据N应是（）A 256-M B 2 -N C M-N 8A33 欲构成能记最大十进制为999的计数器，至少需要（）个双稳态触发器。A 10 B 100 C 1000A34 欲构成能记最大十进制数为999的计数器，至少需要（）片十进制加法计数器芯片；或（）片4位二进制加法计数器芯片。A 3 B 10 C 100AA35 n位二进制加法计数器有（）个状态，最大计数值是（）A 2 B 2 C 2 -1n-1n

24、nBC36 将两片CC40192级联后用借位输出置数法构成M（M 100)进制减法计数器，预制数端的数据N应是（）A M B 100-M C 100+MA37 将两片CC40193级联后用借位输出置数法构成M进制减法计数器，M的取值范围是（）A 0 M 100 B 2 M 2 C 2 M 2 -188B38 将两片CC40193级联后用借位输出置数法构成M进制减法计数器，预制数端的数据应是（）A M B 2 -M C 2 +M88A39 计数器脉冲分配器的一般组成是（）A 计数器 B 2 -M C 计数器和译码器C40 为获得100个节拍脉冲，若采用计数式脉冲分配器，至少需要（）位二进制计数器。A 6 B 7 C 10B此课件下载可自行编辑修改，仅供参考！此课件下载可自行编辑修改，仅供参考！感谢您的支持，我们努力做得更好！谢谢感谢您的支持，我们努力做得更好！谢谢