数字电路时钟触发器结构形式及触方式.ppt

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6.3时钟触发器的结构形式及触发方式一、同步触发器1.同步触发器的触发方式 CP=1 接收 CP=0 保持2.同步触发器的缺点空翻空翻：如果在一个时钟脉冲的作用下，触发器发生了两次或两次以上的翻转。这就叫做空翻。空翻意味着失控，是应当避免的。CPS RQ二、维持阻塞触发器1.在时钟脉冲的上升沿到来时触发。2.克服了空翻。CP DQ三、边沿触发器1.在时钟脉冲的下降沿到来时触发。2.克服了空翻。CPJKQ四、主从触发器（结构看书）1.CP=1时主触发器接收。CP下降沿时从触发器向主触发器靠拢。2.克服了空翻。CPJKQ主Q从五、时钟触发器的直接置位和直接复位(结构看书)1.不受时钟和输入信号的控制。2.Sd=Rd=1时触发器正常工作。六、触发器的逻辑符号同步触发器：CP维阻触发器：上升沿CPCP边沿触发器：下降沿主从触发器：下降沿CP(主从触发器)触发器的扩展端是与的关系触发器的功能转换：JK DJK TJK T T T T=1作业：P230 14，15，16，18第四版：P149 9,11,12,13自考：P150 7，11，13