数字逻辑实验报告2.docx

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1、数字逻辑实验实验报告任课教师李成范易媛1412179721周三11-13节李成范易媛1412179721周三11-13节李成范实验者姓名学 号实验组实验时间指导教师上海大学计算机工程与科学学院2015年10月3日上诲大学计算机学院数字逻辑实验报告2姓名易媛学号14121797教师李成范时间周三11T3节地点计算机学院大楼704机房机位21一一）薪丽橐京露测试芯一.1 .实验目的测试异或门74LS86的逻辑功能，并完成对应的表格；2 .原理依据异或运算和门电路中的高低电压的匹配输出原理。3 .实验步骤1、引脚7连接接地插孔；引脚14连接+5V电源插孔；2、按照指导书上所示电路图，如下图，连接引脚

2、；oo3、拨动开关，观察二极管的变化，并完成实验数据表格。4 .实验数据异或门辆入输出ABYL LL LLLLH LL LHLHH HL LLLLH HH LLHHH HH HLLLL HL HHHL5 .实验现象异或门实验中只有A、B两边电压全跳到低电压或全跳到高电压，低电压指示灯才 会亮，当两边输入的电压不同时，高电压指示灯亮。而A、B则也是要1,2或者4、5 都调到低电压或者高电压，才输出低电压，否则输出高电压。6 .体会通过对异或门逻辑功能的测试，更深的了解了异或门的逻辑功能，但在一开始 其实我没有理解如何将1、2,4、5再通过3,6输入到9, 10中，在这次实验中，74LS86 的9

3、、10引脚好像是没有用的，因此我换了两个输入口，经过观察摸索，终于明白， 因此这次实验中我也了解到了二级输出，这是在我第一次实验中没有遇到的。二.使用Quartus II设计二位全加器实验.实验目的1、掌握组合逻辑电路的功能测试。2、学会二进制数的运算规律。3、掌握构造半加器和全加器的逻辑功能。4、学习使用可编程逻辑器件的开发工具Quartus II设计电路.原理全加器将三个输入端一一两个一位二进制数及来自低位的进位Ci-1进行相加， 产生“和”与“进位Ci”。，当三个输入端输入奇数个“1”时“和”为“1”否 则为“0” ；当三个输入端至少输入两个“1”时“进位”输出为“1”否则为“0”。构成

4、领I访法有鳏h可胡或下吗非门等口邨皿成（见教材人 可用若干与门组成也 可用半加器和或门组成。此次实验是用半加器和或门构成的全加器。1 .实验步骤1、在Quartus II中建立工程文件，画出逻辑电路设计图。2、使用模拟工具进行模拟验证；3、通过验证之后定义FPGA引脚功能；4、下载设计的电路到FPGA；5、按照引脚对照表连接各引脚，并测试FPGA的功能4 .实验数据半加器输入输出ABSC0000011010101101全加器AiBiCi-)CiSi0000001010100101100100110011011010111111二位全加器AlBlAOBOClSIso000000000010010

5、01000100110100100010010101101100110111100100001010010111010011101110011001001101101111010111111105 .实验现象（红灯亮表示输出为0,绿灯亮表示输出为Dei, si, so分别对应三个输出端， 并连接到二极管上，二极管亮灯情况，正如上表所示；.体会第二次使用Quartus II模拟逻辑电路，通过这次设计二位全加器，我对Quartus II这一软件更加熟悉，相比第一次，这一次更加得心应手一点，动手能力也增强 了，不像之前那样，完全不知所措，虽然过程中还是出了一点小问题，就是在实 验过程中，我不小心关掉了软件，后面再打开是忘记将工程文件打开，而是直接 打开画有电路图的文件，导致无法编译，后经过摸索终于发现问题，最终成功， 这也提醒了我，遇到问题要善于从根本上解决问题，着急是解决不了问题的。