嵌入式系统硬件技术.ppt
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1、第第3讲讲 嵌入式系统硬件技术嵌入式系统硬件技术n n本讲主要授课内容本讲主要授课内容n nRAM存储器技术存储器技术n nFLASH存储器技术存储器技术n n串口技术串口技术n n硬盘及硬盘及FAT文件系统文件系统n n显示技术显示技术n n其他接口其他接口13.1RAM存储器技术存储器技术n n在嵌入式系统中在嵌入式系统中CPU通过地址直接访问的通过地址直接访问的存储器包括可读写存储器和只读存储器两存储器包括可读写存储器和只读存储器两类,通常用于上电时存放运行时程序及数类,通常用于上电时存放运行时程序及数据的据的RAM被称为主存。被称为主存。2存储器的几个相关性能指数存储器的几个相关性能指
2、数p容量容量 存储器容量用存储器容量用S=S=WlmWlm表示,表示,W W为存储器字长,为存储器字长,l l为存储器字数,为存储器字数,m m则为存储器体数则为存储器体数 p速度速度 访问时间访问时间(access(access time)Tatime)Ta:从存储器接到读请:从存储器接到读请求到所读的字传送到数据总线上的时间间隔求到所读的字传送到数据总线上的时间间隔 存储周期存储周期TmTm:连续两次访问存储器之间所必需:连续两次访问存储器之间所必需的最小时间间隔。一般的最小时间间隔。一般Tm TaTm Ta 存储带宽存储带宽BmBm:存储器被连续访问时所提供的数:存储器被连续访问时所提供
3、的数据传输速流,单位是位据传输速流,单位是位(或字节)或字节)/秒秒 p价格价格 存储器的价格通常用单位字节价格来表示,若存储器的价格通常用单位字节价格来表示,若总容量为总容量为S S的存储器的总价格为的存储器的总价格为C C,则单位字节价格,则单位字节价格c cC/SC/S3存储器设计目标存储器设计目标p高速度高速度p大容量大容量p低价格低价格4设计目标实现依据设计目标实现依据p存储器的工艺实现技术有了突飞猛进的发展,高速、存储器的工艺实现技术有了突飞猛进的发展,高速、大容量、低价的存储器件以惊人的速度生产出来大容量、低价的存储器件以惊人的速度生产出来p所有程序都具有这样的行为特性:空间和时
4、间局部所有程序都具有这样的行为特性:空间和时间局部性性p90/1090/10原理:一个程序的原理:一个程序的9090时间是消耗在时间是消耗在1010的代的代码上码上 p根据以上局部性原则(根据以上局部性原则(The Principle of The Principle of LocalityLocality),就可以利用各种不同的价格、速度、容),就可以利用各种不同的价格、速度、容量的存储器的组合设计出一个多层次(量的存储器的组合设计出一个多层次(multiple multiple levellevel)存储系统)存储系统 5存储器层次结构存储器层次结构pp在嵌入式系统中所用到的存储器主要有:
5、触发器在嵌入式系统中所用到的存储器主要有:触发器在嵌入式系统中所用到的存储器主要有:触发器在嵌入式系统中所用到的存储器主要有:触发器(Flip-Flops and LatchesFlip-Flops and LatchesFlip-Flops and LatchesFlip-Flops and Latches)、寄存器()、寄存器()、寄存器()、寄存器(Register Register Register Register FilesFilesFilesFiles)、静态随机访问存储器()、静态随机访问存储器()、静态随机访问存储器()、静态随机访问存储器(SRAMSRAMSRAMSRAM)
6、、动态随)、动态随)、动态随)、动态随机访问存储器(机访问存储器(机访问存储器(机访问存储器(DRAMDRAMDRAMDRAM)、闪速存储器()、闪速存储器()、闪速存储器()、闪速存储器(FLASHFLASHFLASHFLASH)、)、)、)、磁盘(磁盘(磁盘(磁盘(Magnetic DiskMagnetic DiskMagnetic DiskMagnetic Disk)等)等)等)等 pp这些存储器的速度,为触发器最快,寄存器次之,这些存储器的速度,为触发器最快,寄存器次之,这些存储器的速度,为触发器最快,寄存器次之,这些存储器的速度,为触发器最快,寄存器次之,SRAMSRAMSRAMSR
7、AM再次,再次,再次,再次,DRAMDRAMDRAMDRAM较慢,然后是较慢,然后是较慢,然后是较慢,然后是FLASHFLASHFLASHFLASH,磁盘最慢,磁盘最慢,磁盘最慢,磁盘最慢pp价格正好反之,磁盘的每兆字节价格最便宜,触价格正好反之,磁盘的每兆字节价格最便宜,触价格正好反之,磁盘的每兆字节价格最便宜,触价格正好反之,磁盘的每兆字节价格最便宜,触发器最贵发器最贵发器最贵发器最贵6存储器层次结构图7存储器层次结构的特性 pp第一,数据的包含性,即上层的数据,在下一第一,数据的包含性,即上层的数据,在下一第一,数据的包含性,即上层的数据,在下一第一,数据的包含性,即上层的数据,在下一层
8、中都能找到。层中都能找到。层中都能找到。层中都能找到。pp第二,下层存储器将自己的地址映射到高层的第二,下层存储器将自己的地址映射到高层的第二,下层存储器将自己的地址映射到高层的第二,下层存储器将自己的地址映射到高层的存储器。存储器。存储器。存储器。8存储器层次结构几个基本概念存储器层次结构几个基本概念pp块(块(块(块(BlockBlockBlockBlock):相邻两级间的信息交换单位相邻两级间的信息交换单位相邻两级间的信息交换单位相邻两级间的信息交换单位pp命中(命中(命中(命中(HitHitHitHit):):):):相邻两层存储层次中,访问地址可相邻两层存储层次中,访问地址可相邻两层
9、存储层次中,访问地址可相邻两层存储层次中,访问地址可以直接在高层存储器中访问到以直接在高层存储器中访问到以直接在高层存储器中访问到以直接在高层存储器中访问到pp命中时间命中时间命中时间命中时间(hit time)(hit time)(hit time)(hit time):访问高层存储器所需的时访问高层存储器所需的时访问高层存储器所需的时访问高层存储器所需的时间,其中包括本次访问是命中还是失效的判定时间间,其中包括本次访问是命中还是失效的判定时间间,其中包括本次访问是命中还是失效的判定时间间,其中包括本次访问是命中还是失效的判定时间pp命中率(命中率(命中率(命中率(Hit RateHit R
10、ateHit RateHit Rate):):):):相邻两层存储层次中,访相邻两层存储层次中,访相邻两层存储层次中,访相邻两层存储层次中,访问地址可以直接在高层存储器中访问到的概率问地址可以直接在高层存储器中访问到的概率问地址可以直接在高层存储器中访问到的概率问地址可以直接在高层存储器中访问到的概率pp失效率(失效率(失效率(失效率(Miss RateMiss RateMiss RateMiss Rate):):):):等于等于等于等于1 1 1 1命中率命中率命中率命中率pp失效损失失效损失失效损失失效损失(miss penalty)(miss penalty)(miss penalty)
11、(miss penalty):用低层存储器中相应用低层存储器中相应用低层存储器中相应用低层存储器中相应的块替换高层存储器中的块,并将该块传送到请求的块替换高层存储器中的块,并将该块传送到请求的块替换高层存储器中的块,并将该块传送到请求的块替换高层存储器中的块,并将该块传送到请求访问的设备(通常是访问的设备(通常是访问的设备(通常是访问的设备(通常是CPUCPUCPUCPU)的时间)的时间)的时间)的时间9存储器层次结构的性能存储器层次结构的性能 pp评价存储器层次结构的性能参数是平均存储访问评价存储器层次结构的性能参数是平均存储访问评价存储器层次结构的性能参数是平均存储访问评价存储器层次结构的
12、性能参数是平均存储访问时间时间时间时间(average memory-access time)(average memory-access time)(average memory-access time)(average memory-access time)平均存储访问时间命中时间平均存储访问时间命中时间平均存储访问时间命中时间平均存储访问时间命中时间命中率命中率命中率命中率 失效率失效率失效率失效率 失效损失失效损失失效损失失效损失pp当块大小过小时,失效率很高当块大小过小时,失效率很高当块大小过小时,失效率很高当块大小过小时,失效率很高 pp当高层存储器容量保持不变时,失效率有一最低当
13、高层存储器容量保持不变时,失效率有一最低当高层存储器容量保持不变时,失效率有一最低当高层存储器容量保持不变时,失效率有一最低限值,此时块大小的变化对失效率没有影响限值,此时块大小的变化对失效率没有影响限值,此时块大小的变化对失效率没有影响限值,此时块大小的变化对失效率没有影响 pp当块大小超过某定值后,(这一定值又称为污染当块大小超过某定值后,(这一定值又称为污染当块大小超过某定值后,(这一定值又称为污染当块大小超过某定值后,(这一定值又称为污染点),失效率呈现随块大小增加而上升的趋势点),失效率呈现随块大小增加而上升的趋势点),失效率呈现随块大小增加而上升的趋势点),失效率呈现随块大小增加而
14、上升的趋势 10主存简介 pp主存是非常重要存储和记忆部件,用以存放主存是非常重要存储和记忆部件,用以存放主存是非常重要存储和记忆部件,用以存放主存是非常重要存储和记忆部件,用以存放数据和程序数据和程序数据和程序数据和程序pp主存大都采用主存大都采用主存大都采用主存大都采用DRAMDRAMDRAMDRAM芯片实现芯片实现芯片实现芯片实现 pp一般说来,容量越大速度越快的存储器就能一般说来,容量越大速度越快的存储器就能一般说来,容量越大速度越快的存储器就能一般说来,容量越大速度越快的存储器就能给系统带来越高的性能给系统带来越高的性能给系统带来越高的性能给系统带来越高的性能pp与微机相比,嵌入式系
15、统的主存一般比较小与微机相比,嵌入式系统的主存一般比较小与微机相比,嵌入式系统的主存一般比较小与微机相比,嵌入式系统的主存一般比较小pp同时在有些嵌入式系统中也有用同时在有些嵌入式系统中也有用同时在有些嵌入式系统中也有用同时在有些嵌入式系统中也有用FlashFlashFlashFlash存储器存储器存储器存储器作为主存使用的情况作为主存使用的情况作为主存使用的情况作为主存使用的情况11DRAM与与SRAM主要差别主要差别 pp对对对对DRAMDRAMDRAMDRAM芯片来说,在读出数据之后还需重新写回芯片来说,在读出数据之后还需重新写回芯片来说,在读出数据之后还需重新写回芯片来说,在读出数据之
16、后还需重新写回数据,因而它的访问延迟和存储周期不同。数据,因而它的访问延迟和存储周期不同。数据,因而它的访问延迟和存储周期不同。数据,因而它的访问延迟和存储周期不同。SRAMSRAMSRAMSRAM的的的的访问时间与存储周期则没有差别访问时间与存储周期则没有差别访问时间与存储周期则没有差别访问时间与存储周期则没有差别pp为防止信息丢失,为防止信息丢失,为防止信息丢失,为防止信息丢失,DRAMDRAMDRAMDRAM需要定期刷新每个存储单需要定期刷新每个存储单需要定期刷新每个存储单需要定期刷新每个存储单元,元,元,元,SRAMSRAMSRAMSRAM却不需要却不需要却不需要却不需要ppDRAMD
17、RAMDRAMDRAM设计强调容量,而对设计强调容量,而对设计强调容量,而对设计强调容量,而对SRAMSRAMSRAMSRAM设计来说,容量和设计来说,容量和设计来说,容量和设计来说,容量和速度同样重要速度同样重要速度同样重要速度同样重要pp就可以比较的存储器设计技术而言,就可以比较的存储器设计技术而言,就可以比较的存储器设计技术而言,就可以比较的存储器设计技术而言,DRAMDRAMDRAMDRAM的容量的容量的容量的容量大概为大概为大概为大概为SRAMSRAMSRAMSRAM的的的的16161616倍,而倍,而倍,而倍,而SRAMSRAMSRAMSRAM的存储周期比的存储周期比的存储周期比的
18、存储周期比DRAMDRAMDRAMDRAM的约的约的约的约快快快快8 8 8 816161616倍倍倍倍 12DRAM存储器存储器n nDRAM由于结构简单集成度高,因此价格由于结构简单集成度高,因此价格非常便宜,是目前嵌入式系统中主要的内非常便宜,是目前嵌入式系统中主要的内存方式。存方式。n nDRAM经历了经历了DRAM,FPM DRAM(Fast page Mode DRAM),EDO DRAM(Extended Data Out DRAM),SDRAM(Synchronous DRAM),DDR SDRAM(Double Data Rate SDRAM),DDR2 SDRAM,DDR3
19、 SDRAM13DRAM的基本结构的基本结构14从从DRAM到到DDRIIIn n最初最初DRAM读写是在控制信号的作用下先读写是在控制信号的作用下先发一个行地址再发一个列地址,随后读发一个行地址再发一个列地址,随后读/写写一个数据。一个数据。15DRAM读数据时序读数据时序16n n人们发现通常数据是连续读人们发现通常数据是连续读人们发现通常数据是连续读人们发现通常数据是连续读/写的,因此,改为写的,因此,改为写的,因此,改为写的,因此,改为FPM DRAMFPM DRAM,送一次行地址后,将行地址锁存,送一次行地址后,将行地址锁存,送一次行地址后,将行地址锁存,送一次行地址后,将行地址锁存
20、,只送列地址,每送一个列地址就读只送列地址,每送一个列地址就读只送列地址,每送一个列地址就读只送列地址,每送一个列地址就读/写一个数据,写一个数据,写一个数据,写一个数据,直到该行的数据读完。从而提高了读直到该行的数据读完。从而提高了读直到该行的数据读完。从而提高了读直到该行的数据读完。从而提高了读/写速度。写速度。写速度。写速度。17n n由于在列地址送出后到读出数据之间需要时间,由于在列地址送出后到读出数据之间需要时间,由于在列地址送出后到读出数据之间需要时间,由于在列地址送出后到读出数据之间需要时间,而这个时间对于地址线而言是空闲的,可以送出而这个时间对于地址线而言是空闲的,可以送出而这
21、个时间对于地址线而言是空闲的,可以送出而这个时间对于地址线而言是空闲的,可以送出下一个列地址,因此开发了下一个列地址,因此开发了下一个列地址,因此开发了下一个列地址,因此开发了EDO DRAMEDO DRAM,利用类,利用类,利用类,利用类似于流水线的模式进一步提高了内存读似于流水线的模式进一步提高了内存读似于流水线的模式进一步提高了内存读似于流水线的模式进一步提高了内存读/写速度。写速度。写速度。写速度。18n n由于由于DRAM需要动态充电的特性使每次读数需要动态充电的特性使每次读数据后需要进行再次充电才能进行下次读,因据后需要进行再次充电才能进行下次读,因此此SDRAM采用了两个(或多个
22、)采用了两个(或多个)Bank的方的方式进行交替数据操作,式进行交替数据操作,Bank0读数据时读数据时Bank1充电,充电,下一周期下一周期Bank1读数据时读数据时Bank0充电,充电,从而提高对外的数据交换能力。从而提高对外的数据交换能力。n nSDRAM的操作改为由外部时钟上升沿同步控的操作改为由外部时钟上升沿同步控制方式,以实现突发数据传送能力。突发数制方式,以实现突发数据传送能力。突发数据传送可以实现接收一次列地址发送多个数据传送可以实现接收一次列地址发送多个数据的能力。据的能力。192021n nDDR(Double Data Rate)SDRAM则采用则采用了二倍预读取的技术,
23、在每次得到一个地了二倍预读取的技术,在每次得到一个地址时芯片内部读取两个数据,这两个数据址时芯片内部读取两个数据,这两个数据分别在一个时钟的上升沿和下升沿传送出分别在一个时钟的上升沿和下升沿传送出去,从而提高读去,从而提高读/写速度。写速度。22n nDDRII SDRAM采用了采用了4倍预读取的技术,倍预读取的技术,在每次得到一个地址时芯片内部读取在每次得到一个地址时芯片内部读取4个数个数据,并将据,并将I/O端口的时钟频率提高为原来的端口的时钟频率提高为原来的两倍(内部操作时钟频率的两倍),并在两倍(内部操作时钟频率的两倍),并在一个时钟上升沿和下升沿各传送一个数据,一个时钟上升沿和下升沿
24、各传送一个数据,从而进一步提高读从而进一步提高读/写速度。写速度。23n nDDRIII SDRAM采用了采用了8倍预读取的技术,倍预读取的技术,在每次得到一个地址时芯片内部读取在每次得到一个地址时芯片内部读取8个数个数据,并将据,并将I/O端口的时钟频率提高为原来的端口的时钟频率提高为原来的4倍(内部操作时钟频率的倍(内部操作时钟频率的4倍),并在一个倍),并在一个时钟上升沿和下升沿各传送一个数据,从时钟上升沿和下升沿各传送一个数据,从而进一步提高读而进一步提高读/写速度。写速度。24SDRAM的特点的特点n nSDRAM由一系列指令控制完成数据存取功由一系列指令控制完成数据存取功能能n n
25、SDRAM需要使用专用的需要使用专用的SDRAM控制器控制器n n能够在系统时钟的驱动下连续存取数据,能够在系统时钟的驱动下连续存取数据,(突发模式)(突发模式)n n由于需要进行预充电,因此一般芯片由多由于需要进行预充电,因此一般芯片由多个个BANK组成组成n n采用预读写技术后,读采用预读写技术后,读/写性能成倍提升。写性能成倍提升。252627n nSDRAM中行地址宽度与列地址宽度常常是中行地址宽度与列地址宽度常常是不一样的,列地址通常只有不一样的,列地址通常只有9位,表示位,表示512个个列,也就是说给出一次行地址,最多能够列,也就是说给出一次行地址,最多能够读取读取512个字节(或
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