数字逻辑第5章.ppt
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1、 第一节第一节 计数器计数器 第二节第二节 寄存器寄存器 第三节第三节 序列码发生器序列码发生器 第四节第四节 时序模块的应用时序模块的应用 小结小结第一节第一节 计数器计数器按进位方式,分为同步和异步计数器。按进位方式,分为同步和异步计数器。按进位制,分为模按进位制,分为模2、模、模10和任意模计数器。和任意模计数器。按逻辑功能,分为加法、减法和可逆计数器。按逻辑功能,分为加法、减法和可逆计数器。按集成度,分为小规模与中规模集成计数器。按集成度,分为小规模与中规模集成计数器。用来计算输入脉冲数目用来计算输入脉冲数目计数器的分类计数器的分类部分常用集成计数器部分常用集成计数器 第一节第一节 计
2、数器计数器 四位二进制同步计数器四位二进制同步计数器第一节第一节 计数器计数器 四位二进制可逆计数器四位二进制可逆计数器 中规模异步计数器中规模异步计数器一、四位二进制同步计数器一、四位二进制同步计数器(二)(二)四位二进制同步计数器四位二进制同步计数器74163(一)(一)四位二进制同步计数器四位二进制同步计数器74161(三)(三)74161/74163功能扩展功能扩展(一)四位二进制同步计数器(一)四位二进制同步计数器74161 内部由四个主从内部由四个主从JK触触发器和控制电路构成。发器和控制电路构成。逻辑符号逻辑符号 符号输入中符号输入中R端有效,在端有效,在此输入为低电平时,输出为
3、此输入为低电平时,输出为0,称之为异步清零。端子输,称之为异步清零。端子输入端用入端用R说明。说明。CORLDCTTCTPCPQ0Q1Q2Q3D0D1D2D3 符号中符号中LD端为有效时,此端引入端为有效时,此端引入线为低时,且时钟线为低时,且时钟CP上升沿时,将输上升沿时,将输入端数字送到输出端。同步预置。入端数字送到输出端。同步预置。D0D1D2D3此端输入信号用此端输入信号用LD表示。表示。时钟输入信号用时钟输入信号用CP表示。表示。当当CP上升沿上升沿,并且并且CTT和和CTP 有效时,计数器加有效时,计数器加1计数。计数。CTP、CTT:可作为使能端和多:可作为使能端和多片级联使用片
4、级联使用。当当Q3 Q2 Q1 Q0=1111 时,且时,且CTT等于等于1时时,控制输出端控制输出端CO输出输出有效高电平。有效高电平。CO74161RLDCTTCTPCPQ0Q1Q2Q3D0D1D2D3CO74161外引线功能端排列图外引线功能端排列图(一)四位二进制同步计数器(一)四位二进制同步计数器74161 741611R2CP3D04D15D26D37CTT8GNDUCC 16CO 15Q0 14Q1 13Q2 12Q3 11CTP 10LD 974161功能表功能表 Q3 Q2 Q1 Q0输输 入入输输 出出CPRLDCTPCTTD3 D2 D1 D0 0 0 0 0 0 D3
5、D2 D1 D0 10 D3 D2 D1 D0 保持保持 11 0 保持保持 11 0 计数计数 11 1 1 1)1)异步清除:当异步清除:当R=0=0,输出,输出“00000000”状态,状态,与与CP无关。无关。2)2)同步预置:当同步预置:当C=1=1,LD=0=0,在在CP上升沿时上升沿时,输出,输出端反映输入数据的状态。端反映输入数据的状态。3)3)保持:当保持:当R=LD=1=1时,时,CTP或或CTT有一个无效,各有一个无效,各触发器均处于保持状态。触发器均处于保持状态。4)计数:当计数:当LD=R=CPT=CTT=1时,按时,按二进制自然二进制自然码码计数。计数。若初态为若初
6、态为0000,15个个CP后,输出为后,输出为“1111”,进位,进位CO=CTTQ3Q2Q1Q0=1。第。第16个个CP作用后,输作用后,输出恢复到出恢复到0000状态,状态,CO=0。(二)四位二进制同步计数器(二)四位二进制同步计数器74163 74163功能表功能表74161功能表功能表Q3 Q2 Q1 Q0输输 入入输输 出出CPRLDCTPCTTD3 D2 D1 D0 0 0 0 0 0 D3 D2 D1 D0 10 D3 D2 D1 D0 保持保持 11 0 保持保持 11 0 计数计数 11 1 1 (1)(1)外引线排列和外引线排列和 74161相同。相同。(2)(2)置数,
7、计数,置数,计数,保持功能与保持功能与74161相同。相同。(3)(3)清零功能与清零功能与74161不同。不同。特点:特点:74163采用采用同步清零同步清零方式方式:当当R=0=0时,且当时,且当 CP 的的上升沿上升沿来到时来到时,输出输出Q0Q1Q2Q3 才全被清零。才全被清零。CORLDCTTCTPCPQ0Q1Q2Q3D0D1D2D3CO74163RLDCTTCTPCPQ0Q1Q2Q3D0D1D2D3CO比较比较四位二进制同步计数器四位二进制同步计数器同步预置同步预置保持保持计数计数7416374161同步预置同步预置保持保持计数计数异步清零异步清零 同步清零同步清零连接成任意模连接
8、成任意模M 的计数器的计数器(1)同步预置法同步预置法(2)反馈清零法反馈清零法(3)多次预置法多次预置法(三)三)74161/7416374161/74163功能扩展功能扩展Q0Q1Q2Q301101 态序表态序表 计数计数 输输 出出 N Q3 Q2 Q1 Q0 0 0 1 1 0 1 0 1 1 1 2 1 0 0 0 3 1 0 0 1 4 1 0 1 0 5 1 0 1 1 6 1 1 0 0 7 1 1 0 1 8 1 1 1 0 9 1 1 1 1例例1:1:设计一个设计一个M=10的计数器。的计数器。方法一方法一:采用后十种状态采用后十种状态CO=10(1)(1)同步预置法同步
9、预置法1CO74163RLDCTTCTPCPQ0Q1Q2Q3D0D1D2D3COCORLDCTTCTPCPf1101100110f/10例例2:2:同步预置法设计同步预置法设计 M=24 计数器。计数器。00011000010000000(24)10=(11000)2需需 两两 片片初态为:初态为:0000 0001终态:终态:0001100000001000连接成任意模连接成任意模M 的计数器的计数器(1)同步预置法同步预置法(2)反馈清零法反馈清零法(3)多次预置法多次预置法(三)三)74161/7416374161/74163功能扩展功能扩展例例3:3:分析图示电路的功能。分析图示电路的
10、功能。0 0 0 0 01 0 0 0 12 0 0 1 03 0 0 1 14 0 1 0 05 0 1 0 16 0 1 1 07 0 1 1 18 1 0 0 09 1 0 0 110 1 0 1 011 1 0 1 112 1 1 0 0 采用采用741610000011(2 2)反馈清零法)反馈清零法 态序表态序表 N Q3 Q2 Q1 Q0连接成任意模连接成任意模M 的计数器的计数器(1)同步预置法)同步预置法(2)反馈清零法)反馈清零法(3)多次预置法)多次预置法(三)(三)74161/7416374161/74163功能扩展功能扩展 M=10 计数器计数器 态序表态序表 N Q
11、3 Q2 Q1 Q00 0 0 0 0(3)(3)多次预置法多次预置法例例4:分析电路功能。分析电路功能。2 0 1 0 13 0 1 1 04 0 1 1 15 1 0 0 07 1 1 0 18 1 1 1 09 1 1 1 11 0 1 0 06 1 1 0 000100011三、中规模异步计数器三、中规模异步计数器二、四位二进制可逆计数器二、四位二进制可逆计数器一、四位二进制同步计数器一、四位二进制同步计数器第二节第二节 计数器计数器3和和G3相关联。相关联。D A:数据输入,从数据输入,从高位高位低位低位。QD QA:数据输出,数据输出,从从高高位位低位低位。1.逻辑符号逻辑符号二、
12、四位二进制可逆计数器二、四位二进制可逆计数器74193 R=1时时,高电平有效,高电平有效,输出清零。输出清零。只要只要DN为高电平有效,为高电平有效,UP上升沿到时,加上升沿到时,加1计数。计数。反之,反之,只要只要UP 高电平有效,高电平有效,DN上升沿到时,减上升沿到时,减1计数。计数。即双时钟输入。即双时钟输入。LD当低电平时,数据从当低电平时,数据从输入到输出,且输入到输出,且异异步预置。步预置。减到最小减到最小值时产生借位值时产生借位信号信号QCB=0 加到最大加到最大值时产生进位值时产生进位信号信号QCC=0CO=0BO=074LS193RCPUQCCLDABCDCORLDUPD
13、NQAQBQCQDABCDCPDBOQCBQAQBQCQD74193功能表功能表二、四位二进制可逆计数器二、四位二进制可逆计数器74193 0 0 0 0 1 A B C D 0 0A B C D 加法计数加法计数1 0 1 减法计数减法计数1 0 1 保持保持11 0 1 QA QB QC QDUPDN RLDA B C D 连接成任意模连接成任意模M 的计数器的计数器(1)接成接成M16的计数器的计数器2.74193功能扩展功能扩展二、四位二进制可逆计数器二、四位二进制可逆计数器74193 74LS193RCPUQCCLDABCDCORLDUPDNQAQBQCQDABCDCPDBOQCBQ
14、AQBQCQD0 0 1 1 01 0 1 1 12 1 0 0 03 1 0 0 14 1 0 1 05 1 0 1 16 1 1 0 07 1 1 0 18 1 1 1 09 1 1 1 1例例6:用:用74193设计设计M=9 计数器。计数器。方法一方法一:采用采用异步预置、异步预置、加法计数加法计数(1)接成)接成M16的计数器的计数器 态序表态序表 N QD QC QB QA0110CO=001f011074LS193RCPUQCCLDABCDCORLDUPDNQAQBQCQDABCDCPDBOQCBQAQBQCQD方法二方法二:采用采用异步预置、异步预置、减减法计数法计数01 0
15、0 111 0 0 020 1 1 130 1 1 040 1 0 150 1 0 060 0 1 170 0 1 080 0 0 190 0 0 0例例7 7:用:用7419374193设计设计M=9 计数器。计数器。态序表态序表N QD QC QB QA(1)接成)接成M16的计数器的计数器1001BO=00f 11001 连接成任意模连接成任意模M 的计数器的计数器(1)接成接成M16的计数器的计数器2.741932.74193功能扩展功能扩展二、四位二进制可逆计数器二、四位二进制可逆计数器74193 例例8:8:用用74193设计设计M=147 计数器。计数器。方法一方法一:采用采用异
16、步清零、异步清零、加加法计数。法计数。M=(147)10=(10010011)2需要两片需要两片74193(2)接成)接成M16的计数器的计数器1100100100000000M=(147)10=(10010011)21001110011001001例例9:9:用用7419374193设计设计M=147 计数器计数器(2)接成)接成M16的计数器的计数器方法二方法二:采用采用减法减法计数、计数、异步预置、异步预置、利用利用BO端。端。三、中规模异步计数器三、中规模异步计数器二、四位二进制可逆计数器二、四位二进制可逆计数器一、四位二进制同步计数器一、四位二进制同步计数器第二节第二节 计数器计数器
17、(1)触发器触发器A:模:模2 CPA入入QA出出(2)触触发发器器B、C、D:模模5异异步步计计数器。数器。CPB 入入QD QB出出1.逻辑符号逻辑符号三、异步计数器三、异步计数器74290QD74LS290R0(1)CPAR0(1)QAQBQCR0(2)S9(1)S9(2)CPBR0(2)S9(1)S9(2)QDQAQBQCCPACPB S9(1)、S9(2)有效。有效。不管不管R0(1)、R0(2)是否有效,数是否有效,数据输出端为据输出端为1001。S9(1)、S9(2)有一个无效。有一个无效。R0(1)、R0(2)输入高电平,输入高电平,数据输出端清零。数据输出端清零。0000(3
18、(3)计数:当计数:当R0(1)、)、R0(2)及及S9(1)、)、S9(2)有低电平时有低电平时,且当有且当有CP下降沿下降沿时,即可以时,即可以实现计数。实现计数。在外部将在外部将QA和和CPB连接构成连接构成8421BCD码计码计数。数。f 从从CPA入,输出从入,输出从QD QA出。出。f 在外部将在外部将QD和和CPA连接构成连接构成5421BCD码计码计数。数。f 从从CPB入,输出从入,输出从QAQD QC QB出。出。f 0 0 计计 数数 0 0 0 0 0 0 三、异步计数器三、异步计数器74290输输 入入 输输 出出CP R0(1)R0(2)S9(1)S9(2)QA Q
19、B QC QD 1 1 0 0 0 0 0 1 1 0 0 0 0 0 1 1 1 0 0 1QD74LS290R0(1)CPAR0(1)QAQBQCR0(2)S9(1)S9(2)CPBR0(2)S9(1)S9(2)QDQAQBQCCPACPB例例 1:采用:采用74290 设计设计M=6计数器。计数器。方法一:利用方法一:利用R端端00 0 0 011 0 0 020 1 0 031 1 0 040 0 1 051 0 1 060 1 1 001100000 M=6=6 态序表态序表N QA QB QC QDQD74LS290R0(1)CPAR0(1)QAQBQCR0(2)S9(1)S9(2
20、)CPBR0(2)S9(1)S9(2)QDQAQBQC例例 2:采用:采用74290 设计设计M=7计数器。计数器。M=7 态序表态序表 N QA QB QC QD 00 0 0 011 0 0 020 1 0 031 1 0 040 0 1 051 0 1 060 1 1 071 0 0 1方法二:利用方法二:利用S 端端01101001CPACPB例例 3:用:用74290 设计设计M=10计数器。计数器。M=10=10 态序表态序表 NQAQDQC QB00 0 0 010 0 0 120 0 1 030 0 1 140 1 0 051 0 0 061 0 0 171 0 1 081 0
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