第3章单片机并行口应用精选PPT.ppt
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1、第第3章单片机并行口应用章单片机并行口应用第1页,本讲稿共64页单片机单片机I/OI/O口的使用口的使用l对单片机的控制,其实就是对对单片机的控制,其实就是对I/O口的控制,无口的控制,无论单片机对外界进行何种控制,或接受外部的控论单片机对外界进行何种控制,或接受外部的控制,都是通过制,都是通过I/O口进行的。口进行的。51单片机总共有单片机总共有P0、P1、P2、P3四个四个8位双向输入输出端口,每位双向输入输出端口,每个端口都有锁存器、输出驱动器和输入缓冲器。个端口都有锁存器、输出驱动器和输入缓冲器。4个个I/O端口都能作输入输出口用,其中端口都能作输入输出口用,其中P0和和P2通通常用于
2、对外部存储器的访问。常用于对外部存储器的访问。第2页,本讲稿共64页MCS-51MCS-51单片机的并行端口结构与操作单片机的并行端口结构与操作l51系列单片机有系列单片机有4个个I/O端口,每个端口都是端口,每个端口都是8位位准双向口准双向口,共占,共占32根引脚。每个端口都包括一个根引脚。每个端口都包括一个锁存器(即专用寄存器锁存器(即专用寄存器P0P3)、一个输出驱动)、一个输出驱动器和输入缓冲器。通常把器和输入缓冲器。通常把4个端口笼统地表示为个端口笼统地表示为P0P3。第3页,本讲稿共64页l 在无片外扩展存储器的系统中,这在无片外扩展存储器的系统中,这4个端口的个端口的每一位都可以
3、作为准双向通用每一位都可以作为准双向通用I/O端口使用。在端口使用。在具有片外扩展存储器的系统中,具有片外扩展存储器的系统中,P2口作为高口作为高8位位地址线,地址线,P0口口分时作为分时作为低低8位地址线和双向数据位地址线和双向数据总线总线。l51单片机单片机4个个I/O端口线路设计的非常巧妙,端口线路设计的非常巧妙,学习学习I/O端口逻辑电路,不但有利于正确合理地使端口逻辑电路,不但有利于正确合理地使用端口,而且会给设计单片机外围逻辑电路有所用端口,而且会给设计单片机外围逻辑电路有所启发。启发。下面简单介绍一下输入下面简单介绍一下输入/输出端口结构。输出端口结构。第4页,本讲稿共64页D
4、QCLK QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚一、一、P0P0口的结构口的结构下图为下图为P0口口的某位的某位P0.n(n=07)结构图,它由)结构图,它由一个输出锁存器、两个三态输入缓冲器和输出驱动一个输出锁存器、两个三态输入缓冲器和输出驱动电路及控制电路组成。从图中可以看出,电路及控制电路组成。从图中可以看出,P0口既口既可以作为可以作为I/O用,也可以作为地址用,也可以作为地址/数据线用。数据线用。第5页,本讲稿共64页1 1、P0P0口作为口作为普通普通I/OI/O口口输出时输出时CPU
5、CPU发出控制电平发出控制电平“0 0”封锁封锁“与与”门,将输出上拉场效门,将输出上拉场效应管应管T T1 1截止,同时使多路开关截止,同时使多路开关MUXMUX把锁存器把锁存器与输出与输出D QCLK QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚第6页,本讲稿共64页驱动场效应管驱动场效应管T T2 2栅极接通。故内部总线与栅极接通。故内部总线与P0P0口同相。由口同相。由于输出驱动级是漏极开路电路,必须于输出驱动级是漏极开路电路,必须外接上拉电阻外接上拉电阻才能有才能有高电平输出。高电平输出。P0
6、P0的输出级可驱动的输出级可驱动8 8个个LSTTLLSTTL负载。负载。D QCLK QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚第7页,本讲稿共64页 输入时输入时-分分读引脚读引脚或或读锁存器读锁存器读引脚:读引脚:由传送指令由传送指令(MOVMOV)实现;实现;下下面一个缓冲器用于读端口面一个缓冲器用于读端口引脚引脚数据,当执行一条由端口数据,当执行一条由端口输入的指令时,读脉冲把该三态缓冲器打开,这样端口引脚上输入的指令时,读脉冲把该三态缓冲器打开,这样端口引脚上的数据经过缓冲器读入到内部总线
7、。的数据经过缓冲器读入到内部总线。D QCLK QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚第8页,本讲稿共64页 输入时输入时-分分读引脚读引脚或或读锁存器读锁存器读锁存器:读锁存器:有些指令有些指令 如:如:P0=P0&0 x0FP0=P0&0 x0F称为称为“读读-改改-写写”指令,需要读锁存器。指令,需要读锁存器。上上面面一个缓冲器用于读端口一个缓冲器用于读端口锁存器锁存器数据。数据。D QCLK QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制
8、控制VCCT1T2P0P0口引口引脚脚第9页,本讲稿共64页*原因:原因:如果此时该端口的负载恰是一个晶体管如果此时该端口的负载恰是一个晶体管基极基极,且原端,且原端口输出值为口输出值为1 1,那么导通了的,那么导通了的PNPN结会把端口引脚高电平拉低;结会把端口引脚高电平拉低;若此时直接读端口引脚信号,将会把原输出的若此时直接读端口引脚信号,将会把原输出的“1 1”电平误电平误读为读为“0 0”电平。现采用读输出锁存器代替读引脚,图中,上面的电平。现采用读输出锁存器代替读引脚,图中,上面的三态缓冲器就为读锁存器三态缓冲器就为读锁存器Q Q端信号而设,读输出锁存器可避免上端信号而设,读输出锁存
9、器可避免上述可能发生的错误。述可能发生的错误。*D QCLK QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚第10页,本讲稿共64页准准双向口:双向口:从图中可以看出,在读入端口数据时,由于输出驱从图中可以看出,在读入端口数据时,由于输出驱动动FETFET并接在引脚上,如果并接在引脚上,如果T2T2导通,就会将输入的高电平导通,就会将输入的高电平拉成低电平,产生误读。所以在端口进行输入操作前,拉成低电平,产生误读。所以在端口进行输入操作前,应先向端口锁存器应先向端口锁存器写写“1”,使使T2T2截止,截止
10、,引脚处于悬浮状引脚处于悬浮状态,态,变为高阻抗输入,以避免锁存器为变为高阻抗输入,以避免锁存器为“0 0”时对引脚读入时对引脚读入的干扰。这就是所谓的的干扰。这就是所谓的准准双向口。双向口。D QCLK QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚第11页,本讲稿共64页2 2、P0P0作为作为地址地址/数据总线数据总线 在系统扩展时,在系统扩展时,P0P0端口作为端口作为地址地址/数据总线数据总线使用时,分为:使用时,分为:P0P0引脚引脚输出地址输出地址/数据数据信息。信息。D QCLK QMUX
11、P0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚第12页,本讲稿共64页 CPU CPU发出控制电平发出控制电平“1 1”,打开,打开“与与”门,又使多路开关门,又使多路开关MUXMUX把把CPUCPU的的地址地址/数据总线数据总线与与T2T2栅极反相接通,输出地址或数据。栅极反相接通,输出地址或数据。由图上可以看出,上下两个由图上可以看出,上下两个FETFET处于反相,构成了推拉式的输出处于反相,构成了推拉式的输出电路,其负载能力大大增强。电路,其负载能力大大增强。2 2、P0P0作为作为地址地址/数据总线数据总
12、线D QCLK QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚第13页,本讲稿共64页 P0 P0引脚引脚输出地址输出地址/输入数据输入数据 输入信号是从引脚通过输入缓冲器进入输入信号是从引脚通过输入缓冲器进入内部总线内部总线。此时,此时,CPUCPU自动使自动使MUXMUX向下,并向向下,并向P0P0口写口写“1 1”,“读引脚读引脚”控控制信号有效,下面的缓冲器打开,外部数据读入内部总线。制信号有效,下面的缓冲器打开,外部数据读入内部总线。2、P0作为地址地址/数据总线数据总线-真正的双向口D QCL
13、K QMUXP0.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚地址地址/数据数据控制控制VCCT1T2P0P0口引口引脚脚第14页,本讲稿共64页二、二、P2P2的内部结构的内部结构1.P21.P2口作为口作为普通普通I/OI/O口口D QCLK QMUXP2.n读锁存器读锁存器内部总线写锁存器写锁存器读引脚读引脚地址地址控制控制VCCRTP2口引脚CPUCPU发出控制电平发出控制电平“0 0”,使多路开关,使多路开关MUXMUX倒向锁存器倒向锁存器输出输出Q Q端,构成一个准双向口。其功能与端,构成一个准双向口。其功能与P1P1相同。相同。第15页,本讲稿共64页 2.P2
14、2.P2口作为口作为地址总线地址总线 在系统扩展片外在系统扩展片外程序存储器程序存储器扩展数据存储器且容量超过扩展数据存储器且容量超过256B 256B(用用MOVX DPTRMOVX DPTR指令指令)时,时,CPUCPU发出控制电平发出控制电平“1 1”,使多路开关,使多路开关MUXMUX倒倒内部地址线内部地址线。此时,。此时,P2P2输出高输出高8 8位地址。位地址。D QCLK QMUXP2.n读锁存器读锁存器内部总线写锁存器写锁存器读引脚读引脚地址地址控制控制VCCRTP2口引脚第16页,本讲稿共64页P1P1口、口、P3P3口的内部结构口的内部结构 P1 P1口的一位的结构口的一位
15、的结构 它由一个它由一个输出锁存器输出锁存器、两个三态输入缓冲器两个三态输入缓冲器和和输出驱动电输出驱动电路路组成组成-准双向口。准双向口。D QD QCLK QCLK QP1.nP1.n读读锁存器锁存器内部总线内部总线写写锁存器锁存器读读引脚引脚VCCRT TP1口引脚第17页,本讲稿共64页P3P3的内部结构的内部结构一、作为通用一、作为通用I/OI/O口与口与P1P1口类似口类似-准双向口准双向口(W=1)(W=1)D QD QCLK QCLK QP3.nP3.n读读锁存器锁存器内部总线内部总线写锁存器写锁存器读读引脚引脚VCCRT TP3口引脚第二第二输入功能输入功能第二第二输出功能输
16、出功能W第18页,本讲稿共64页P3P3的内部结构的内部结构二、二、P3P3P3P3第二功能第二功能(Q=1Q=1)此时引脚部分输入此时引脚部分输入(Q=1Q=1、W=1)W=1),部分输出部分输出(Q=1Q=1、W W输出输出)。D QD QCLK QCLK QP3.nP3.n读读锁存器锁存器内部总线内部总线写锁存器写锁存器读读引脚引脚VCCRT TP3口引脚第二第二输入功能输入功能第二第二输出功能输出功能W第19页,本讲稿共64页P3P3P3P3第二功能各引脚功能定义:第二功能各引脚功能定义:P3.0P3.0:RXDRXD串行串行口输入口输入P3.1P3.1:TXDTXD串行串行口输出口输
17、出P3.2P3.2:INT0INT0外部中断外部中断0 0输入输入P3.3P3.3:INT1INT1外部中断外部中断1 1输入输入P3.4P3.4:T0T0定时器定时器0 0外部输入外部输入P3.5P3.5:T1T1定时器定时器1 1外部输入外部输入P3.6P3.6:WRWR外部写外部写控制控制P3.7P3.7:RDRD外部读外部读控制控制第20页,本讲稿共64页综上所述:综上所述:*当当P0作为作为I/O口使用时,特别是作为输出时,输口使用时,特别是作为输出时,输出级属于开漏电路,必须外接上拉电阻才会有出级属于开漏电路,必须外接上拉电阻才会有高电平输出;如果作为输入,必须先向相应的高电平输出
18、;如果作为输入,必须先向相应的锁存器写锁存器写“1”,才不会影响输入电平。,才不会影响输入电平。*当当CPU内部控制信号为内部控制信号为“1”时,时,P0口作为地址口作为地址/数据总线使用,这时,数据总线使用,这时,P0口就无法再作为口就无法再作为I/O口口使用了。使用了。第21页,本讲稿共64页任务一:一个任务一:一个LEDLED发光二极管的闪烁控制发光二极管的闪烁控制状态灯原理图状态灯原理图 任务三:控制任务三:控制8 8个个LEDLED发光二极管的闪烁控制发光二极管的闪烁控制任务二:调试发光二极管的闪烁控制任务二:调试发光二极管的闪烁控制第22页,本讲稿共64页#include/包含头文
19、件包含头文件reg51.hvoid delay(unsigned char a);/延时函数声明延时函数声明sbit P1_0=P10;/特殊功能位声明特殊功能位声明void main()/主函数主函数while(1)P1_0=0;/将将P0的第的第1个引脚置个引脚置“0”,LED点亮点亮delay(250);/延时延时 P1_0=1;/将将P0的第的第1个引脚置个引脚置“1”,LED熄灭熄灭delay(250);/延时延时void delay(unsigned char a)/延时函数延时函数unsigned char x,y;for(x=a;x0;x-)for(y=250;y0;y-);第
20、23页,本讲稿共64页C C5151的数据类型的数据类型基本数据类型基本数据类型类型类型符号符号关键字关键字数的表示范围数的表示范围所占位数所占位数整整型型字字符符型型实实型型有有无无(signed)int16-3276832767(signed)short16-3276832767(signed)long32-2147483648214748364716unsignedint0655353204294967295unsignedlongintunsignedshortint16065535有有float323.4e-383.4e38有有double641.7e-3081.7e308有有cha
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