微机原理及应用-ch6(精品).ppt
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1、6.1 可编程并行接口芯片可编程并行接口芯片8255A第六章第六章 可编程接口芯片可编程接口芯片6.1 可编程并行接口芯片可编程并行接口芯片8255A一、并行通信与并行接口一、并行通信与并行接口 并行通信并行通信就是把一个字符的各数位用几条数据线同就是把一个字符的各数位用几条数据线同时进行传送,通常每次传送时进行传送,通常每次传送8位或位或16位数据。这种方式和位数据。这种方式和串行通信相比,在同样的传输率下,信息传输速度快,串行通信相比,在同样的传输率下,信息传输速度快,但是传送距离较近。但是传送距离较近。实现并行通信的接口称为实现并行通信的接口称为并行接口并行接口。并行接口能从。并行接口能
2、从微处理机或外设接收数据,需要时发送出去,因此在信微处理机或外设接收数据,需要时发送出去,因此在信息传送过程中,并行接口起着锁存或缓冲作用。并行接息传送过程中,并行接口起着锁存或缓冲作用。并行接口分为可编程和不可编程两种类型。可编程是指接口在口分为可编程和不可编程两种类型。可编程是指接口在工作前必须由工作前必须由CPU用输出指令(用输出指令(OUT指令)对它编程,指令)对它编程,规定其工作方式,此编程过程称为初始化。规定其工作方式,此编程过程称为初始化。二、二、8255A内部结构及引脚功能内部结构及引脚功能 18255A内部结构内部结构 8255A的内部的内部结结构如构如图图所示,它由数据所示
3、,它由数据总线缓总线缓冲冲器器,数据端口数据端口A、B、C,A组组控制和控制和B组组控制控制,读读/写写控制控制逻辑逻辑四部分四部分组组成成。(1)数据总线缓冲数据总线缓冲器器 数据总线缓冲器是一个双向三态的数据总线缓冲器是一个双向三态的8位数据缓冲位数据缓冲器,器,8255A通过它与系统总线相连。输入数据、输出通过它与系统总线相连。输入数据、输出数据、数据、CPU 发给发给8255A的控制字都是通过这个缓冲器的控制字都是通过这个缓冲器进行的。进行的。8255A芯片内部包含三个芯片内部包含三个8位数据端口位数据端口(A口、口、B口、口、C口口),共共24条条I/O线线(PA0PA7,PB0PB
4、7,PC0PC7)。端口端口A对应一个对应一个8位数据输入锁存器和一个位数据输入锁存器和一个8位数据位数据输出锁存器输出锁存器/缓冲器。用端口缓冲器。用端口A作为输入或输出时,数作为输入或输出时,数据均受到锁存。据均受到锁存。端口端口B和和端口端口C均均对应一个对应一个8位输入缓冲器和一个位输入缓冲器和一个8位数据输出锁存器位数据输出锁存器/缓冲器。缓冲器。使用中,端口使用中,端口A和端口和端口B作为独立的输入端口和输作为独立的输入端口和输出端口,端口出端口,端口C配合端口配合端口A和和B的工作。端口的工作。端口C常通过控常通过控制命令被分成两个制命令被分成两个4位端口,分别用来为端口位端口,
5、分别用来为端口A和和B提供提供控制信号和状态信号。控制信号和状态信号。(2)并行输入并行输入/输出端口输出端口PA、PB、PC 这两组控制电路一方面接收这两组控制电路一方面接收CPU发来的控制发来的控制字并决定字并决定8255A的工作方式;另一方面接收来自读的工作方式;另一方面接收来自读/写控制逻辑电路的读写控制逻辑电路的读/写命令,完成接口的读写命令,完成接口的读/写写操作。操作。A组控制电路控制端口组控制电路控制端口A和端口和端口C的高的高4位的工位的工作方式和读作方式和读/写操作。写操作。B组控制电路控制端口组控制电路控制端口B和端口和端口C的低的低4位的工位的工作方式和读作方式和读/写
6、操作。写操作。(3)A组控制和组控制和B组控制组控制 读读/写控制逻辑负责管理写控制逻辑负责管理8255A的数据传输过的数据传输过程。它接收译码电路的程。它接收译码电路的CS*和来自地址总线的和来自地址总线的A1,A0信号,以及控制总线的信号,以及控制总线的RESET,RD*,WR*信信号,将这些信号进行组合后,得到对号,将这些信号进行组合后,得到对A组控制部件组控制部件和和B组控制部件的控制命令,并将命令发给这两个组控制部件的控制命令,并将命令发给这两个部件,以完成对数据信息、状态信息和控制信息部件,以完成对数据信息、状态信息和控制信息的传输。的传输。(4)读读/写控制逻辑写控制逻辑 2.8
7、255A的芯片引脚信号的芯片引脚信号除电源和地以外,除电源和地以外,8255A的芯片引脚信号可分为的芯片引脚信号可分为两组:两组:(1)和外设一边相连的信和外设一边相连的信号号PA7PA0:A端口数据信号端口数据信号PB7PB0:B端口数据信号端口数据信号PC7PC0:C端口数据信号端口数据信号RESET:复位信号,高电平有效。当复位信号,高电平有效。当RESET信号到来,所有信号到来,所有内部寄存器都被清除,同时,内部寄存器都被清除,同时,3个数据端口被自动设为输出端个数据端口被自动设为输出端口口D7D0:8255A的数据线,和系统数据总线相连的数据线,和系统数据总线相连CS*:芯片选择信号
8、,低电平有效。芯片选择信号,低电平有效。CS*有效时,有效时,RD*和和WR*才对才对8255A有效有效RD*:读出信号,低电平有效。有效时,读出信号,低电平有效。有效时,CPU可从可从8255A中读中读取输入数据取输入数据WR*:写入信号,低电平有效。有效时,写入信号,低电平有效。有效时,CPU可往可往8255A中中写入控制字和数据写入控制字和数据A1、A0:端口选择信号,分别与地址线端口选择信号,分别与地址线A1和和A0相连。相连。A1A0=00,选中端口,选中端口A;A1A0=01,选中端口,选中端口B;A1A0=10,选中端口,选中端口C;A1A0=11,选中控制字寄存器,选中控制字寄
9、存器(2)和和CPU一边相连的信号一边相连的信号8255A的操作方式的操作方式A1A0操操 作作00010端口端口ACPU01010端口端口BCPU10010端口端口CCPU00100CPU端口端口A01100CPU端口端口B10100CPU端口端口C11100CPU控制寄存器控制寄存器11010非法操作非法操作110数据数据总线总线浮空浮空1未未选该选该8255A,数据,数据总线总线浮空浮空三、三、8255A工作方式工作方式 PA口可工作于方式口可工作于方式0、方式、方式1、方式、方式2;PB口可工作于方式口可工作于方式0、方式、方式1;PC口只能工作于方式口只能工作于方式0。1.方式方式0
10、基本基本I/O方式方式 无条件传输方式。无条件传输方式。在方式在方式0下,每一个端口都作为基本的输入或输出口,下,每一个端口都作为基本的输入或输出口,端口端口C口的高口的高4位和低位和低4位以及端口位以及端口A口、端口口、端口B都可独立地都可独立地设置为输入口或输出口。设置为输入口或输出口。CPU可以随时对它们进行读或写。通过可以随时对它们进行读或写。通过IN和和OUT指令指令 2.方式方式1选通选通I/O方式方式 有条件的数据传输,条件是有关(控制)信号有效有条件的数据传输,条件是有关(控制)信号有效。方式方式1下三个端口分为下三个端口分为A、B两组,端口两组,端口A、端口、端口B仍作为输入
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