上海交通大学电工及电子技术实验中心-可编程器件与电子设计自动化.ppt

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1、 上海交通大学电工及电子技术实验中心上海交通大学电工及电子技术实验中心 可可编编程程器器件件与与电电子子设设计计自自动动化化EDAEDA经历了几次大的进步经历了几次大的进步l70年代，EDA工具供应商只有几家，产品几乎全部面向LSI或PCB布线设计。例如，现在常用的TANGO软件就属于PCB布线软件。这一时期的EDA一般称为电路CAD（计算机辅助设计）。EDAEDA经历了几次大的进步经历了几次大的进步l80年代，开始供应带电路图编辑工具和逻辑模拟工具的EDA软件，这个时期的EDA是以数字电路分析工具为代表，主要解决电路设计没有完成之前的功能检验问题。EDAEDA经历了几次大的进步经历了几次大的

2、进步l进入90年代，乃至目前使用的EDA软件是第三代EDA软件。以逻辑综合、硬件行为仿真、参数分析和测试为重点。设计工具门类齐全，能够提供系统设计需要的全部工具，如描述设计意图的设计输入工具、具有逻辑综合和设计优化能力的设计工具以及验证设计和评估性能的仿真工具，能够在系统级、电路级和RTL及门级进行设计描述、综合和仿真。电子线路计算机辅助设计（电子线路计算机辅助设计（CADCAD）与电子设计自动化（与电子设计自动化（EDAEDA）CAD：Computer Aided Design EDA：Electronic Design Automationl可编程器件 l基于芯片的设计方法l以计算机为操作

3、平台lEDA软件工具传统数字电路设计方法传统数字电路设计方法l确定目标l设计电路原理图 考虑因素：设计者经验（直接设计、利用真值表、现有的电路模块）、可获得的元器件、尽可能少地使用元件、制图规范，美观（用电路图设计软件，如PROTEL、ORCAD、PSPICE等).传统数字电路设计方法传统数字电路设计方法l审核、修改电路原理图（电路仿真软件，WORKBENCH等）l设计、制作印刷电路板 （利用相应的软件完成从原理图到印刷板的自动或半自动布线）l购置元器件、焊接、调试调试中发现问题，重复步骤3-5三人表决器电路三人表决器电路真值表真值表A B C F0 0 0 00 0 1 00 1 0 00

4、1 1 11 0 0 01 0 1 11 1 0 11 1 1 1F=AB+BC+CA可编程可编程ASIC器件（器件（PLD）l电路主体是“与阵列”和“或阵列”l可以直接输出，也可通过寄存器方式按可编程的部位分类按可编程的部位分类CPLD（Altera 公司为代表）复杂可编程逻辑器件（Complex Programmable Logical Devices)l一个CPLD含有多个逻辑元件块（PLD）l每个逻辑块间的接线是可编程的l运行速度比FPGA快l功耗较大CPLD CPLD 结结 构构 方方 框框 图图FPGAFPGA（XilinxXilinx 公司为代表）公司为代表）现场可编程门阵列 （

5、Field Programmable Gate Array)l 逻辑功能块粒度小l 类似门阵列的连线通道和逻辑功能块结 构l 逻辑元件使用率高l 寄存器较多 可编程可编程ASICASIC器件的编程元件器件的编程元件l熔丝型开关l浮栅编程技术l基于SRAM的编程元件熔丝型开关熔丝型开关l只允许对器件编程一次,编程后不能修改.l集成度、工作频率和可靠性很高.l适用于电磁辐射干扰强的恶劣环境.浮栅编程技术浮栅编程技术l基于2ROM存储器的可编程器件能够重复编程100次以上l系统掉电后编程信息也不会丢失l可用在系统编程的方法l可设置加密位、节能方式等工作条件基于基于SRAMSRAM的编程元件的编程元件

6、l编程数据存储于器件的RAM区中l掉电时RAM中数据会丢失l编程数据平时存储在EPROM、磁盘中l系统加电时将这些编程数据即时写入可编程器件的RAM中电路原理图输入方式与下载l与传统的设计方法相近，电子工程师容易接受l简捷、直观l设计者需要熟悉元器件功能l适合于用中规模通用模块来设计电路l对于复杂电路的设计，十分困难甚至难以实现硬件描述语言（HDL、VHDL、ABEL等）输入方式l与传统的设计思考方式完全不同的崭新思维方式l类似高级程序语言l设计较少依赖对元器件的熟悉程度l容易进行复杂电路的设计(适合某些不通用的控制器电路)逻辑电路的语言描述逻辑电路的语言描述lHDL(Hardware Des

7、cription Language)硬件描述语言lAHDL(Altera Hardware Description Language)lABEL-HDLlVHDL EPM7128SEPM7128S管脚示意图管脚示意图 在系统编程芯片在系统编程芯片EPM7128S-15EPM7128S-15基基 本本 结结 构构l低密度、高性能CMOS可编程逻辑器件之一。l84脚的PLCC封装。l4个直接输入2，1，84，83和64个I/O引脚。（I/O引脚既可作为输出、又可作为输入）lTMS、TDI、TDO、TCK是在系统编程信号，在系统编程之后，四个信号不可作为I/O引脚。l 8个相似的逻辑阵列块LAB（Logic Array Block)。每个LAB有16个宏单元(Macrocell）2个独立的全局时钟和一个全局清除.每个宏 单元有一个寄存器。l 一个可编程连线阵列（PLA）.l 多个输入/输出控制块（I/O Block）.JDEE-7 JDEE-7 在系统可编程器件实验箱在系统可编程器件实验箱 面面 板板 图图JDEE-7JDEE-7在系统可编程器件实验板在系统可编程器件实验板 注注 意意 事事 项项