数字调节器的计算机实现解析.pptx
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1、一、直接程序法非正则形式 直接程序法:是指对(550)式所表示的D(z)不作任何实质性变化而实现它的方法。非正则:当所用延时环节数目高于D(z)的阶数(D(z)分母中z-1的最高次幂),则称非正则形式;正则:当所用延时环节数目小于等于D(z)的阶数时则称为正则形式。在z域中,数字调节器一般可表示成关于z-1的有理分式:第1页/共35页数字调节器输出的Z变换表达式第2页/共35页根据(5-52)式可编写出计算u(k)的程序。程序框图如图5-16所示。由图5-15看出,非正则形式计算一次u(k)的花销如下:(1)加法次数m+n;(2)乘法次数m+n+1;(3)移动或延时次数m+n.它们是:(4)寄
2、存纯滞后信号所须的单元数m+n+2.它们是:u(k-i),i=0,1,2ne(k-i),i=0,1,2m第3页/共35页二、直接程序法正则形式 为了减少操作次数。将(5-50)式稍加改写,引入中间函数Q(z),有 第4页/共35页直接实现法的正则形式I信息流程图若将每个延迟环节的输出定义为状态变量,则按图5-17写出的状态方程是可控标准型,故正则形式I也称可控标准型实现.第5页/共35页由此可编写程序。由图5-17可知,正则形式I计算一次u(k)的开销是:(1)加法次数m+n;(2)乘法次数m+n+1;(3)移动操作次数n;(4)纯滞后信号的存储单元数n+1.与非正则形式相比,位移操作次数与存
3、储单元数分别减少了m个和m+1个.第6页/共35页第7页/共35页正则形式II每计算一次u(k)的开销是:(1)加法次数:m+n;(2)乘法次数:m+n+1;(3)移动操作次数:n;(4)纯滞后信号的存储单元数:n+1.(5)计算滞后小。计算滞后小的原因:式(5-60)中的d可以在上一个采样周期内预先算好,在本采样周期,只要得到误差采样值e(k),按b0e(k)十d做一次乘法和一次加法后,就可立即得到控制输出u(k)。由于计算滞后相当于在系统中加入一纯滞后环节所以计算滞后小,有利于提高系统品质。这是正则形式II的最大优点。第8页/共35页 四、串行程序法当数字调节器D(z)具有较高的阶次时,可
4、把D(z)分解因式,化作一些简单的一阶环节或二阶环节中的串联。这样,可将D(z)的因式形式一般地写成:信息流程如图5-19所示。图中Di(z)是一阶或二阶环节:第9页/共35页串行程序法的特点可以简化程序设计。只要设计出一阶或二阶Di(z)的子程序,通过反复调用子程序,便可实现D(z)。这种程序设计所占存贮量小,程序易读易调试。可降低系统对参数、及量化误差的灵敏度。D(z)分解因式,有时较困难。计算一次u(k)的开销为:加法次数:m+n;乘法次数:m+n+1;移位操作次数:n十1;纯滞后信号需单元数:n+1。每个环节的输出作为下一个环节的输入,逐个环节的串行进行下去,最终得到输出u(k)。而每
5、个环节的编程仍用直接程序法。第10页/共35页 五、并行程序法 对于高阶的D(z)、可以用部分分式法将其比为多个一阶或二阶环节的相加,其中每个环节可用直接程序法(部分分式法)编程。式(550)可用部分分式法表示如下:其并行程序信号流程如图5-20。图中Di(z)是一阶或二阶环节例如:第11页/共35页并行程序法的特点:可以简化程序设计。可以降低系统对参数、及量化误差的灵敏度。部分分式有时难求。计算一次u(k)的开销为:加法次数:2n-1;乘法次数:2n;移位操作次数:n;纯滞后信号所需单元数:n。六、小结和举例各种程序设汁法计算一次u(k)的开销列于表5-2中。选择程序设计法的基本原则:程序易
6、读性强、计算时间短、计算误差小、占存贮单元少、编程方便。为了简便易读,可采用直接程序法的非正则形式;为了减少计算滞后,可选直接程序法正则形式Il;为了计算精确并减小对系数变化的灵敏度,应选串行程序法。选并行程序法显然也较精确,但它的计算次数、移位次数等开销比串行程序法大。第12页/共35页五种程序实现方法比较第13页/共35页解:第14页/共35页(5)并行程序法第15页/共35页二、关于数字PID的三个参数分析 例:计算机控制系统如图6-5所示采样周期T01s。若数字调节器D(z)k,试分析kP对系统性能的影响以及选择kP的方法。第16页/共35页由上式及Z变换性质,可求出输出序列y(kT)
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