quarusII使用初步PPT课件.ppt
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1、Quartus II 8.0使用介绍Quartus II 8.0 简介EDA开发平台PLD/FPGA功能:设计输入、编译、逻辑综合、器件适配、设计仿真、定时分析、器件编程Quartus II使用方法使用方法 建立新项目 建立新Verilog HDL文件 编译项目 建立新块设计文件 功能仿真 分配器件及引脚 下载文件到开发板License 的设置License 的设置在终端下输入ipconfig /all,找到物理地址License 的设置license.dat里的XXXXXXXXXXXX用物理地址(例子里是50784c76e2b1)替换在License file 中导入license.dat一
2、、建立新项目建立新项目:FileNew Project Wizard指定完项目目录后的界面指定完项目目录后的界面:项目名称、顶层设计实体名称缺省使用该目录名称。项目名称、顶层设计实体名称缺省使用该目录名称。项目名称一般可任取,但顶层设计实体名称一定要与将要设计的某个项目名称一般可任取,但顶层设计实体名称一定要与将要设计的某个文件同名。文件同名。FileNew 或 工具栏上的“新建”按钮在出现的“新建”界面的“Device Design Files”标签中选择“Verilog HDL File”。二、建立新VerilogHDL文件输入VerilogHDL源文件保存VerilogHDL源文件本例中
3、的项目只有这一个文件,所以该VerilogHDL源文件的名称与该项目的顶层设计实体名称相同,当然,该VerilogHDL源文件的名称一定与它内部的实体(“Entity”)名称相同。编译项目:菜单Processing-Start Compilation或工具栏的编译按钮三、编译项目 四、建立新块设计文件使用Quartus II软件在进行数字逻辑设计时,除了可用VHDL进行设计外,还可以用“块文件”进行设计。用块文件进行数字逻辑设计一般就是用电子元器件进行设计,也即电路原理图设计。下面的例子介绍如何用块文件进行数字逻辑设计。在这个例子中,要实现的功能是这样的:AB and C指定项目目录、名称等
4、建立块文件在新建文件的“Device Design Files”标签中选中“Block Diagram/Schematic File”块文件编辑窗口为输入元器件,鼠标双击任意空白处。输入元器件的界面 输入或查找元器件输入“and2”,点击“OK”按钮结束。输入完“and2”器件后的界面输入“input”引脚输入完所需的所有器件后的界面连接器件 为输入、输出引脚命名双击要命名的输入或输出引脚,在出现的界面中的“Pin name”栏中为器件指定名称。指定完所有名称后的界面保存块文件并编译项目:菜单Processing-Start Compilation或工具栏的编译按钮建立波形文件为进行仿真需要建
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