多功能数字钟电路设计.pdf
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1、多功能数字钟电路设计 一、数字电子钟设计摘要2 二、数字电子钟方案框图2 三、单元电路设计及相关元器件的选择3 1.6 进制计数器电路的设计3 2.10 进制计数器电路的设计4 3.60 进制计数器电路的设计4 4.时间计数器电路的设计5 5.校正电路的设计6 6.时钟电路的设计7 7.整点报时电路设计8 8.译码驱动及单元显示电路9 四、系统电路总图及原理9 五、经验体会10 六、参考文献10 附录 A:系统电路原理图 附录 B:元器件清单 一、数字电子钟设计摘要 数字钟是一种用数字电路技术实现时、分、秒计时的装置,与机械式时钟相比具有更高的准确性和直观性,且无机械装置,具有更更长的使用寿命
2、,因此得到了广泛的使用。数字钟从原理上讲是一种典型的数字电路,其中包括了组合逻辑电路和时序电路。此次设计数字钟就是为了了解数字钟的原理,从而学会制作数字钟。而且通过数字钟的制作进一步的了解各种在制作中用到的中小规模集成电路的作用及实用方法。且由于数字钟包括组合逻辑电路和时叙电路。通过它可以进一步学习与掌握各种组合逻辑电路与时序电路的原理与使用方法。二、数字电子钟方案框图 图 1 数字电子钟方案框图 三、单元电路设计和元器件的选择 1.6 进制计数器电路的设计 现要设计一个6进制的计数器,采用一片中规模集成电路74LS90N芯片,先接成十进制,再转换成 6 进制,利用“反馈清零”的方法即可实现
3、6 进制计数,如图 2 所示。图 2 2.10 进制电路设计 图 3 3.60 进数器电路的设计“秒”计数器与“分”计数器都是六十进制,它由一级十进制计数器和一级六进制计数器连接而成,如图 4 所示,采用两片中规模集成电路 74LS90N 串接起来构成“秒”“分”计数器。图 4 4.时间计数器电路的设计 时计数电路由 U1 和 U2 组成的 24 进制电路,如图 5 所示。图 5 5.校正电路的设计。校正时间的方法是:首先截断正常的计数通路,然后再进行人工出触发计数或将频率较高的方波信号加到需要校正的计数单元的输入端,校正好后,再转入正常计时状态即可。根据要求,数字钟应具有分校正和时校正功能,
4、因此,应截断分个位和时个位的直接计数通路,并采用正常计时信号与校正信号可以随时切换的电路接入其中。图 6 所示为所设计的校时电路。如图 6 所示,当开关打向下时,因为校正信号和 0 相与的输出为 0,而开关的另一端接高电平,正常输入信号可以顺利通过与或门,故校时电路处于正常计时状态;当开关打向上时,情况正好与上述相反,这时校时电路处于校时状态。与非门可选 74LS01N,非门则可用与非门 2 个输入端并接来代替节省芯片。因此实际使用时,须对开关的状态进行消除抖动处理,图 6 为加 2 个的电容。图 6 6时钟电路的设计 通常,数字钟的晶体振荡器输出频率较高,为了得到 1Hz 的秒信号输入,需要
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