等离子体对90nm工艺MOS器件的损伤.pdf
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1、第 2 8卷第 1期 2 0 0 7年 1月 半导体学报 CHI NES E J OURNAL OF S EMI CoNDUCToRS Vo1 28 No 1 Ja n,2 00 7 等离子体对 9 0 n m 工艺 MOS器件的损伤*唐 瑜t 郝 跃 孟志琴 马晓华 (西安电子科 技大学 宽禁带半导体材料 与器件教育部重点实验室,西安7 1 0 0 7 1)摘要:研究 了等离子体工 艺对 9 0 n m铜大马士革工艺器件 的损 伤 对 n MOS F E T和 p MOS F E T分别进行 了 HC I 和 NB TI 应力实验,实验结果证 明天线 比仍是反应 等离子体损伤重要 的标准且通
2、孔 天线结 构器件 的损伤最 大,并 从通 孔刻蚀工艺过程 中解 释其原因 关键 词:等离子体损 伤;天线结构;通孔;铜大马士革工艺 EEACC:2 55 0 F;2 5 60 中图分类号:T N 4 3 2 文献标识码:A 文章编号:0 2 5 3 4 1 7 7(2 0 0 7)0 1 0 0 9 2-0 4 1 引言 随着 VL S I 芯 片尺寸不 断减 小和速 度不 断提 高,功耗的问题也越来越严重,与此同时加工的复杂 性迅速增加,使得等离子工艺 已经成为现代大规模 I c制造工业不可缺少的部分,更细 的线条和更好 的 图形对加工工艺的严格要求,使高密度等离子技术 的应用越来越重要
3、但是,基于等离子技术的工艺容 易在加工过程中在导体层面上集聚电荷 实验 数据 表明,这种电荷的积累会影响薄栅氧化层的性能,使 栅氧的各种 电学参数如氧化层 中的固定电荷、界面 态密度、平带电压及栅漏电流等退化,严重时甚至会 造成器件 的失效,这被称为“天线效应”(也被 称为“等离子导致栅氧损伤”)1 另外对器件的可靠性也 产 生 重 大 影 响,如 n MOS F E T 热 载 流 子 可 靠 性(HC)2。和 p MOS F E T 负 偏 压 不 稳 定 性(NB TI)_ 4 本文 分别对 n MOS F E T 和 p MOS F E T施 加 HC I 和 NB TI 应力来研究充
4、 电损伤对 9 0 n m 工 艺可靠性 的影响 2实验 与讨论 实 验 样 品 采 用 9 0 n m 工 艺 下 栅 氧 厚 度 为 l _ 4 ri m、宽长 比为 l O m O 1 m 的 MoS器件,且采 用 7层金属布线 的大马士革 C u互连工艺 所有的 实验器件都经过 No退火,并采用 S T I 隔离 为了放 大等离子体 的充电损伤,通常在栅电极上引出大面 积 的导线区,加强等离子体工艺过程中的电荷收集,这种结构被形象地称为“天线”实验样 品采用 2种*国家 自然科学基金资助项 目(批准号:6 0 5 0 6 0 2 0)t通信作者 E ma i l:y t a n g 8
5、 2 y a h o o c o m c n 2 0 0 6 0 8-1 6收到,2 0 0 6-0 9-0 7定稿 天线 结 构,如图 1所 示 口口 I 口口 1 _ I l l I I m 图 1 天线 结构示 意图(a)金属 天线;(b)通孔天线 Fi g 1 S c h e ma t i c d i a g r a m o f a n t e n n a s t r u c t u r e (a)M e t a l s t r u c t u r e;(b)Vi a s t r u c t u r e 金属天线采用 M1和 M2(即天线加在第 1 和第 2层金属上)两种结构,通孑 L
6、 天线则采用 M1 Vi a 1 M2(天线加在第 1层层间介质上,以下简称 Vi a 1)结构 天线 比有 2 种,分别为 4 0 0和 4 0 0 0,金属天线 的周长分别为 4 2 0和 4 2 0 0 m 通 孑 L 天线上分 别有 1 6 0 0和 1 6 0 0 0个通 孔 实验 仪器采用 HP 4 1 5 6 B半 导体参数分析仪 2 1 天线 比对 器件 的影 响 选择 2种天线 比(AR:4 0 0 4 0 0 0)的金属天 线器件进行研究 对 n MOS F E T施加 HCI 应力,应 力条件为 V a=V :1 8 V,应力时间为 l O 0 0 s 图 2(a)显示不
7、 同天线 比的 n MOS F ET的跨导 曲线几乎不变,这是 由于灰化工艺后 的金属退火工 艺几乎完全“消除”了等离子体工艺 中产生 的陷阱,使氧化层中悬挂键 的数量大大减少,形成许多 S i 2 0 0 7中国电子学会 维普资讯 http:/ 第 1期 唐瑜 等:等离子体对 9 0 n m工艺 MO S器件的损伤 H键,使缺陷变为潜在 的,在测量 中不 会对器件 电 特性产生影 响 图 2(b)在施 加 l O 0 0 s的 HCI 应 力 后,天线 比越大的器件跨导越小,且相对于参考器件 具有大天线比的器件跨导退化较大 实验表明 HCI 应 力释 放 了样 品 中由于退 火工 艺 而转
8、为潜 在 的界面 态,使栅对沟道的控制能力减弱,从而使更大的天线 比的器 件具 有 更小 的漏 电流 图 2(a)HC I应力前 不 同天线 比 n MOS F ET跨导 与栅压 的 曲线;(b)HCI 应力后不同天线比 n MO S F E T跨导与栅压的曲 线 F i g 2 (a)g V c u r v e f o r d i f f e r e n t a n t e n n a r a t i o d e v i c e s b e f o r e HCI s t r e s s;(b)g V c u r v e f o r d i f f e r ent a nt e nna r
9、a t i o de vi c e s af t er H CI s t r e s s 图 3是饱和漏电流退化率与应力 时间的关系 图中显示更 大天线 比的器件漏 电流的退化 更为严 重 由于这些潜在 的陷阱,化学键变得更弱,并且影 响了周围的晶格结构,使周 围的化学键也受到影响,使晶格结构不再紧密,容易受到外加应力的影响 7 在施加了 HCI 应 力后,由于这些化学键更加脆弱,容易被高能 电子打破,陷阱重新被激活 在工艺 中,具有更大的天线 比的器件,栅氧化层电子陷阱和界 面态产生也就更多,在 HCI 应力过程 中电子陷入其 中,减小了氧化层 电场,从而影响了漏电流的变化,使得天线 比越大
10、的器件漏 电流退化越严重 也就是 说,较大的栅天线会收集更多的等离子体 电流,造成 更多的陷阱 从以上讨论可 以得 出,在 9 0 n m 工艺 中天线 比 仍是衡量等离子体损 伤的重要标准,所 以在 电路设 薯 图 3 对不 同天线 比 n MOS F E T施加 1 0 0 0 s HC I 应 力时的 J d 退化 Fi g 3 De gr a da t i on i n l d ve r s u s s t r es s t i me f or di f f er ent a nt e nna r a t i o n M 0SFETS i n HCI s t r e s s 计 中必须
11、考虑“天线效应”对 电路可靠性的影响 目 前在实际设计中,一般 阈值天线 比小于 4 0 0,可采用“跳线法”和“添加反偏二极管”来消除天线效应嘲 2 2 不 同天 线层 对器件 的 影响 选取 M1,M2和 Vi a l 天 线 的器 件进 行 研究,天 线 比均 为 4 0 0 0 同样 对 n MO S F E T施 加 1 0 0 0 s的 HC I 应力,应力条件为 V =V =1 8 V,应 力时间 为 1 0 0 0 s 另外对 p MOS F E T施加 NB T I 应力,应力 条件为 V =一1 8 V,其余 电极 接地,应力 时间为 5 0 0 0 s,实验 温度 为 1
12、 2 0 图 4是施加 1 0 0 0 s HC I应力之后不 同天线层 n MOS F E T最 大跨 导退 化 图 从 图 中看 出,退 化 最 大 O 1 8 O 1 6 O 1 4 O 1 2 旦 o 1 0 0 0 8 O O 6 0 0 4 O O 2 O Vi a l M 2 M l Ref An t e n na t y p e 图 4 HC I 应力后不 同天线层 n MO S F E T跨导退化 Fi g 4 Deg r a d at i on i n g f or di f f e r e nt a nt enn a t y p e nM 0SFETS a f t e r
13、 HCI s t r es s 的是Vi a l天 线 结 构 的 器 件,其 跨 导 退 化 了 0 1 7 mS,而参考器件跨导退化只有 0 0 1 mS 图 5是 不同天线层器件饱和漏电流退化率与应力时间关系 图,同样 说 明 Vi a l天 线器件 的退化 最 为严重 对 p MOS F E T施加 NB TI 应 力后,不 同器件 和饱 维普资讯 http:/ 半导体学报 第 2 8卷 3 图 5 不 同天线层 n MOS F E T漏电流退 化与应 力时间的关系 Fi g,5 De g r a da t i on i n J d 蛆 I ve r s u s s t r e s s
14、 t i me f o r di f f e r e nt a nt e nna t yp e nM OSFETs i n HCI s t r es s 和漏 电流,曲 退 化 分 别 如 图 6,7所 示 所 有 具 有 天 线 的器件的退化都 比参考器件大,这是 因为等离子 图 6 不 同天线层 p MOS F E T在 NB T I 应力下 tb 退化 Fi g,6 De gr a da t i on i n Vlb v er s u s s t r e s s t i me f o r d i f f e r e nt a nt e nna t yp e pM OSFETs i n N
15、BTI s t r e s s 图 7不同天线层 p MOS F E T饱和 漏 电流 随 NB T I应力 时间 的退化 Fi g 7 De gr a da t i on i n J d s a l ve r s u s s t r e s s t i me f or di f f e r e nt an t enna t y pe pM OSFETs i n NBTI s t r e s s 体工艺过程 中的充电损伤使得具有天线的器件产生 更多的界面态,退火使得缺陷变为潜在的,形成很多 S i H键,在界 面处氢的浓度大大增加 施 加 N B T I 应力后充电损伤的器件退化也就更大 图中
16、还显示 Vi a l 天线器件退化最大,所以说明 Vi a l 器件充电损 伤更为严重 这说明在 C u l o w k大马士革工艺 中通孑 L 天线 较金属天线对器件的损伤更为严重,而在 Al 布线工 艺中等离子体损伤主要发生在金属刻蚀工艺中 铜布线大马士革工艺主要包括以下几个工艺步 骤:(1)在前层的互连层平面上淀积一层薄的刻蚀 停止层和厚 的互连介质(绝缘)层材 料(b l a c k d i a mo n d),如 图 8(a)所示;一 一 一 (f)图 8 C u l o w k大马士革工艺 流程示意 图(a)淀积刻蚀停止层和 l o w-k介质;(b)刻蚀通孔;(c)刻蚀 引线沟槽
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