半导体器件原理.pptx

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1、2023/2/221SemiconductorDevices简介简介双极型器件是电子和空穴两种载流子都参与导电的半导体器件 从P-N结理论的讨论中已知电流输运是由电子和空穴两种载流子组成的，故由P-N结组成的晶体管又称作双极晶体管。双极晶体管是最重要的半导体器件之一。1947年由贝尔实验室的一个研究小组发明。第1页/共138页2023/2/222SemiconductorDevicesThe”Planar Process”developed by Fairchild in the late 50s shaped the basic structure of the BJT,even up to

2、 the present day.双极型晶体管第2页/共138页2023/2/223SemiconductorDevices3.1 3.1 晶体管的基本原理晶体管的基本原理1、基本结构及其杂质分布基本结构 由两个P-N结共用一个基区组成的。在两个结中，一个叫发射结，一个叫集电结。中间区域就叫基区，而另两个区与结相对应的被称作发射区和集电区。器件具有三个电极端子，分别称作发射极，基极和集电极。第3页/共138页2023/2/224SemiconductorDevices双极型晶体管n+pnp+np第4页/共138页2023/2/225SemiconductorDevices晶体管工艺与杂质分布(

3、a)合金管杂质分布的特点：三个区内杂质均匀分布，发射结、集电结为突变结.(b)双扩散管杂质分布特点：基区为缓变杂质分布，发射区杂质分布也缓变。第5页/共138页2023/2/226SemiconductorDevices分类晶体管内部，载流子在基区的传输过程是决定晶体管的增益、频率特性等性能参数的重要指标。在基区宽度确定后，基区杂质分布是影响基区输运过程的关键因素，一般可以分为两大类：(a)均匀基区晶体管，传输机构以扩散为主，如合金管和全离子注入管。传输以扩散为主。(b)缓变基区晶体管。如各种扩散管。由于基区中存在自建电场，以漂移为主，第6页/共138页2023/2/227Semiconduc

4、torDevicesNPN晶体管共基极(a)、共发射极（b）和共集电极（c）的三种连接法(a)(b)(c)第7页/共138页2023/2/228SemiconductorDevices2、晶体管的放大原理、晶体管的放大原理以均匀基区P-N-P晶体管为例分析其基本物理图象：内部载流子的运动。电压增益：功率增益：第8页/共138页2023/2/229SemiconductorDevicesP-N-P均匀基区晶体管的物理结构、杂质分布、电场分布和平衡态能带图第9页/共138页2023/2/2210SemiconductorDevicesP-N-P均匀基区晶体管正常偏置条件下的物理结构、杂质分布、电场

5、分布和能带图第10页/共138页2023/2/2211SemiconductorDevices3、晶体管端电流的组成、晶体管端电流的组成工作在放大状态下pnp晶体管的各个电流分量为：IEP：从发射区注入的空穴电流，IEN：从基区注入到发射区的电子电流，ICN：集电区基区结附近的热电子漂移到基区形成的电流，ICP：集电区基区结的空穴注入电流。IBRIEPICP，基区内电子与空穴电流的复合而必须补充的电子电流。第11页/共138页2023/2/2212SemiconductorDevicesPNP晶体管电流组成IE=IEp+IEnIC=ICp+ICnIB=IE-IC=IEn+(IEp-ICp)-I

6、Cn第12页/共138页2023/2/2213SemiconductorDevicesemitter current injected into the base base current injected into the emitter recombination in the base current region reverse biased current across the BCJ reverse biased current across the BCJ electron current from the emitterNPN晶体管电流组成第13页/共138页2023/2/22

7、14SemiconductorDevices4、晶体管的电流增益晶体管的电流增益直流共基极电流放大系数（或电流增益）的定义为 其中，发射效率：基区传输因子 即第14页/共138页2023/2/2215SemiconductorDevices集电极电流表达式：下标CB:表示C和B结的端电流O:表示对应的第三端与第二端之间为开态第15页/共138页2023/2/2216SemiconductorDevices共发射极晶体管的电流放大系数（电流增益）为 电路应用中，晶体管的共射级组态最常用，即发射极作为公共端，基极和集电极为输入和输出端。第16页/共138页2023/2/2217Semiconduc

8、torDevices共射级晶体管放大IBICIE第17页/共138页2023/2/2218SemiconductorDevices5 5、提高电流增益的一般原则提高电流增益的一般原则 晶体管的电流传输作用是晶体管具有放大能力的基础，晶体管具有放大作用需要满足下列条件，内部：发射结与集电结要相距很近，即WBpn0时 即阴影部分面积第30页/共138页2023/2/2231SemiconductorDevices理想晶体管的电流一电压方程理想晶体管的电流一电压方程均匀基区P-N-P晶体管电流一电压方程：第31页/共138页2023/2/2232SemiconductorDevices第32页/共1

9、38页2023/2/2233SemiconductorDevices由基区内总的少子存贮电荷 可得集电极电流的另一表达式：第33页/共138页2023/2/2234SemiconductorDevices讨论讨论晶体管三个极的电流和基区内的少子分布有关，理想晶体管的基本关系式为：外加电压通过eqV/kT控制边界上的载流子浓度；发射极和集电极电流由边界处的少子浓度梯度给出，这两个电流和基区存贮电荷成正比；P-N-P晶体管的发射效率 基区传输因子 第34页/共138页2023/2/2235SemiconductorDevices2、晶体管的工作状态 晶体管的工作状态取决于发射结、集电结上所加的电压

10、极性。放大状态：VEB正偏，VCB反偏；饱和状态：VEB正偏，VCB正偏；截止状态：VEB反偏，VCB反偏；反转状态：VEB反偏，VCB正偏；饱和状态时，晶体管处于小偏置电压、大输出电流情况，即导通状态。截止状态时，基区内无存贮电荷，集电极电流接近0，即关断状态。反转状态时，电流增益小于放大状态，因为集电极掺杂浓度比基极浓度要低，因此发射效率也较低。第35页/共138页2023/2/2236SemiconductorDevices工作模式：VCBSaturationForward activeCutoffInverted activeVEBPNPNPNSaturationForward act

11、iveCutoffInverted activeVBCVBE放大反转饱和截止正偏反偏正偏反偏正偏反偏反偏正偏E-BC-B状态第36页/共138页2023/2/2237SemiconductorDevices3、静态特性的修正（1）缓变基区晶体管热平衡下，中性基区内将存在一个自建电场来抵消由于基区杂质浓度梯度分布而引起的扩散电流。在放大偏置状态下，所注入的少子不仅有扩散运动，还有由基区内建电场引起的漂移运动。内建电场的主要作用是减少注入少子渡越基区所需的时间，从而改善晶体管的高频特性。还可以减小少子在基区的复合，从而改善基区的传输因子。第37页/共138页2023/2/2238Semicondu

12、ctorDevices基区内建电场的表达式基区内建电场的表达式基区中自建电场对电流的贡献，平衡时，基区内多子电流为零。即第38页/共138页2023/2/2239SemiconductorDevices双扩散管中，基区杂质分布一般满足高斯分布或余误差分布，都可以近似为指数分布。即：其中，是由基区两边的杂质浓度比值决定的一个常数，称其为场因子。基区内建电场的表达式为：式中负号表示自建电场方向与x方向相反。第39页/共138页2023/2/2240SemiconductorDevices基区中少子分布与电场因子有密切关系，=0相当于均匀基区，越大，基区电场越强。基区中大部分区域的少子浓度梯度较小，

13、只有在近集电结处少子浓度梯度才增大。第40页/共138页2023/2/2241SemiconductorDevices推导缓变基区的少子分布和各区少子电流时有两种方法：（1）求解包括漂移分量在内的少子连续性方程，得到少子分布和少子电流分布从而导出缓变基区晶体管的I-V方程，这种方法精确，但过程繁杂。（2）忽略少子在基区输运过程中的复合损失，认为基区少子电流近似为常数（WB0时，对给定的基极电流IB，集电极电流IC不依赖于VEC。但实际上，IC随VEC的增加而增加。这种集电极电流不饱和现象可以用厄尔利效应来解释。当VEC增加时，基区宽度W减小，导致0增加，故IC增大。第52页/共138页2023

14、/2/2253SemiconductorDevicesEarly effect:impact of VBC on WB注意:VBC 越负，第53页/共138页2023/2/2254SemiconductorDevices利用共发射极输出特性曲线的切线来确定VA:第54页/共138页2023/2/2255SemiconductorDevices（4）Kirk效应（基区展宽效应）在大电流密度工作下的晶体管基区将会发生扩展，这一现象是柯克于1962年首先提出来的，所以也被称为柯克效应。由于现代大功率晶体管都是用扩散工艺制造，所以下面的讨论都是针对缓变基区晶体管的。在放大工作状态下，理想晶体管假定边界

15、处的少子浓度为0，但实际上存在少子浓度。空穴浓度在中性基区内被多子电子中和，但在耗尽区内将改变正负电荷层的浓度。若维持集电结偏压不变，则负电荷层减小，正电荷层宽度增加，整个耗尽区向衬底移动，中性基区趋于加宽。一定条件下，中性基区宽度超过扩散时形成的原始基区宽度，这种现象称为基区展宽效应（Kirk效应）第55页/共138页2023/2/2256SemiconductorDevices（5）产生复合电流和大注入效应（a）基区电导调制效应 以PNP晶体管为例：由基区电中性要求，基区中多子与少子分布相同，即满足：dnB(x)/dx=dpB(x)/dx和 nB(0)=nB0+pB(0）基区多子（电子）浓

16、度可以用下式表示：考虑到基区大注入的少子对多子分布带来的影响后，基区电导率为第56页/共138页2023/2/2257SemiconductorDevices若只考虑基区靠近发射结附近的电导率可近似为：对应电阻率为：随着注入的加大，pB(0)不断加大，基区电导率 B相应地不断上升，电阻率不断下降。这一现象被称为基区电导调制效应。式中的pB(0)/NB称为注入比。第57页/共138页2023/2/2258SemiconductorDevices（b）产生复合电流实际晶体管在反向偏压下，集电区基区内耗尽层存在产生电流，而发射区基区正偏，耗尽层内有复合电流。如果产生电流在ICBO中起支配作用，对突变

17、的集电结，ICBO随 增加，对线性缓变的集电结，ICBO随 增加，同时 也增加。在小电流下，复合电流占支配作用，m2。IC是由注入基区的空穴扩散到集电区形成的空穴电流，不受发射区基区的复合电流影响。第58页/共138页2023/2/2259SemiconductorDevices（c）大注入自建电场大注入时，由于电子（多子）浓度梯度的存在，必定会向集电结方向扩散，集电结上加的是反向偏压，它阻止电子流向集电区，因此在集电结的基区侧有电子积累，由于扩散运动，在发射结的基区侧电子浓度将降低，从而在基区中产生由发射结指向集电结的电场B，这一自建电场称为大注入自建电场。它同时改变了基区少子分布。基区电子

18、和空穴的电流方程应为：第59页/共138页2023/2/2260SemiconductorDevices式中等号右边第一项为大注入引起的自建电场形成的漂移电流，第二项为浓度梯度引起的扩散电流。自建电场阻止多子（电子）的扩散，即InB=0式中，EB为基区本身掺杂分布形成的内建电场第60页/共138页2023/2/2261SemiconductorDevices（6）饱和电流和击穿电压（a）饱和电流当发射极开路时，集电极一基极结的反向电流定义为ICBO。当基极开路时，集电极-发射极结的反向电流定义为ICEO。通常，ICBO ICEO，ICBO 发射结短路时的电流IC。第61页/共138页2023/

19、2/2262SemiconductorDevices（b）击穿电压放大状态下，当VBC（共基极接法）或VEC（共射极接法）超过击穿电压临界值时，晶体管的集电极电流IC急剧增加，称为雪崩击穿。原因是集电结耗尽区内的电场太强而产生大量电子空穴（雪崩倍增）。共基极接法：定义发射极开路时集电极一基极击穿电压为BVCBO，对集电区掺杂远低于基区时：式中，EC是临界击穿电场，NC是集电区的掺杂浓度第62页/共138页2023/2/2263SemiconductorDevices共射极接法：定义基极开路时集电极一发射极的击穿电压为BVCEO，当外加电压较高以至集电结发生雪崩倍增效应，利用PN雪崩倍增因子的经

20、验公式：可得：对于Si，n26，且0较大，因此BVCEOBVCBO第63页/共138页2023/2/2264SemiconductorDevices（c）基区穿通 随着集电结反向电压的增加，集电结势垒区向两边扩展，基区有效宽度WBeff减小。如果晶体管的基区掺杂浓度比集电压低，基区宽度WB又较小，则有可能在集电结发生雪崩击穿之前，WBeff减小到零，即发射区到集电区之间只有空间电荷区而无中性的基区，这种现象称为基区穿通。发生基区穿通时的集电极电压称穿通电压VPT，在VPT下，集电极电流将迅速上升。显然，基区较薄的合金结晶体管容易出现基区穿通效应，或者发生在集电区掺杂浓度高于基区的晶体管中。第6

21、4页/共138页2023/2/2265SemiconductorDevices假设基区、集电区均匀掺杂，根据势垒宽度的公式，有 对于给定的基区宽度WB，只有当NB较大时才能防止基区穿通，使器件的电压只受集电结耗尽区的雪崩倍增作用限制。（NCNB时，容易发生基区穿通）第65页/共138页2023/2/2266SemiconductorDevices4 4、输入和输出特性曲线、输入和输出特性曲线晶体管应用在电路中可以有三种连接方式。这三种连接方式中应用最广的是共发射极连接，因为它具有大的电流增益和功率增益，电流增益定义为：而共基极连接具有更高些的截止频率。共集电极连接运用很少。故在此主要讨论共基极

22、和共发射两种连接。第66页/共138页2023/2/2267SemiconductorDevicesNPN晶体管(a)共基极、（b）共发射极和（c）共集电极三种连接法(a)(b)(c)第67页/共138页2023/2/2268SemiconductorDevicesNPNNPN晶体管共基极输入输出特性晶体管共基极输入输出特性输入特性：IE随VBE指数上升，与正向P-N结特性一致，随着VCB增加，IE随VBE而上升得更快，这是由于基区宽度WB随VCB增加而减小，从而导致IE增大。输出特性：IE=0时IC=ICBO，即集电结反向饱和电流。IC按IE的规律随IE而增加，若IE一定，IC基本上不随VC

23、B变化，在VCB下降到0以后IC才逐步下降到0，这是由于只有当集电结处于正偏状态后，才能阻止由发射区注入基区的空穴流向集电区。此时，晶体管进入饱和区。第68页/共138页2023/2/2269SemiconductorDevicesNPN晶体管共基极接法输出特性曲线第69页/共138页2023/2/2270SemiconductorDevicesNPNNPN晶体管共发射极输入输出特性晶体管共发射极输入输出特性输入特性：与正向P-N结特性一致，随着VCE增加，IB减小。这是由于增加VCE会使WB减小，基区中的复合电流减小，从而使IB减小；至于VBE=0时，IB不为0，这是由于此时VCB0，集电结

24、有ICBO流过，使IB=ICBO。输出特性：当IB=0时，流过晶体管的电流为ICEO，随着IB增加，IC以IB的规律上升；且随着VCE增加IC略上升，这是由于Early效应（WB减小而使增大）的结果；当VCE减小到一定值（对硅管来说，该值约为）而使集电结转为正偏后，IC迅速下降，此时，晶体管进入饱和区。第70页/共138页2023/2/2271SemiconductorDevicesNPN晶体管共发射极接法输出特性曲线第71页/共138页2023/2/2272SemiconductorDevices晶体管输出特性分为三个区域：I为线性工作区，为饱和区，为截止区。I区工作的晶体管，发射结处于正偏

25、，集电结处于反偏；区工作的晶体管，发射结和集电结均处于正偏；区工作的晶体管，发射结和集电结都为反偏。第72页/共138页2023/2/2273SemiconductorDevices3.3 3.3 晶体管模型晶体管模型 晶体管内部物理过程非常复杂，而在电路应用中，只需要关心器件的端特性。如果用一些基本的元件构造一个端网络，与晶体管的端网络相同，称为晶体管的等效电路或模型。因此在不同的应用场合可以有不同的模型。从构造途径划分可以分为两类：(1)由器件物理分析给出，称为物理模型，其物理意义明确，反映了器件内部的物理过程；(2)从应用角度出发，将器件视为“黑匣子”，不管其内部发生的过程，仅根据器件的

26、端特性来构造模型，称为电路模型，这类模型的参数也可以与晶体管的内部参数联系起来。第73页/共138页2023/2/2274SemiconductorDevices多年来，在SPICE之类的电路模拟器中，概括双极型晶体管的电学特性模型主要有EM模型(J.J.Ebers-J.L.Moll)和GP模型（Gummel-Poon）。其中EM模型使器件的电学特性和器件的工艺参数相联系。而GP模型则是建立在器件电学特性和基区多子电荷相联系的基础之上的。第74页/共138页2023/2/2275SemiconductorDevices1 1物理模型物理模型为了模拟双极晶体管的特性，可以使用各种模拟工具对电子、

27、空穴分布、电场、电流等进行物理计算。一维模型在许多情况下有效，但是电流集边效应、边缘泄漏特性、发射极周边电容等，从本质上讲要用两维或三维模型来分析。对于硅基器件，通常用基于扩散漂移输运机制的计算公式就足够了，但在计算一些与尺寸有关的特性时这些公式不再精确。对于族HBTHBT，上述输运机制的模拟精度会进一步受到影响。使用蒙特卡罗模拟是比较精确的，但是需要大量的计算。因而引入了流体动力学或能量平衡模拟，模拟的精度较差但计算较简单。第75页/共138页2023/2/2276SemiconductorDevices埃伯斯莫尔模型（EMEM模型）是19541954年由和首先提出的，属于晶体管的物理模型，

28、其模型参数能较好反映物理本质且易于测量。基本思想是晶体管可以认为是基于正向的二极管和基于反向的二极管的叠加。IF0为正偏时二极管的饱和电流IR0为反偏时二极管的饱和电流第76页/共138页2023/2/2277SemiconductorDevices基本EM模型的等效电路第77页/共138页2023/2/2278SemiconductorDevices基本的EM模型表达式第78页/共138页2023/2/2279SemiconductorDevices由此得到基本的EM模型：由上面两式可得，式中IEBO和ICBO分别为集电极开路时发射极饱和电流和发射极开路时的集电极饱和电流。第79页/共138

29、页2023/2/2280SemiconductorDevicesEbers-Moll Model为了改善模型的精确度，在基本模型基础上加串联电阻和耗尽层电容的改进模型。第80页/共138页2023/2/2281SemiconductorDevices还可以考虑在内部发射极和集电极两端之间加上额外的电流源来包括厄而利效应。还可以在基极引线上加上二极管以解释沿基极发射极结的两维电流拥挤效应。总结：器件模型越精确，所需模型参数就越多，器件模型就越复杂。第81页/共138页2023/2/2282SemiconductorDevices2 2电路级的模型电路级的模型GummelPoon模型(GP模型)的

30、主要特点是把晶体管的电学特性（结电压、集电极电流等）和基区多子电荷联系在一起。其中QB0为热平衡时基区的多子电荷总量。QjE代表发射结正偏时其耗尽区宽度变化而使基区多子电荷增加的数量，QjC代表集电结正偏时其耗尽区宽度变化而使基区多子电荷增加的数量，QdEQdC代表基区中存储电荷的数量。具体的计算见课本半导体器件物理基础P83。第82页/共138页2023/2/2283SemiconductorDevicesGummel-Poon Model()第83页/共138页2023/2/2284SemiconductorDevicesGummelGummelPoonPoon模型的不足之处模型的不足之处

31、 不能很好描述电流集边效应。电流集边效应对硅双极晶体管是重要的问题，而对大多数HBT而言，因为HBT的基区掺杂通常较大，则可忽略。为了部分的考虑这些效应，SPICE模型提供一个表达式来描述基区电阻随正向电流的变化。不能很好描述电荷贮存效应和集电区在饱和时的电阻，特别是对于承受中等偏压、具有较厚和轻掺杂集电区的晶体管。当晶体管工作在VBC较低的情形下，集电区没有耗尽，串联电阻显著增大。然而，如果VBC正偏且足够大时，注入到集电区的空穴使电阻减小。用电荷控制模型描述晶体管的瞬态行为，只能是一种近似。特别是，瞬态电荷的分布与由电荷控制模型得到的稳态分布是不同的，至少非静态电荷分布会导致输出电流相对于

32、输入偏压在时间上有所延迟。通常将时间延迟因子纳入到集电极电流源中，以用来校正已经包括在电荷控制模型中被称作延迟相位的延迟量。第84页/共138页2023/2/2285SemiconductorDevices为了精确描述晶体管的基区电阻和集电结电容，需要使用分布电阻电容网络。为简化起见，GummelPoon模型只考虑了单一的基极电阻，器件的大部分电容必须通过该电阻进行充电，而在更精确的模型中，基区被分成几部分，分别定义了不同的串联电阻和相关的电容。双极晶体管中的电流密度可能会很大，这样电流流过器件时会产生很可观的热量，由于晶体管的各种特性强烈依赖于温度的变化，自加热效应将对测量的特性产生影响。这

33、对于族器件尤为重要，因这种器件基区的电阻率高从而要求的发射区宽度也大。而且族材料的导热率比硅低。为了计及自加热效应，可以考虑附加一个与晶体管有关的热电路。考虑串联电阻等影响后，模型可以十分精确，但所需参数多达25个。为了对特定电路进行分析，必须在精确度和模型复杂性之间进行折衷考虑。第85页/共138页2023/2/2286SemiconductorDevices3.4 3.4 频率特性频率特性晶体管在实际应用中大都是用来放大交流讯号，特别是随着现代电子技术的发展，越来越多地被用于高频、超高频和微波领域，但当信号频率升高时，晶体管的放大特性要发生变化，如电流增益减小，相移增加等，这些变化的主要原

34、因是势垒区电容及扩散电容的充放电。1频率参数2晶体管的小信号等效电路3.频率功率限制第86页/共138页2023/2/2287SemiconductorDevices（1 1）频率参数）频率参数在低频工作时，电流增益不随频率变化。但工作在高频时，电流增益明显下降，且随着频率的增高,电流增益一直降下去，直到器件失去放大能力。为了描述增益随频率变化的限制，引入下列电流增益的频率特征参数。共基极截止频率f：定义为当电流增益随频率升高而下降到低频增益的1/倍时所对应的频率，即下降到1/0时频率。共发射极截止频率f：定义为下降到1/0时的频率。特征频率fT：定义为下降到1时（0db）的频率。第87页/共

35、138页2023/2/2288SemiconductorDevices值得注意的是，f f以后，随频率升高而下降是有规律的：频率升高一倍，增益就下降一倍，即下降6db，其频率与增益的乘积保持为常数不变。fT就是增益一带宽乘积，fT也是描述晶体管能起电流放大作用的最高极限频率。晶体管频率响应的最重要限制是少子通过基区的渡越时间。第88页/共138页2023/2/2289SemiconductorDevices基区渡越时间 当基区少数载流子pB(x)以速度v(x)穿越基区，产生基区传输电流IpB(x)=AqpB(x)v(x)时，v(x)为基区少子的有效速度，以PNP管为例，则空穴穿越基区的时间为

36、在基区宽度WBLpB，近似认为基区传输电流为常数即IpB(x)IpE=-AJpE时，基区少子分布用均匀基区和线性近似代入可得第89页/共138页2023/2/2290SemiconductorDevices（2 2）晶体管的小信号等效电路）晶体管的小信号等效电路晶体管是非线性器件，但对于小信号条件下的工作状态可以看作线性器件。因此，常用四端网络的等效电路来研究晶体管电学特性。随着运用频率的提高，晶体管的各种电容效应开始起支配作用，故必须考虑势垒电容CTe、CTc和发射结的扩散电容Cde的影响，也要考虑基极电阻rb的作用，因为该电阻和电容组成的RC时间常数将会影响晶体管的高频性能。在高频时，由于

37、rC1/CTc，故rc可以忽略。第90页/共138页2023/2/2291SemiconductorDevices跨导gm：输入电导：输出电导：第91页/共138页2023/2/2292SemiconductorDevices较高频时第92页/共138页2023/2/2293SemiconductorDevices高频时第93页/共138页2023/2/2294SemiconductorDevices高频时，考虑基区宽度调制效应时存在有限的输出电导第94页/共138页2023/2/2295SemiconductorDevices（3 3）频率功率限制）频率功率限制高频功率增益：定义高频优值U为

38、功率增益与频率平方的乘积：标志晶体管的放大能力，也称增益一带宽积。最高振荡频率：式中，rb为基极电阻，CTC为集电极总输出电容。第95页/共138页2023/2/2296SemiconductorDevices提高晶体管特征频率提高晶体管特征频率f fT T的途径的途径 在一般的高频晶体管中，减小B是提高fT的主要因素：降低晶体管的基区宽度WB，提高基区电场因子。减小发射结面积以减小CTe。减小集电结的势垒宽度xjC，即降低集电区电阻率，但它又与提高击穿电压有矛盾。为此，必须根据不同要求作适当选择。减小集电极串联电阻rcs及集电结势垒电容CTc。为此一是降低集电区电阻率和减小集电区厚度，以减小

39、rcs（但这也与提高击穿电压的要求矛盾）；二是缩小结面积以降低CTc。综合之，提高fT的主要途径是：减小基区宽度WB，减小结面积（发射结及集电结），适当降低集电区电阻率和厚度。第96页/共138页2023/2/2297SemiconductorDevices3.5 3.5 功率特性功率特性1最大集电极电流IC为使晶体管电路的输出功率大，要求晶体管能输出较大的电流，但大电流工作的晶体管电流放大系数和截止频率都要下降，从而限制了输出功率。因此，在讨论晶体管的功率特性时，我们先讨论晶体管的最大集电极电流。基区电导调制效应及有效基区扩展效应(Kirk效应）均会使晶体管特性变差，因此必须定义各自的最大电

40、流限制。最大集电极电流密度取决于上述两种效应中最小的最大发射极电流。第97页/共138页2023/2/2298SemiconductorDevices2功率晶体管的安全工作区(SOA)晶体管的最大耗散功率 晶体管的输出功率，除受到电学参数限制外，还受到热学参数的限制，这是由于电流的热效应使晶体管消耗一定的功率，引起管芯发热，此热量通过半导体、管壳等途径散到管外，称为晶体管的耗散功率。晶体管的最大耗散功率与热阻有如下关系：式中TjM为最高结温；TA为环境温度；RT是稳态热阻，与功率晶体管的结构、材料和各材料的厚度、面积和热导率等有关；第98页/共138页2023/2/2299Semiconduc

41、torDevices晶体管结温有一定限制，温度过高将会引起P-N结的热击穿。通常规定：锗晶体管的最高结温定为85125，硅晶体管则定为150200。第99页/共138页2023/2/22100SemiconductorDevices晶体管的二次击穿 实践表明，当晶体管工作在最大耗散功率范围内时，仍有可能发生击穿而被烧毁。一般认为，这是由于晶体管的二次击穿所引起的。当集电结反向偏压VCE逐渐增大到某一数值时，集电极电流IC急剧增加，这就是通常的雪崩击穿，称为一次击穿；继续增加集电结电压，使IC增大到某一临界值此VCE突然降低，而电流则继续增大，出现负阻效应，此称二次击穿。二次击穿的过程极短，通常

42、为微秒量级，一旦发生二次击穿，如果没有保护措施，则晶体管很快就烧毁。第100页/共138页2023/2/22101SemiconductorDevices安全工作区(SOA)是晶体管能安全工作的范围,它受四个参数限制:（1）集电极最大电流ICM。如果晶体管在脉冲状态工作，那么该电流可比直流时的ICM大3倍；（2）集电极最大耗散功率PCM。在直流工作时它取决于稳态热阻RT，在脉冲工作时，则取决于瞬态热阻RTS。通常ICVCE-1；（3）二次击穿临界功耗PSB曲线由实验决定，电流与电压有如下关系：IV-n；n在4之间；（4）最大电压VCEM。在线性放大区，VCEM=VSUS。第101页/共138页

43、2023/2/22102SemiconductorDevices3.6 3.6 开关特性开关特性在叙述晶体管的三个工作区中已经注意到，如果晶体管工作在截止区，其输出阻抗很大，相当于电路“断开”；若晶体管工作在饱和区，则它的输出阻抗很小，相当于电路“接通”。这样使用的晶体管在电路中起着开关作用。晶体管由截止区转换到饱和区，或由饱和区转换到截止区，可以通过加在其输入端的外界信号来实现，因此，转换速度极快。近代电子计算机中所用的开关电路，就是根据晶体管的这一特性来设计的，其开关速度达每秒几十万次到几百万次，甚至更高。第102页/共138页2023/2/22103SemiconductorDevice

44、s第103页/共138页2023/2/22104SemiconductorDevices（1 1）关断和导通阻抗）关断和导通阻抗为了表征开关作用，考虑三个基本参量。关断阻抗，导通阻抗和开关时间。关断阻抗：导通阻抗：由上面两式可知，结的反向饱和电流IEBO、ICBO小时，关断阻抗很高。导通阻抗近似反比于IC，当IC很大时，导通阻抗很小。通常，基区和集电区的欧姆电阻包含在总阻抗内，尤其对于导通阻抗。第104页/共138页2023/2/22105SemiconductorDevices（2 2）开关时间）开关时间开关时间的定义：晶体管从关态转变为开态的时间称为开启时间ton，由开态转变为关态的时间称

45、为关断时间toff。由于在开关过程中集电极电流是交替变化的，电流开始上升或开始下降的时刻很难准确确定，工程上一般以最大值ICS的或倍进行测量，定义开关时间。延迟时间：从基极回路输入正脉冲信号起（t=0）到晶体管集电极电流升至为止，称为延迟时间td。上升时间：集电极电流由升至为止，称为上升时间tr。存贮时间：基极信号变负开始到集电极电流下降到CS，称为存贮时间ts。下降时间：集电极电流从CS下降到CS所需的时间为下降时间tf。tontd+tr；tofftstf；tton+toff第105页/共138页2023/2/22106SemiconductorDevices利用电荷控制模型分析开关时间利用

46、电荷控制模型分析开关时间基区内存贮的总过剩少子电荷为（PNP管）：由连续性方程给出存贮电荷随时间的变化由此，可得电荷控制的基本方程：瞬态基极电流的作用第106页/共138页2023/2/22107SemiconductorDevices延迟时间：存贮时间：式中，若t3p，则第107页/共138页2023/2/22108SemiconductorDevices分析分析导通时间取决于如何迅速把空穴（PNP管的基区少子）或电子（NPN管的基区少子）注入到基区。关断时间取决于如何通过复合使空穴迅速消失。开关晶体管的重要参数之一是少子寿命。对高速开关管，降低少子寿命的有效方法是在禁带中心附近引入有效产生

47、复合中心如掺金工艺。第108页/共138页2023/2/22109SemiconductorDevices（3 3）开关过程）开关过程截止状态延迟过程上升过程超量存贮即饱和状态超量储存电荷消失过程即存贮时间下降过程截止状态第109页/共138页2023/2/22110SemiconductorDevices提高开关速度的措施提高开关速度的措施提高晶体管的开关速度，必须从改善器件性能及电路工作条件着手，这里我们仅讨论提高开关速度对器件性能的要求。(1)提高晶体管的频率特性，要求：(a)减小结面积，使 CTe及CTc减小;(b)减小基区宽度WB，一般说fT主要决定于WB，减小WB可大大提高fT。(

48、2)在工艺上增加掺金工序，其原因是：(a)降低集电区少子寿命，可减少集电区中超量储存少子的数量，在储存时间内又可加速超量储存少子的消失，从而使ts减小；对NPN效果更好。(b)析出凝聚在位错、层错处的重金属铜、铁等，以改善反向特性。(c)掺金后的缺点：一是使反向漏电流增加，还减小了电流放大增益；二是使集电区电阻率增加，这是因为金起一定的施主或受主作用。(3)减小集电区外延尽厚度WC，以减小超量储存的电荷。第110页/共138页2023/2/22111SemiconductorDevices双极晶体管优点双极晶体管优点电子沿垂直方向流过器件。器件尺寸可精确控制，容易制造出电子渡越时间短、截止频率

49、高的器件；导通电流流经整个发射区，单位芯片面积上的电流密度可以很大，实现大电流输出；集电极电流的载流子密度直接由输入电压控制，跨导可以很高；开启电压由pn结内建电场决定，而不依赖于器件尺寸和工艺的变化；输入电容一般用工作电流衡量，大小主要由扩散电容决定，因此适应驱动负载能力强；在高压大电流电路中，由于电子和空穴的双注入，有可能获得轻掺杂集电区电阻的电导调制，使串联电阻小。第111页/共138页2023/2/22112SemiconductorDevices在DC工作下需要一定的输入基极电流；工作在饱和区时，基极电流增加，过剩电荷存贮，使开关速度变缓，难以用于逻辑电路；在电路中，阈值电压不能作为

50、设计参数。目前只能制造具有正阈值电压的晶体管；目前通过先进的工艺技术能使器件的尺寸和寄生效应变的更小，异质结的使用在晶体管的设计中增加一个新的自由度，使器件更快。在BiCMOS技术中双极与FET相结合可获得超高输入阻抗并可实现在逻辑电路中的信号开关旁路晶体管。双极晶体管缺点双极晶体管缺点第112页/共138页2023/2/22113SemiconductorDevices晶体管设计 主要设计指标 在通讯广播等设备上应用的N-P-N高频功率晶体管，甲类工作状态。其基本参数指标为：fT=1000MHz,输出功率P0=5W,功率增益Gp=5db,Vcc=28V,=40%第113页/共138页2023