计算机组成原理第二章第8讲定点乘法运算.ppt
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1、定点乘法运算2.3 定点乘法运算2.3.1 2.3.1 定点原定点原码码乘法乘法2.3.2 2.3.2 定点定点补码补码乘法乘法定点定点浮点浮点加加定点加减法器定点加减法器浮点加减法浮点加减法减减乘乘原码并行乘法原码并行乘法直接补码乘法直接补码乘法浮点乘除法浮点乘除法除除原码除法原码除法并行除法器并行除法器2.3.1 定点原码乘法原码乘法在定点计算机中,两个原码数相乘的运算规则:l l乘积的符号位由两数的符号位按异或运算得到乘积的符号位由两数的符号位按异或运算得到,而乘积的数值部分则是两个正数相乘之积。而乘积的数值部分则是两个正数相乘之积。设设n位被乘数和乘数用定点整数表示位被乘数和乘数用定点
2、整数表示(定点小数也同样适用定点小数也同样适用):被乘数被乘数 原原f n110乘数乘数 原原f n110则乘积则乘积 原原(ff)(n110)(n110)式中式中,f为被乘数符号为被乘数符号,f为乘数符号。为乘数符号。关键问题关键问题:怎样解决两个无符号整数的乘法运算:怎样解决两个无符号整数的乘法运算2.3.1 定点原码乘法1、定点原码乘法原理尾数乘法举例如下:设设1101,1101,10111011 1 1 0 1 1 1 0 1 ()1 0 1 11 0 1 1()1 11 10 01 1 1 11 10 01 1 0 00 00 00 0 1 11 10 01 1 1 10 00 00
3、 01 11 11 11 1()1、定点原码乘法原理n位乘n位积可能为2n位.乘积的最后是所有位积之和,有n个数相加,而加法器只有两个输入端l l所以需要改造所以需要改造l l方法一:硬件实现方法方法一:硬件实现方法(串行的串行的“移位和加法移位和加法”),),硬件结构简单硬件结构简单,速度太慢速度太慢(时间延迟太长,时间延迟太长,不采用不采用).).l l方法二:不带符号位的方法二:不带符号位的阵列乘法器阵列乘法器1、定点原码乘法原理A=a4a3a2a1a0 A=a4a3a2a1a0 阵列分析:阵列分析:B=b4b3b2b1b0B=b4b3b2b1b0 a4b0 a3b0 a2b0 a1b0
4、 a0b0 a4b0 a3b0 a2b0 a1b0 a0b0 a4b1 a3b1 a2b1 a1b1 a0b1 a4b1 a3b1 a2b1 a1b1 a0b1 a4b2 a3b2 a2b2 a1b2 a0b2 a4b2 a3b2 a2b2 a1b2 a0b2 a4b3 a3b3 a2b3 a1b3 a0b3 a4b3 a3b3 a2b3 a1b3 a0b3a4b4 a3b4 a2b4 a1b4 a0b4a4b4 a3b4 a2b4 a1b4 a0b4用公式描述乘法过程:用公式描述乘法过程:设有两个无符号二进制整数:设有两个无符号二进制整数:A Aa amm1 1aa1 1a a0 0B Bb
5、 bn n1 1bb1 1b b0 0它们的真值分别为它们的真值分别为a a和和b b,即即mm1 1n n1 1 a a a ai i2 2i ib b b bj j2 2j ji i0 0j j0 0 在二进制乘法中在二进制乘法中,被乘数被乘数A A与乘数与乘数B B相乘相乘,产生产生mmn n位位乘积乘积P P:P Pp pmmn n1 1pp1 1p p0 0乘积乘积P P 的数值为:的数值为:1、定点原码乘法原理实现这个乘法过程所需要的操作:其中的aibj实际为ai与bj的逻辑与不带符号位的阵列乘法器解决问题的核心:怎样将乘法阵列中的每个逻辑与累加 用构思精巧、绘图细密、像个刺绣作品
6、的阵列乘法器实现乘法阵列器工作构思图:a4b0 a3b0 a2b0 a1b0 a0b0 a4b0 a3b0 a2b0 a1b0 a0b0 a4b1 a3b1 a2b1 a1b1 a0b1 a4b1 a3b1 a2b1 a1b1 a0b1 a4b2 a3b2 a2b2 a1b2 a0b2 a4b2 a3b2 a2b2 a1b2 a0b2 a4b3 a3b3 a2b3 a1b3 a0b3 a4b3 a3b3 a2b3 a1b3 a0b3a4b4 a3b4 a2b4 a1b4 a0b4a4b4 a3b4 a2b4 a1b4 a0b4FAFAFAFAFAFAFAFAFAFAFAFAFAFAFAFAFA
7、结构FA被加数或和被加数或和进位进位加数加数和和进位进位不带符号位的阵列乘法器先勘误:l l教材图教材图2.52.5最下边一行最下边一行FAFA右侧的水平箭头应删右侧的水平箭头应删掉(除了掉(除了0 0输入)输入)l l即,改为和上页即,改为和上页pptppt图一致。图一致。阵列乘法器分析:m位被乘数,n位乘数的阵列乘法器可由(m1)n个全加器构成。为提高并行处理能力和速度,减少进位延迟时间,每行相加产生的进位移到下一行前一位的全加器处理。虚线部分是一个行波进位加法器,将最后一次进位加入分别累加。最难的就是耗时分析:阵列乘法器分析:耗时分析(5位乘以5位原码):l l对于对于FAFA得到得到S
8、 S耗时耗时6T6T,得到,得到C C耗时耗时5T5Tl l向下运算耗时向下运算耗时6T 46T 4l l最后一行行波进位耗时最后一行行波进位耗时 2T 4+3T2T 4+3T 3T3T指的是每个指的是每个FAFA运算中第一个异或门的共同耗时,运算中第一个异或门的共同耗时,过程中不需要溢出判断过程中不需要溢出判断l l不要忘了:乘法阵列是由不要忘了:乘法阵列是由与门组与门组生成生成所以tm=T +(n-1)6T +(n-1)2T+3TFA逻辑电路和框图1位补码运算的加法减法器位补码运算的加法减法器1位补码运算的加法减法器位补码运算的加法减法器FA不带符号位的阵列乘法器阵列乘法器耗时计算的特别说
9、明:l l1.1.该耗时公式为时间估算,有一定程度的细节该耗时公式为时间估算,有一定程度的细节忽略成分忽略成分l l2.2.即使不做溢出判断,加法器最后一个结果出即使不做溢出判断,加法器最后一个结果出来还得再多加一个来还得再多加一个T Tl l3.3.如果将加法器第一个全加器输入端连接更合如果将加法器第一个全加器输入端连接更合理(低位进位和理(低位进位和0 0连接连接AiAi、BiBi端)又可省出一个端)又可省出一个T T的时间的时间l l4.4.具体细节自行推敲讨论具体细节自行推敲讨论 a4b0 a3b0 a2b0 a1b0 a0b0 a4b0 a3b0 a2b0 a1b0 a0b0 a4b
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