基于-DSP实时语音处理设计.pdf

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1、-基于 TMS320VC5402 的音频信号采集与处理系统。介绍了该系统的总体方案和硬软件设计。讨论了模/数(A/D)和数/模(D/A)转换电路的设计方法以及如何利用 TMS320VC5402 的多通道缓冲同步串口(McBSP)和 PCM1800 及PCM1744 芯片接口来实现音频信号的采集和输出。通过改变输入输出压缩比例自动控制增益的幅度，扩大了接收机的承受围，它能够在输入信号幅度变化很大的情况下，使输出信号保持恒定或仅在较小围变化，不至于因为输入信号太小而无常工作，也不至于因为输入因为输入信号太大而使接收机发生饱和或阻塞。实验证明：所设计的基于 DSP 的硬件和软件系统是一个很好的音频信

2、号采集与处理系统。绪言 近年来，随着 DSP 技术的普及和低价格、高性能 DSP 芯片的出现，DSP已越来越多地被广阔的工程师所承受，并越来越广泛地被应用于各个领域，例如：语音处理、图像处理、模式识别及工业控制等，并且已日益显示出其巨大的优越性。DSP 是利用专门或通用的数字信号处理芯片，以数字计算的方法对信号进展处理，具有处理速度快、灵活、准确、抗干扰能力强、体积小及可靠性高等优点，满足了对信号快速、准确、实时处理及控制的要求。对实时数字信号处理的应用需求和超大规模集成电路技术水平的飞速开展，推动着 DSP 性能不断提高。DSP 是一种专用的数字信号处理器。随着超大规模集成电路技术上取得的突

3、破进展，高度集成化的 DSP 数字信号处理器具有体积小、功耗低和运算速度快等诸多优点，因此非常适用于语音信号的压缩处理。基于 DSP 的实时语音处理系统，它具有可选择的信号采样速率和高性能的数字信号处理能力，不仅可以用来对立体音频信号进展实时编解码处理，还可以用来作为高速的实时信号采集与处-理板使用。它包括多路语音实时采集，压缩处理，存储功能等根本功能。根据设计要求中的要点，所要设计的基于 DSP 的实时语音处理系统功能是，它能同时输入至少两路音频信号，而且能够对两路输入信号进展实时采集并将模拟信号数字化，然后对信号进展数字信号处理，并能够根据要求存储不少于 10小时的录音，最后输出音频信号。

4、则在设计系统过程中，为满足要求要有信号采集，模/数及数/模转换，数字信号处理局部，包括数据压缩等，电源电路，复位电路，时钟电路。信号特征分析 音频信号经过高精度高速的ADC 转换后得到一串数字信号，分帧输入到波形输入缓冲区 RAM。然后由手动控制一种或几种处理算法将音频信号调入TMS320C5402 的部进展高速运算。经过处理的音频信号，再输入到高精度高速的DAC转换器中，复原成模拟的声音信号，经音箱功率放大电路放大输出。一、本设计的任务 1.输入信号为 2 路语音信号，要求系统能对 2 路输入信号进展实时采集、数字化处理、压缩、存储录音，要保证一定的录音质量，录音时间不少于 10 小时。2.

5、根据参数对输入信号特征进展分析、需求分析，选择确定DSP芯片型号、语音采集芯片型号，完成系统硬件设计。二、本设计的实现方案 1、系统构造框图:-音频系统应该具有较宽的动态围，选择 1624 位的 ADC 和 DAC 能完全捕获或恢复高保真的音频信号。系统的核心芯片(DSP)选用美国 TI 公司的TMS320VC54021(以下简称C5402)。2、DSP芯片模块是整个实时语音处理系统的核心局部，它对经数字化的信号进展压缩，编解码等。A/D转换模块功能是把模拟信号数字化，包括采集和量化，这局部为DSP处理语音数字信号做好了准备；D/A转换模块就是把数字信号转换为模拟的信号，输出音频信号。SDRA

6、M 动态随机存储器存储器模块主要是为 DSP 处理器扩展存储容量，到达要求的存储容量；但要注意的是要与 DSP 处理器的速度相匹配，以高精度高速 音频信号 ADC 波形输入 缓冲区 RAM TMS320 VC5402 波形输出 缓冲区 RAM 高精度高速 音频信号 DAC 音频处理程序 存 储 区EPROM语音信号 存储器 SDRAM 电源 复位电路-便良好的运行。电源模块是为部芯片及周边系统电路提供能量的局部。复位电路模块 3、DSP 处理器：作为 DSP 家族高性价比代表的 16 位定点 DSP 芯片，C5402 适用于语音通信等实时嵌入应用场合。与其它C54*芯片一样，C5402 具有高

7、度灵活的可操作性和高速的处理能力。其性能特点如下：操作速率可达 100MIPS；具有先进的多总线构造，三条 16 位数据存储器总线和一条程序存储器总线；40 位算术逻辑单元(ALU)，包括一个 40 位桶形移位器和两个 40 位累加器；一个 1717乘法器和一个 40 位专用加法器，允许 16 位带/不带符号的乘法；整合维特比加速器，用于提高维特比编译码的速度；单周期正规化及指数译码；8 个辅助存放器及一个软件栈，允许使用业界最先进的定点 DSP C 语言编译器；数据/程序寻址空间为 1M16bit，置 4K16bit ROM 和 16k16bit RAM；置可编程等待状态发生器、锁相环(PL

8、L)时钟产生器、两个多通道缓冲串口、一个与外部处理器通信的 8 位并行 HPI 口、两个 16 位定时器以及 6 通道 DMA 控制器且低功耗。与C54*系列的其它芯片相比，5402 具有高性能、低功耗和低价格等特点。它采用 6 级流水线，且当 RPT(重复指令)时，一些多周期的指令就变成了单周期的指令；芯片部RAM和ROM可根据PMST存放器中的OVLY和DROM位灵活设置。这些都有利于算法的优化。三、硬件设计 1、C5402 采用 3.3V 和 1.8V 电源供电，其中 I/O 采用 3.3V 电源供电，-芯片的核采用 1.8V 电源供电。而实际常用的只有 5V 电源，所以必须采用电源转换

9、芯片。选用 TPS7301 和 TPS7333 两块电源转换芯片(它们都是 TI 公司为配合 DSP 而设计的电源转换芯片)，分别接上适当的外围电阻，构成电阻分压器，即可调整两块芯片的输出电压分别为 3.3V 和 1.8V。A/D 电路 PCM1800是双声道单片型20位ADC，单+5V电源供电，信噪比为95dB，动态围为 95dB，其部嵌有高通滤波器，具有 PCM 音频接口和四种数据格式，分为主控和受控两种模式，采样频率可选为 32kHz、44.1KHz 和 48KHz。2、PCM1800 构成音频信号采集系统时，主要涉及到 BCK(位时钟信号)、LRCK(采样时钟信号)、FSYNC(帧同步

10、信号)、DOUT(数字信号输出)、SYSCLK(系统时钟输入)这几个对时序有要求的引脚。通过对引脚 MODE0 和MODE1 进展编程，可让 PCM1800 工作于主控模式(Master Mode)。此时，BCK、LRCK、FSYNC 均作为输出，其时序由 PCM1800 部的时钟产生电路控制。但 SYSCLK 只能由外部提供(这里用C5402 的 TOUT 脚输出信号提供)。PCM1800 的系统时钟只能是 256fs、384fs 或者 512fs，这里 fs 是音频信号采样频率。在主控模式时，FSYNC 用来指明 PCM1800 的 DOUT 输出的有效数据，它的上升沿说明一帧数据的起始，

11、下降沿说明一帧数据的完毕。FSYNC的频率是采样时钟频率LRCK 的 2 倍。在此模式下，位时钟信号 BCK 的频率是采样时钟频率 LRCK 的 64 倍。-3、通过对 PCM1800 的 FMT0、FMT1 两引脚编程(FMT01，FMT10)，可以设置 PCM1800 输出的数据格式为 20 位的 IIS 格式。为了保证在数据处理时不影响新数据的接收以及在接收数据时不中断正在进展的数据处理过程，采用了多通道缓冲同步串口(McBSP)。PCM1800 与C5402 连接后，C5402 使用缓冲串口 0 接收数据，各种同步信号由 PCM1800 产生，C5402 是被动接收各种信息。PCM18

12、00 与C5402 的硬件接线图如图 2 所示。PCM1800 与 C5402 的硬件接线图 4、电源管理功能模块 所用器件:TPS73HD301(3.3-V/Adjustable Output,)该芯片一端输入可调,围是1.2-9.7V D/A 电路 PCM1744 是双声道立体声 DAC，包含数字滤波器和输出放大器，动态围为95dB，具有多种采样频率可选，最高可达96kHz。采用 24 位的 IIS 数据输入格式。PCM1744 的操作主要涉及到 LRCIN(采样时钟信号输入)、BCKIN(位时钟信号输入)、SCKI(系统时钟输入)、DIN(数据输入)这几个对时序有要求的引脚。PCM174

13、4 与C5402 连接后，C5402 使用缓冲串口 1 发送数据，各种时钟信号均由C5402 产生，PCM1744 被动接收各种信息。PCM1744 的系统时钟信号(SCKI)由C5402 的 TOUT 引脚提供，TOUT 是C5402 的定时器输出信号引脚，有较强的驱动能力，可以驱动多个芯片。PCM1744 的数据接收时钟格式必须是 IIS 格式，C5402 在缓冲串口存放器中设置各种时钟方式时，必须满足 IIS格式的要求。C5402 作为主开工作器件，可以对其缓冲串口输出信号进展调整。-输出的采样时钟信号、位时钟信号可以在 McBSP 存放器 SRGR1 和 SRGR2 中设置，设置遵循图

14、 3 的原则。C5402 时钟发生流程图 根本的时钟信号可以来自 CPU 时钟，也可以来自晶振时钟，这在 SRGR2存放器中的第 13 位设置。根本时钟输入后，经 CLKGDV(SRGR1 的第 7 位到第 0 位)所设置的值进展第一次分频，得到位时钟信号(由 BCLK*1 脚输出)。值得注意的是，位时钟信号最高为 DSP 频率的一半。位时钟信号经 FPER(SRGR2的第 11 位到第 0 位)和 FWID(SRGR1 的第 15 位到第 8 位)所设置的值进一步分频得到采样时钟信号(由 BFS*1 脚输出)，FPER 和 FWID 分别设置采样时钟信号的低电平和高电平的时间值。C5402与

15、PCM1744的硬件接线如图4所示。PCM1744 与 C5402 接线图 PCM1800 完成音频信号采集后，在 DSP 的外扩程序存储器中嵌入相应的处理算法，语音信号经处理后，再从 PCM1744 输出。复位电路:所用芯片为 74HC14 存储器模块：所用芯片为 MT48LC8M8A2TG-75 存储容量 Density 为 64Mb 数据宽度 16 位 工作电压 3.3V TSOP 封装 54 管脚 时钟速率 133 MHz 四、软件设计-1、在本课程设计中的一些主要的程序 语音的采集滤波与放大 int dIn21=0,mOut21=0;/定义 dInmOut char dOut;cha

16、r hn21=0.05;int Read_BSP1(void);void Write_BSP1(int);void Led_Light(void);int AGC_audio(int);/Main program void main()init_board();while(1)int i,j;dOut=0;for(i=0;i21;i+)dIni=Read_BSP1();mOuti=AGC_audio(dIni);/将采集大信号放大 for(j=0;jma*ArrIn)/如果输入信号大于临时正峰值ma*ArrIn ma*ArrIn=AGC_in;/则更新临时峰值 if(-1*AGC_inma*A

17、rrIn)/早果输入信号大于临时负峰值ma*ArrIn ma*ArrIn=-1*AGC_in;/则更新临时峰值 if(dTime4096)/每隔 4096 个时钟修改一次长期峰值 ma*AGC_in=ma*ArrIn;/则更新长期峰值 ma*ArrIn=0;/并重新捕捉临时峰值 dTime=0;/重新开场计时 dTime+;if(AGC_in ma*AGC_in)/及时检测长期正峰值勤-ma*AGC_in=AGC_in;/及时更新长期正峰值 if(ma*AGC_in10)/如果输入信号大于 1 AGC_Coff=500.0/(ma*AGC_in+100);/按信号幅度成反比关系计算放大系数 i

18、f(-1*AGC_in)ma*AGC_in)/及时检测长期正峰值勤 ma*AGC_in=-1*AGC_in;/及时更新长期负峰值 if(ma*AGC_in10)/如果输入信号大于-1 AGC_Coff=500.0/(ma*AGC_in+100);/按信号幅度成反比关系计算放大系数 if(ma*AGC_in20000)/对放大后的信号进展限幅 AGC_out=20000;/如果信号幅度超过2000则用2000表示 if(AGC_out-20000)AGC_out=-20000;-return AGC_out;/返 回 放 大 后 的 信 号，即AGC_audio(dIn)=AGC_out 滤波器

19、放大设计 五、系统调试及结果分析(1)调试步骤：测试电源电压 测试 DSP 芯片的输出频率 对硬件系统进展系统仿真 对 DSP 外围硬件调试 模数接口的调试 (2)软件调试 DSP 系统的软件调试主要是在仿真器上进展。为了提高程序的效率，编写系统软件可采用三种不同的方法，即用汇编语言编写、C 语言编写以及 C 与汇编的混合语言编写。软件调试时，可以通过比拟 C 程序的模拟结果与汇编程序的结果来实现。通常，两种结果应完全一致。(3)系统调试 本系统的初始化主要有以下几项工作：中断矢量的重定位 工作时钟设置 等待状态数的设置-中断设置 其他设置 (4)结果分析 最后试听出来大致效果良好,能够将采集

20、到的语音进展适当的滤波以及放大处理.在本次课程设计中我们遇到了一系列问题:1.耳机和麦在试听初没有声音或杂音很大 解决方法:将耳机和麦插在电脑的插孔里,通过电脑测试耳机和麦是否正常 2.调整好程序后试听中耳机里面大杂音很大,啸叫声不断.解决方法:调整滤波器以及 AGC 放大程序数据的设置.3.试听过程中发现从远处传来大声音强,近处大声音要弱.原因:近处大声音过大,在采集声音信号的过程中失真了.六、设计总结及心得 本次课程设计，我了解了模/数(A/D)和数/模(D/A)转换电路的设计方法，掌握了利用TMS320VC5402的多通道缓冲同步串口(McBSP)和PCM1800及PCM1744 芯片接

21、口来实现音频信号的采集和输出的方法。通过改变输入输出压缩比例自动控制增益的幅度，扩大了接收机的承受围，使它能够在输入信号幅度变化很大的情况下，使输出信号保持恒定或仅在较小围变化。通过本次课程设计，加深了我对 DSP 的掌握和理解，稳固了我在DSP 技术原理及应用课程中所学的根本理论知识和实验技能，使我对该课程有了更深入的了解，进一步激发了我对所学专业学习的兴趣，提高了我的学习、独立思考及动手的能力。-课程设计不仅是对前面所学知识的一种检验，而且也是对自己能力的一种提高。通过这次做课程设计使我明白了自己的知识还很欠缺，要学习的东西还很多。我明白学习是一个长期积累的过程，以后的工作、生活中都应该不断的学习，努力提高自己知识和综合素质。