数字电子技术课程设计报告数字钟的设计与制作1263.pdf

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1、浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 0 数字电子技术课程设计报告 题 目：数字钟的设计与制作 学 年：03/04 学年学 期：第二学期 专 业：通信 班 级：通信 022 学 号：02022572 姓 名：张慧慧 指导教师及职称：钱裕禄 讲师 时 间：2004 年 6 月 28 日 2004 年 7 月 7 日 浙江万里学院电子信息学院 浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 1 数字电子技术课程设计报告 一、设计目的 数字钟是一种用数字电路技术实现时、分、秒计时的装置，与机械式时钟

2、相比具有更高的准确性和直观性，且无机械装置，具有更更长的使用寿命，因此得到了广泛的使用。数字钟从原理上讲是一种典型的数字电路，其中包括了组合逻辑电路和时序电路。因此，我们此次设计与制做数字钟就是为了了解数字钟的原理，从而学会制作数字钟.而且通过数字钟的制作进一步的了解各种在制作中用到的中小规模集成电路的作用及实用方法.且由于数字钟包括组合逻辑电路和时叙电路.通过它可以进一步学习与掌握各种组合逻辑电路与时序电路的原理与使用方法.二、设计要求 （1）设计指标 时间以 12 小时为一个周期；显示时、分、秒；具有校时功能，可以分别对时及分进行单独校时，使其校正到标准时间；计时过程具有报时功能，当时间到

3、达整点前 10 秒进行蜂鸣报时；为了保证计时的稳定及准确须由晶体振荡器提供表针时间基准信号。（2）设计要求 画出电路原理图（或仿真电路图）；元器件及参数选择；电路仿真与调试；PCB 文件生成与打印输出。（3）制作要求 自行装配和调试，并能发现问题和解决问题。（4）编写设计报告 写出设计与制作的全过程，附上有关资料和图纸，有心得体会。三、原理框图 1数字钟的构成 数字钟实际上是一个对标准频率（1HZ）进行计数的计数电路。由于计数的起始时间不可能与标准时间（如北京时间）一致，故需要在电路上加一个校时电路，同时标准的1HZ 时间信号必须做到准确稳定。通常使用石英晶体振荡器电路构成数字钟。浙江万里学院

4、电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 2 （a）数字钟组成框图 2 晶体振荡器电路 晶体振荡器电路给数字钟提供一个频率稳定准确的 32768z 的方波信号，可保证数字钟的走时准确及稳定。不管是指针式的电子钟还是数字显示的电子钟都使用了晶体振荡器电路。一般输出为方波的数字式晶体振荡器电路通常有两类，一类是用门电路构成；另一类是通过非门构成的电路，本次设计采用了后一种。如图（b）所示，由非门与晶体、电容和电阻构成晶体振荡器电路，实现整形功能，将振荡器输出的近似于正弦波的波形转换为较理想的方波。输出反馈电阻为非门提供偏置，使电路工作于放大区域，即非门的功能

5、近似于一个高增益的反相放大器。电容、与晶体构成一个谐振型网络，完成对振荡频率的控制功能，同时提供了一个度相移，从而和非门构成一个正反馈网络，实现了振荡器的功能。由于晶体具有较高的频率稳定性及准确性，从而保证了输出频率的稳定和准确。（b）CMOS 晶体振荡器（仿真电路）浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 3 3 时间记数电路 一般采用 10 进制计数器如 74HC290、74HC390 等来实现时间计数单元的计数功能。本次设计中选择 74HC390。由其内部逻辑框图可知，其为双 2-5-10 异步计数器，并每一计数器均有一个异步清零端（高

6、电平有效）。秒个位计数单元为进制计数器，无需进制转换，只需将与（下降沿有效）相连即可。（下降没效）与Z 秒输入信号相连，可作为向上的进位信号与十位计数单元的相连。秒十位计数单元为进制计数器，需要进制转换。将进制计数器转换为进制计数器的电路连接方法如图.所示，其中可作为向上的进位信号与分个位的计数单元的相连。十进制-六进制转换电路 分个位和分十位计数单元电路结构分别与秒个位和秒十位计数单元完全相同，只不过分个位计数单元的作为向上的进位信号应与分十位计数单元的相连，分十位计数单元的作为向上的进位信号应与时个位计数单元的相连。时个位计数单元电路结构仍与秒或个位计数单元相同，但是要求，整个时计数单元应

7、为进制计数器，不是的整数倍，因此需将个位和十位计数单元合并为一个整体才能进行进制转换。利用片实现进制计数功能的电路如图（d）所示。（d）十二进制电路 另外，图（d）所示电路中，尚余进制计数单元，正好可作为分频器Z输出信号转化为Z信号之用。4 译码驱动及显示单元电路 选择作为显示译码电路；选择数码管作为显示单元电路。由CD4511 把输进来的二进制信号翻译成十进制数字，再由数码管显示出来。这里的 LED 数码管是采用共阴的方法连接的。计数器实现了对时间的累计并以 8421BCD 码的形式输送到 CD4511 芯片，再由 4511浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧

8、02022572 第 页 4 芯片把 BCD 码转变为十进制数码送到数码管中显示出来。5 校时电路 数字钟应具有分校正和时校正功能，因此，应截断分个位和时个位的直接计数通路，并采用正常计时信号与校正信号可以随时切换的电路接入其中。即为用 COMS 与或非门实现的时或分校时电路，In1 端与低位的进位信号相连；In2 端与校正信号相连，校正信号可直接取自分频器产生的 1HZ或 2HZ（不可太高或太低）信号；输出端则与分或时个位计时输入端相连。当开关打向下时，因为校正信号和 0 相与的输出为 0，而开关的另一端接高电平，正常输入信号可以顺利通过与或门，故校时电路处于正常计时状态；当开关打向上时，情

9、况正好与上述相反，这时校时电路处于校时状态。实际使用时，因为电路开关存在抖动问题，所以一般会接一个 RS 触发器构成开关消抖动电路，所以整个较时电路就如图（f）。（f）带有消抖电路的校正电路 6 整点报时电路 电路应在整点前 10 秒钟内开始整点报时，即当时间在 59 分 50 秒到 59 分 59 秒期间时，报时电路报时控制信号。当时间在 59 分 50 秒到 59 分 59 秒期间时，分十位、分个位和秒十位均保持不变，分别为 5、9 和 5，因此可将分计数器十位的 Q和 Q、个位的 Q和 Q及秒计数器十位的Q和 Q相与，从而产生报时控制信号。报时电路可选 74HC30 来构成。74HC30

10、 为 8 输入与非门。浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 5 12345611128U174HC30DIO1IO2IO3IO4IO5IO6说明：当时间在59分50秒到59分59秒期间时 分十位、分个 位和秒十位均保持不变，分别为5，9和5；因此，可以将分计数器十位的Qc和QA，个位的QD和QA及秒计数器十位的QC和QA相与，从而产生报时控制信号。分计数器十位的Qc和QA分计数器个位的QD和QA秒计数器十位的QC和QA5VVCCX14V_0.5W5VVCC数字钟设计整点报时电路部分 四、元器件 1四连面包板 1 块（编号 A45）2镊子

11、1 把 3剪刀 1 把 4共阴八段数码管 6 个 5网络线 2 米/人 6CD4511 集成块 6 块 7CD4060 集成块 1 块 874HC390 集成块 3 块 974HC51 集成块 1 块 1074HC00 集成块 4 块 1174HC30 集成块 1 块 1210M 电阻 5 个 13500 电阻 14 个 1430p 电容 2 个 1532.768k 时钟晶体 1 个 16蜂鸣器 10 个（每班）1）芯片连接图 1)74HC00D 2)CD4511 浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 6 3)74HC390D 4)74H

12、C51D 2面包板的介绍 面包板一块总共由五部分组成，一竖四横，面包板本身就是一种免焊电板。面包板的样式是：浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 7 面包板的注意事项：1 面包板旁一般附有香蕉插座，用来输入电压、信号及接地。2 上图中连着的黑线表示插孔是相通的。3 拉线时，尽量将线紧贴面包板，把线成直角，避免交叉，也不要跨越元件。4 面包板使用久后，有时插孔间连接铜线会发生脱落现象，此时要将此排插孔做记号。并不再使用。五、各功能块电路图 数字钟从原理上讲是一种典型的数字电路，可以由许多中小规模集成电路组成，所以可以分成许多独立的电路。（一

13、）六进制电路 由 74HC390、7400、数码管与 4511 组成，电路如图一。U1A74 HC0 0D123U2A74 HC0 0D123U3A74 HC3 90D1QA31QB51QC61QD71INA11INB41CLR2U4DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT345 11BDU5SEVEN_ SEG_COM_ KA B C D E F GCom5VVCCV1 32Hz 5V将 十 进 制 计 数 器 转 换 为六 进 制 的 连 接 方 法（二）十进制电路 由 74HC390、7400、数码管与 4511 组成，电路如图二。浙

14、江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 8 U1A74 HC3 90D1QA31QB51QC61QD71INA11INB41CLR2U2DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT345 11BDV1 60Hz 5V5VVCCU3SEVEN_ SEG_COM_KA B C DE F GComU4A74 HC0 0D123U4B74 HC0 0D456十进制接法测试仿真电路（三）六十进制电路 由两个数码管、两 4511、一个 74HC390 与一个 7400 芯片组成，电路如图三。（四）双六十进

15、制电路 由 2 个六十进制连接而成，把分个位的输入信号与秒十位的 Qc 相连，使其产生进位，电路图如图四。浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 9 U1A74HC00D123U1B74HC00D456U3A74HC390D1QA31QB51QC61QD71INA11INB41CLR2U3B74HC390D2QA132QB112QC102QD92INA152INB122CLR14U2DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU5DA7DB1DC2DD6OA13OD10OE9O

16、F15OC11OB12OG14EL5BI4LT34511BD5VVCCV1 100kHz 5VU4SEVEN_SEG_COM_ KA B C D E F GComU1C74HC00D9108U1D74HC00D121311U6SEVEN_SEG_COM_ KA B C D E F GComU7SEVEN_SEG_COM_ KA B C D E F GComU8A74HC390D1QA31QB51QC61QD71INA11INB41CLR2U9DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU10A74HC00D123U11B74HC0

17、0D4565VVCCU12B74HC390D2QA132QB112QC102QD92INA152INB122CLR14U13DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU14SEVEN_SEG_COM_ KA B C D E F GComU15C74HC00D9108U16D74HC00D1213115VVCC（五）时间计数电路 由 1 个十二进制电路、2 个六十进制电路组成，因上面已有一个双六十电路，只要把它与十二进制电路相连即可，详细电路见图五。U1SEVEN_SEG_COM_KABCDEFGComU2SEVEN_SEG_CO

18、M_KABCDEFGComU3SEVEN_SEG_COM_KABCDEFGComU4SEVEN_SEG_COM_KABCDEFGComU5SEVEN_SEG_COM_KABCDEFGComU6SEVEN_SEG_COM_KABCDEFGComU7DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU8DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU9DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU10DA7DB1DC

19、2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU11DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU12DA7DB1DC2DD6OA13OD10OE9OF15OC11OB12OG14EL5BI4LT34511BDU13A74HC390D1QA31QB51QC61QD71INA11INB41CLR2U14A74HC390D1QA31QB51QC61QD71INA11INB41CLR2U15A74HC390D1QA31QB51QC61QD71INA11INB41CLR2U16B74HC390

20、N2QA132QB112QC102QD92INA152INB122CLR14U17B74HC390N2QA132QB112QC102QD92INA152INB122CLR14U18B74HC390N2QA132QB112QC102QD92INA152INB122CLR14V1 1000Hz 5V5VVCCU19A74HC00D123U20B74HC00D4565VVCCU20C74HC00D9108U20D74HC00D1213115VVCCU21A74HC00D123U22B74HC00D456U23C74HC00D9108U24D74HC00D1213115VVCC5VVCC5VVCCU2

21、5A74HC00D123U26B74HC00D456时，分，秒计时电路图（六）校正电路 由 74CH51D、74HC00D 与电阻组成，校正电路有分校正和时校正两部分，电路如图六。浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 10 U174 HC5 1D8611213910112345U2A74 HC0 0D123U2B74 HC0 0D456U2C74 HC0 0D9108U2D74 HC0 0D121311U3A74 HC0 0D123U3B74 HC0 0D4565VVCCR310 MohmR410 MohmR210 MohmR110 Mo

22、hmJ1Key =AJ2Key =BIO1IO2IO3IO4IO5IO6时计数器分计数器正常输入信号校正信号正常输入信号校正信号小时校正电路分钟校正电路分校正时锁定小时信号输入注意：分校时时，不会进位到小时。数字钟设计校时电路部分图中采用基本RS触发器构成开关消抖动电路，其中与非门选用74HC0 0；对J1和J2，因为校正信号与0相与为0，而开关的另一端接高电平，正常输入信号可以顺利通过与或门，故校时电路处于正常计时状态，当开关打向上时，情况正好与上述相反，这时电路处于校时状态。（七）晶体振荡电路 由晶体与 2 个 30pF 电容、1 个 4060、一个 10 兆的电阻组成，芯片 3 脚输出

23、2Hz 的方波信号，电路如图七。（八）整点报时电路 由 74HC30D 和蜂鸣器组成，当时间在 59:50 到 59:59 时，蜂鸣报时，电路如图八。浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 11 12345611128U174HC30DIO1IO2IO3IO4IO5IO6说明：当时间在59分50秒到59分59秒期间时 分十位、分个 位和秒十位均保持不变，分别为5，9和5；因此，可以将分计数器十位的Qc和QA，个位的QD和QA及秒计数器十位的QC和QA相与，从而产生报时控制信号。分计数器十位的Qc和QA分计数器个位的QD和QA秒计数器十位的Q

24、C和QA5VVCCX14V_0.5W5VVCC数字钟设计整点报时电路部分 六、总接线元件布局简图 整个数字钟由时间计数电路、晶体振荡电路、校正电路、整点报时电路组成。其中以校正电路代替时间计数电路中的时、分、秒之间的进位，当校时电路处于正常输入信号时，时间计数电路正常计时，但当分校正时，其不会产生向时进位，而分与时的校位是分开的，而校正电路也是一个独立的电路。电路的信号输入由晶振电路产生，并输入各电路。简图如图九。七、芯片连接总图 因仿真与实际元件上的差异，所以在原有的简图的基础上，又按实际布局画了这张按实际芯片布局的接线图，如图十。八、总结 1 实验过程中遇到的问题及解决方法 面包板测试 测

25、试面包板各触点是否接通。七段显示器与七段译码器的测量 浙江万里学院电子学院数字电子技术课程设计报告 通信 022 张慧慧 02022572 第 页 12 把显示器与 CD4511 相连，第一次接时，数码管完全没有显示数字，检查后发现是数码管未接地而造成的，接地后发现还是无法正确显示数字，用万用表检测后，发现是因芯片引脚有些接触不良而造成的，所以确认芯片是否接触良好是非常重要的一件事。时间计数电路的连接与测试 六进制、十进制都没有什么大的问题，只是芯片引脚的老问题，只要重新插过芯片就可以解决了。但在六十进制时，按图接线后发现，显示器上的数字总是 100进制的，而不是六十进制，检测后发现无论是线路

26、的连通还是芯片的接触都没有问题。最后，在重对连线时发现是线路接错引脚造成的，改过之后，显示就正常了。校正电路 因上面程因引脚接错而造成错误，所以校正电路是完全按照仿真图所连的，在测试时，开始进行时校时时，没有出现问题，但当进行到分校时时，发现计数电路的秒电路开始乱跳出错。因此，电路一定是有地方出错了，在反复对照后，发现是因为在接入校正电路时忘了把秒十位和分个位之间的连线拿掉而造成的，因此，在接线时一定要注意把不要的多余的线拿掉。2 设计体会 通过这次对数字钟的设计与制作，让我了解了设计电路的程序，也让我了解了关于数字钟的原理与设计理念，要设计一个电路总要先用仿真仿真成功之后才实际接线的。但是最后的成品却不一定与仿真时完全一样，因为，再实际接线中有着各种各样的条件制约着。而且，在仿真中无法成功的电路接法，在实际中因为芯片本身的特性而能够成功。所以，在设计时应考虑两者的差异，从中找出最适合的设计方法。通过这次学习，让我对各种电路都有了大概的了解，所以说，坐而言不如立而行，对于这些电路还是应该自己动手实际操作才会有深刻理解。3 对设计的建议 我希望老师在我们动手制作之前应先告诉我们一些关于所做电路的资料、原理，以及如何检测电路的方法，还有关于检测芯片的方法。这样会有助于我们进一步的进入状况，完成设计