EDA原理图输入设计方法定稿.pptx

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1、1、内附逻辑函数：MAX+PLUS II包含常用的逻辑函数，这些逻辑函数被称为图元(Primitive)和符号(Symbol),也称元件。共有4个子目录中装载着不用种类的逻辑函数文件。在设计原理图时候，到相应的子目录中查找相应的元件即可。prim子目录中存放的是数电中的一些基本元件库，如AND、OR、INPUT OUTPUT等元件。mf子目录中存放的是一些中规模的器件库，如74系列的逻辑器件等。由可编程与阵列和固定或阵列组成，熔丝编程方式，双极性工艺，广泛推广。Mega_lpm子目录中存储的是较大并且可做参数设计的元件。Edif子目录中存放的是一些符合EDIF(电子设计交互)格式的元件。第1页

2、/共14页2、逻辑规则引脚名称：输入输出引脚的的名称。命名规则是不超32个的字母数字和“/”，“_”，“”等，不区分大小写，同一个设计文件中不能重复。节点名称：各元件之间传递信号的线。命名和引脚相同。总线名称：2-256个节点的组合，要在名称后面加m.n表示节点的编号。文件名称：扩展名为.gdf 文件名小于32个字符。项目名称：项目名称与最高层次的原理图名称一致。第2页/共14页3、原理图编辑工具就是设计原理图时候，经常使用的一些工具按钮。如选择工具文字工具画正交线工具画直线工具画弧线工具画圆工具放大工具缩小工具与窗口适配工具连接点接/点断工具打开橡皮筋连接功能关闭橡皮筋连接功能第3页/共14

3、页4、原理图编辑流程建立文件夹 每个项目最好建立一个文件夹：注意不能是中文目录进入原理图设计系统:菜单FILE-NEW，选择图像编译文件。输入元件:先确定放置位置，然后菜单Symbol-Library 选择元件元件的编辑：移动,旋转,删除,复制，通过鼠标拖拽，右键菜单连线：鼠标选择一个端口，按住左键移动到另一个端口。命名:给各个引线端子命名，也可以给节点命名。总线：总线是一组相关的连线，就是给这组线命名。保存文件：文件另存到最初建立的文件夹中。将当前设计项目设置为工程文件。使用菜单File-Project-Set Project to current File创建元件：当元件检查无误后，可以使

4、用菜单 File-Creat Default Symbol,在当前目录中生成一个元件，以后设计时候可以 直接作为元件来调用。第4页/共14页5、设计项目的处理MAX+PLUS II的编译器是一个高速的自动化的设计处理器，能完成对设计项目的编译。能够将设计文件转换成器件编程、仿真、定时分析所需要的输出文件，是本软件系统的核心。项目编译 启动编译器编译过程选择器件全局项目综合方式启用设计规则检查工具引线端子适配打开平面图编辑器选择视图选择方式显示最后一次编译所生成的平面图编辑引线端子第5页/共14页6、设计项目的校验MAX+PLUS II的设计项目的校验包括项目的仿真(Simulate)和定时分析

5、(Timing Analysis)两部分。仿真：创建仿真波形文件选择欲仿真的引线端子编译输入节点的仿真波形仿真分析仿真结果定时分析：启动定时分析工具传播延时分析时序逻辑电路性能分析建立/保持时间分析第6页/共14页7、器件编程编程是指将编程数据放到具体的可编程器件中去。一般是将成功编译和仿真后的一个项目编程到一个具体的可编程器件中进行测试。MAX+PLUS II的编程器(Programmer)完成对器件的编程工作。编程下载方式有ByteBlaster并行下载和ByteBlaster(MV)并行下载和ByteBlaster串行下载等。下面是ByteBlaster(MV)并行下载的下载例子。项目编

6、译：安装ByteBlaster电缆打开编程器选择编程硬件用JTAG或FLEX链在系统编程 第7页/共14页第三章 原理图输入设计方法一、原理图设计方法二、1位全加器设计三、数字电子钟设计四、利用LPM兆功能模块的电路设计五、波形输入设计第8页/共14页二、1位全加器设计通过对1位全加器的设计来掌握原理图输入方法，及层次化设计的方法。1、建立文件夹 2、输入设计项目和存盘:选择prim文件夹加载各个元件,连线,编辑保存3、将设计项目设置成工程文件:将当前项目设置为工程文件4、选择目标器件并编译：选择一个具体的芯片，并编译5、时序仿真：建立波形测试文件，出入测试的节点，编辑波形并仿真6、引脚锁定：

7、选择并锁定各个引脚，并重新编译7、编程下载：连接计算机、下载电缆和目标板，选择下载方式，下载8、设计顶层文件：根据底层图纸设计顶层的图纸，重新仿真下载。第9页/共14页二、1位全加器设计首先设计一个半加器。逻辑方程：co=abso=ab真值表a b so co0 0 0 01 0 1 00 1 1 01 1 0 1因为so端因为使用了同或门，因此在一输入端或输出加了一个非门第10页/共14页二、1位全加器设计全加器-以半加器为元件设计的层次电路逻辑方程：cout=ab+ac+bcsum=ainbinCin真值表ain bin cin sum cout0 0 0 0 00 0 1 1 00 1 0 1 00 1 1 0 11 0 0 1 01 0 1 0 11 1 0 0 11 1 1 1 1 因为so端因为使用了同或门，因此在一输入端或输出加一个非门第11页/共14页第三章 原理图输入设计方法EDA工具仍然保留着原理图输入的设计方式，可以利用原有的电路知识快速完成设计，支持层次电路设计方式。一、原理图设计方法二、1位全加器设计三、数字电子钟设计-略四、利用LPM兆功能模块的电路设计-略五、波形输入设计-略第12页/共14页本章结束共15页第13页/共14页感谢您的欣赏！第14页/共14页