EDA第2章FPGACPLD结构原理uvj.pptx
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1、EDA技术实用教程技术实用教程第第2 2章章 FPGA/CPLD结构原理结构原理 2.1 概概 述述 2.1 概概 述述 2.1.1 PLD的发展历程的发展历程 2.1.2 PLD分类分类 2.2 简单简单PLD结构原理结构原理 2.2.1 逻辑元件符号表示逻辑元件符号表示 2.2 简单简单PLD结构原理结构原理 2.2.1 逻辑元件符号表示逻辑元件符号表示 2.2 简单简单PLD结构原理结构原理 2.2.2 PROM结构原理结构原理 2.2 简单简单PLD结构原理结构原理 2.2.2 PROM结构原理结构原理 2.2 简单简单PLD结构原理结构原理 2.2.2 PROM结构原理结构原理 2.
2、2 简单简单PLD结构原理结构原理 2.2.2 PROM结构原理结构原理 2.2 简单简单PLD结构原理结构原理 2.2.3 PLA结构原理结构原理 2.2 简单简单PLD结构原理结构原理 2.2.3 PLA结构原理结构原理 2.2 简单简单PLD结构原理结构原理 2.2.4 PAL结构原理结构原理 2.2 简单简单PLD结构原理结构原理 2.2.4 PAL结构原理结构原理 2.2.5 GAL结构原理结构原理 2.2 简单简单PLD结构原理结构原理 2.2.5 GAL结构原理结构原理(1)寄存器模式)寄存器模式 2.2 简单简单PLD结构原理结构原理(2)复合模式)复合模式 1、组合输出双向口
3、结构、组合输出双向口结构 2.2 简单简单PLD结构原理结构原理(2)复合模式)复合模式 2、组合输出结构、组合输出结构 2.2 简单简单PLD结构原理结构原理(3)简单模式)简单模式 1、反馈输入结构、反馈输入结构 2.2 简单简单PLD结构原理结构原理(3)简单模式)简单模式 2、输出反馈结构、输出反馈结构 2.2 简单简单PLD结构原理结构原理(3)简单模式)简单模式 3、输出结构、输出结构 2.3 CPLD的结构及其工作原理的结构及其工作原理 2.3 CPLD的结构及其工作原理的结构及其工作原理 1.逻辑阵列块逻辑阵列块LAB2.3 CPLD的结构及其工作原理的结构及其工作原理 2.宏
4、单元宏单元 三种时钟输入模式三种时钟输入模式(1)全局时钟信号。)全局时钟信号。(2)全局时钟信号由高电平有效的时钟信号使能。)全局时钟信号由高电平有效的时钟信号使能。(3)用乘积项实现一个阵列时钟。)用乘积项实现一个阵列时钟。2.3 CPLD的结构及其工作原理的结构及其工作原理 3.扩展乘积项扩展乘积项2.3 CPLD的结构及其工作原理的结构及其工作原理 4.可编程连线阵列可编程连线阵列PIA2.3 CPLD的结构及其工作原理的结构及其工作原理 5.I/O控制块控制块 2.4 FPGA的结构及其工作原理的结构及其工作原理 2.4.1 查找表逻辑结构查找表逻辑结构 2.4 FPGA的结构及其工
5、作原理的结构及其工作原理 2.4.1 查找表逻辑结构查找表逻辑结构 2.4.2 Cyclone III系列器件的结构与系列器件的结构与原理原理 2.4.2 Cyclone III系列器件的结构与原理系列器件的结构与原理 2.4.2 Cyclone III系列器件的结构与原理系列器件的结构与原理 2.4.2 Cyclone III系列器件的结构与原理系列器件的结构与原理 2.4.2 Cyclone III系列器件的结构与原理系列器件的结构与原理 2.4 FPGA的结构及其工作原理的结构及其工作原理 2.4.2 Cyclone III系列器件的结构与原理系列器件的结构与原理 2.4 FPGA的结构
6、及其工作原理的结构及其工作原理 2.4.2 Cyclone III系列器件的结构与原理系列器件的结构与原理 2.4 FPGA的结构及其工作原理的结构及其工作原理 2.4.2 Cyclone III系列器件的结构与原理系列器件的结构与原理 2.4 FPGA的结构及其工作原理的结构及其工作原理 2.4.2 Cyclone III系列器件的结构与原理系列器件的结构与原理 2.5 硬件测试硬件测试 2.5.1 内部逻辑测试内部逻辑测试 2.5.2 JTAG边界扫描测试边界扫描测试 2.5 硬件测试硬件测试 2.5.2 JTAG边界扫描测试边界扫描测试 2.5 硬件测试硬件测试 2.5.2 JTAG边界
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