最新八路抢答器设计仿真课程设计.pdf
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1、 八 路 抢 答 器 设 计 仿 真 课 程 设 计 精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除 谢谢-23-课 程 设 计 题 目 八路抢答器设计控制电路 学 院 专 业 班 级 姓 名 指导教师 精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除 谢谢-2-课程设计任务书 题 目:八路抢答器设计控制电路 初始条件:根据自己的设计题目内容,写出已知或者已经具备的条件 要求完成的主要任务:(包括课程设计工作量及其技术要求,以及说明书撰写等具体要求)1.完成本题目的理论设计,相关参数符号设计目的 2.对理论设计方案进行实物测试或仿真分析,并与理论结果进行对比
2、3.完成不少于 20 页的设计报告,详细说明理论设计过程以及测试/仿真分析结果 时间安排:7.5:理论设计 7.6 7.7:安装调试或仿真 7.8:撰写报告 7.9:答辩 指导教师签名:系主任签名:精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除 谢谢-2-摘 要 74 系列常用集成电路设计的八路数显抢答器的电路主要由五部分组成:数字抢答电路、译码显示电路、可预置时间的定时电路、报警电路以及秒脉冲产生电路。其中数字抢答电路包括了编码电路和锁存电路,实现了对信号编码和锁存的功能,防止二次抢答的问题;译码显示电路能将抢答到的选手编号直观地显示出来;在定时电路中,主持人可通过时间预设
3、开关预设供抢答的时间,且系统将完成自动倒计时;报警电路则起到声报警功能,当在规定的时间内无人抢答时,系统中的蜂鸣器将发出警报声,提示主持人本轮抢答无效,实现报警功能;秒脉冲产生电路用于为定时电路提供一个频率为 1Hz 的标准时钟信号。该抢答器不仅具有智能化的特点,同时采用数字式显示显得很直观,使得运用范围较广且很方便。关键词:抢答器 编码 锁存 精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除 谢谢-23-Abstract 74 series common integrated circuit design of the circuit responder eight-way
4、digital consists mainly of five parts:the digital circuit,decoding display circuit vies to answer first,preset time timing circuit,alarm circuit and the second pulse circuits.Digital circuits including coding responder circuit and latch circuit,signal encoding and latch on the function,prevent secon
5、dary vies to answer first problem;Decode display circuit can be the contestant vies to answer first shown visually Numbers,In the timing circuits,host by default for the preset switch time vies to answer first the time,and the system will be the countdown,Alarm circuit does sound alarm functions,whe
6、n within the prescribed time no contest,the system will send alerts,buzzer this contest null and void,host alarm functions,Second pulse circuits for timing circuit provides a standard for 1Hz frequency clock signal.This contest is not only has the characteristics of intelligent digital display appea
7、r very intuitive by using a wider range,and very convenient.Keywords:vies to answer first editor coding latch 精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除 谢谢-23-目 录 课程设计任务书.-1-摘 要.-2-Abstract.-3-1.1 基于单片机 AT89S52的抢答器硬件设计.-6-1.1.1硬件部分设计原理.-6-1.1.2 软件部分设计原理.-6-1.1.3 优缺点.-6-1.2 基于 FPGA 的抢答器硬件设计.-6-1.2.1设计原理.-6-1.2
8、.2优缺点.-7-1.3 基于 74 系列集成电路的抢答器设计.-7-1.3.1设计原理.-7-1.3.2优缺点.-8-1.4 单元电路设计.-8-1.4.1抢答电路设计.-8-1.4.2定时电路设计.-9-1.4.3报警电路设计.-10-1.4.4时序控制电路设计.-10-1.5 整体电路设计及工作原理.-11-1.6 主要参数计算.-12-2 电路的仿真.-13-2.1 抢答电路的仿真.-13-抢答电路的仿真如图 8 所示:.-13-2.2 定时电路的仿真.-13-2.3 脉冲发生电路的仿真.-14-2.4 报警电路的仿真.-16-3 性能测试数据.-17-3.1 抢答电路.-17-3.2
9、 定时电路.-17-3.3 脉冲发生电路.-17-3.4 报警电路.-17-3.5 综合分析.-17-精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除 谢谢-23-4 主要芯片参数.-18-4.1 74LS192 引脚排列及功能表.18 4.2 74LS279 引脚排列.18 4.3 74LS48 引脚排列及功能表.18 4.4 74LS148 引脚排列及功能表.-19-4.5 555 定时器引脚排列.-20-5 心得体会.-21-阎石.数字电子计数基础.高等教育出版社,1998.-22-附录-元件清单.-23-精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除
10、谢谢-23-1 原理电路的设计 1.1 基于单片机 AT89S52的抢答器硬件设计 1.1.1 硬件部分设计原理 AT89S52 的各引脚功能情况为:P1 口(P1.0 P1.7)8 个引脚,P1.7 为最高位,P1.0 为最低位。在 AT89S52 不带片外存储器时,P1 口可作为通用 I/O 口使用,P1.0 P1.7 用于传送 CPU 的输入/输出数据。这时输出数据可以得到锁存,不需外接专用锁存器。输入数据可以得到缓冲,增加了数据输入的可靠性;P37 引脚外接电阻、放大管以及扬声器;RST 复位线,外接电容、电阻。使 AT89S52 处于复位工作状态;TXD:串行口数据发送;RXD:串行
11、口数据接收;XMT1 和 XMT2外接石英晶体和微调电容,为片内振荡电路输入线,用来连接 AT89S52 片内 OSC的定时反馈网络;INT0/INT1:外部中断 0/1 输入;T/C1、T/C0:定时器/计数器 I/O 的外部输入。1.1.2 软件部分设计原理 根据本文的电路求出要显示不同路数的数字所需的编码,将它们存在一个表中待用时取出。8 路抢答输入信号由 8 个按键控制,程序一直判断是否有按键按下,若没有按键按下则循环判断;直到有按键按下后,立即把通过按键输入的信号储存起来然后对 8 路输入信号进行逐位扫描判断,最后根据扫描结果转入查表程序取数并通过数码管显示输出结果,同时发光二极管亮
12、起,表示抢答成功。1.1.3 优缺点 使用单片机设计抢答器,成本低,易控制,但硬件设计和软件编程比较复杂,我们尚不具备此项技能。1.2 基于 FPGA 的抢答器硬件设计 1.2.1 设计原理 精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除 谢谢-23-抢答器结构简图如图 1 所示:1、FPGA 最小系统电路:FPGA 正常工作时的基本电路,由时钟和复位电路组成。2、键盘输入电路:用 3 3 矩阵键盘组成 3 个组共 9 个人的抢答按钮。同时包括Start,Add,Sub 三个由主持人控制的单独按钮。3、显示模块:用移位寄存器 74HC164 驱动 4 位共阴数码管显示;数码管
13、要显示的数据通过 74HC164 串行数据端口输入。4、报警及相关信息显示:蜂鸣器电路和 LED 灯显示相关状态信息指示电路。1.2.2 优缺点 使用 FPGA 设计抢答器使电路高度集成,运行速度快。但成本较高,编程复杂。1.3 基于 74 系列集成电路的抢答器设计 1.3.1 设计原理 总体方框图如图 2 所示:精品好文档,推荐学习交流 仅供学习与交流,如有侵权请联系网站删除 谢谢-23-图 2 抢答器原理框图 电路分为主体电路和拓展电路。主体电路完成基本强大功能,即开始抢答当选手按抢答按钮时,能显示选手的编号,同时能封锁输入电路。拓展电路完成定时抢答功能。1.3.2 优缺点 该电路设计较为
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