数字电路实验报告-触发器.docx
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1、数电试验五触发器实验报告班级: 学号: 姓名:一、试验目的1、掌型基本RS、D. JK触发器的展理及应用,2、掌握D数据锁存器的原理及应用,3掌握Muti sin仿真软件的使用二、试验仪器及器件74L. S00四2输入与非门 74LS20 二4输入与非门 74LS74 双D正沿触发器 74LS76 双JK触发器 74LS75 四位D数据锁存器 蜂鸣器、三极管及电阻若干三、实验原理及操作技能触发器是一个具有记忆功能的,具有两个稳定状态的信息存储器件,是构成多种时序 电路的最基本逻辑单元,也是数字逻辑电路中一种重要的单元电路。在数字系统和计算机中有着广泛的应用。触发器具有两个稳定状态,即“0“和“
2、1“,在一 定的外界信号作用下,可以从一个稳定状态翻转到另一个稳定状态。触发器有集成触发器和门电路组成的触发器。触发方式有电平触发和边沿触发两种。D触发器在时钟脉冲CP的前沿(正跳变0一1)发生翻转,触发器的次态取决于CP 的脉冲上升沿到来之前D端的状态,即次态=D。因此,它具有置0、置1两种功能。由于 在CP=1期间电路具有维持阻塞作用,所以在CP=1期间,D端的数据状态变化,不会 影响触发器的输出状态。D触发器应用很广,可用做数字信号的寄存,移位寄存,分频和波形发生器等。1.触发器是构成时序逻辑电路中存储电路的基本单元,其状态可以自行保 持0状态1状态,所以能够记忆和存贮一位二值信息。正是
3、由于触发器这种记忆 功能,使它成为数字系统中的基本记忆单元。按照触发器实现的逻辑功能不 同,将触发器分为RS触发器、D触发器、JK触发器和T触发器等几种。RS触发器在CP有效电平或边沿时,按照输入信号S、R的状态改变状态。S为 1时置1, R为1时清0, S、R同时无效为0时,触发器状态不变,S、R不能同时有 效为高电平。JK触发器是在CP有效电平或边沿时,按照输入J、K的状态改变 状态,J为1时置1, K为1时清0, J、K均为0时,保持状态不变,均为1时,触 发器状态必翻。D触发器在有效电平或边沿到来时,将D端的数据锁存保持。74LS74包含两个D触发器,均为上升沿触发。2.74S75外引
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