上拉电阻与下拉电阻简介通信电子电子设计_通信电子-电子设计.pdf
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1、上拉电阻:1、当 TTL 电路驱动 COMS 电路时,如果 TTL 电路输出的高电平低于 COMS 电路的最低高电平(一般为 3.5V,这时就需要在 TTL 的输出端接上拉电阻,以提高 输出高电平的值。2、OC 门电路必须加上拉电阻,才能使用。3、为加大输出引脚的驱动能力,有的单片机管脚上也常使用上拉电阻。4、在 COMS 芯片上,为了防止静电造成损坏,不用的管脚不能悬空,一般接上拉 电阻产生降低 输入阻抗,提供泄荷通路。5、芯片的管脚加上拉电阻来提高输出电平,从而提高芯片输入信号的噪声容限 增强抗干扰能 力。6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电磁干扰。7、长线传输中电
2、阻不匹配容易引起反射波干扰,加上下拉电阻是电阻匹配,有效 的抑制反射 波干扰。上拉电阻阻值的选择原则包括:1、从节约功耗及芯片的灌电流能力考虑应当足够大;电阻大,电流小。2、从确保足够的驱动电流考虑应当足够小;电阻小,电流大。3、对于高速电路,过大的上拉电阻可能边沿变平缓。综合考虑 以上三点,通常在 1k 到 10k 之间选取。对下拉电阻也有类似道理 对上拉电阻和下拉电阻的选择应结合开关管特性和下级电路的输入特性进行设 定,主要需要考 虑以下几个因素:1.驱动能力与功耗的平衡。以上拉电阻为例,一般地说,上拉电阻越小,驱动能力 越强,但 功耗越大,设计是应注意两者之间的均衡。2.下级电路的驱动需
3、求。同样以上拉电阻为例,当输出高电平时,开关管断开,上 拉电阻应 适当选择以能够向下级电路提供足够的电流。3.高低电平的设定。不同电路的高低电平的门槛电平会有不同,电阻应适当设 定以确保能输 出正确的电平。以上拉电阻为例,当输出低电平时,开关管导通,上拉电 阻和开关管导通电阻 分压值应确保在零电平门槛之下。4.频率特性。以上拉电阻为例,上拉电阻和开关管漏源级之间的电容和下级电 路之间的输入 电容会形成 RC 延迟,电阻越大,延迟越大。上拉电阻的设定应考虑电 路在这方面的需求。下拉电阻的设定的原则和上拉电阻是一样的。OC 门输出高电平时是一个高阻态,其上拉电流要由上拉电阻来提供,设输入端 每端口
4、不大于 100uA,设输出口驱动电流约 500uA,标准工作电压是 5V,输入口的高 低电平门限为0.8V(低于此值为低电平;2V(高电平门限值。选上拉电阻时:500uA x 8.4K=4.2即选大于 8.4K 时输出端能下拉至 0.8V 以下,此为最小阻值,再小就拉不 下来了。如果输出口驱动电流较大,则阻值可减小,保证下拉时能低于 0.8V 即可。当输出高电平时,忽略管子的漏电流,两输入口需 200uA 200uA x15K=3V 即上拉电阻压降为 3V,输出口可达到 2V,此阻值为最大阻值,再大就拉不到 2V 了。选 10K 可用。COMS 门的可参考 74HC 系列 设计时管子的漏电流不
5、可忽略,IO 口实际电流在不同电平下也是不同的,上述 仅仅是原理,一句话概括为:输出高电平时要喂饱后面的输入口,输出低电平不要把 阻以提高输出高电平的值门电路必须加上拉电阻才能使用为加大输出引脚的驱动能力有的单片机管脚上也常使用上拉电阻在芯片上为了防止静电造成损坏不用的管脚不能悬空一般接上拉电阻产生降低输入阻抗提供泄荷通路芯片的管悬空就比较容易接受外界的电磁干扰长线传输中电阻不匹配容易引起反射波干扰加上下拉电阻是电阻匹配有效的抑制反射波干扰上拉电阻阻值的选择原则包括从节约功耗及芯片的灌电流能力考虑应当够大电阻大电流小从确保够的驱选取对下拉电阻也有类似道理对上拉电阻和下拉电阻的选择应结合开关管特
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