硬件EMC设计规范精计算机存储计算机计算机硬件与维护.pdf

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1、硬件 EMC 设计规范(精)1/10 硬件 EMC 设计规范 引言:本规范只简绍 EMC 的主要原则与结论,为硬件工程师们在开发设计中抛砖引玉。电磁干扰的三要素是干扰源、干扰传输途径、干扰接收器。EMC 就围绕这些 问题进行研究。最基本的干扰抑制技术是屏蔽、滤波、接地。它们主要用来切断干扰的传输途径。广义的电磁兼容控制技术包括抑制干扰源的发射和提高干扰接收器的敏感度,但已延伸到其他学科领域。本规范重点在单板的 EMC 设计上,附带一些必须的 EMC 知识与法则。在印制 电路板设计阶段对电磁兼容考虑将减少电路在样机中发生电磁干扰。问题的种类包括公共阻抗耦合、串扰、高频载流导线产生的辐射和通过由互

2、连布线和印制线形成的回路拾取噪声等。在高速逻辑电路里,这类问题特别脆弱,原因很多:1、电源与地线的阻抗随频率增加而增加,公共阻抗耦合的发生比较频繁;2、信号频率较高,通过寄生电容耦合到步线较有效,串扰发生更容易;3、信号回路尺寸与时钟频率与其谐波的波长相比拟,辐射更加显著。4、引起信号线路反射的阻抗不匹配问题。一、总体概念与考虑 硬件 EMC 设计规范(精)2/10 1、五一五规则,即时钟频率到 5MHz 或脉冲上升时间小于 5ns,则 PCB 板须 采用多层板。2、不同电源平面不能重叠。3、公共阻抗耦合问题。模型:Z S1 Z L1 Z S2 Z L2 I1 I2 Z G I1+I2 V N

3、1,2 V S1 V S2 yf-f4-06-cjy 扰的三要素是干扰源干扰传输途径干扰接收器就围绕这些问题进行研究最基本的干扰抑制技术是屏蔽滤波接地它们主要用来切断干扰的传输途径广义的电磁兼容控制技术包括抑制干扰源的发射和提高干扰接收器的敏感度但已延伸到少电路在样机中发电磁干扰问题的种类包括公共阻抗耦合串扰高频载流导线产的辐射和通过由互连布线和印制线形成的回路拾取噪声等在高速逻辑电路里这类问题特别脆弱原因很多电源与地线的阻抗随频率增加而增加公共阻抗耦合相比拟辐射更加显著引起信号线路反射的阻抗不匹配问题一总体概念与考虑硬件设计规范精五一五规则即时钟频率到或脉冲上升时间小于则板须采用多层板不同电

4、源平面不能重叠公共阻抗耦合问题模型硬件设计规范精为电源流经地硬件 EMC 设计规范(精)3/10 V N1=I2Z G 为电源 I2 流经地平面阻抗 Z G 而在 1 号电路感应的噪声电压。由于地平面电流可能由多个源产生,感应噪声可能高过模电的灵敏度或数电 的抗扰度。解决办法:模拟与数字电路应有各自的回路,最后单点接地;电源线与回线越宽越好;缩短印制线长度;电源分配系统去耦。4、减小环路面积与两环路的交链面积。5、一个重要思想是:PCB 上的 EMC 主要取决于直流电源线的 Z 0 C,好的滤波,L0,减小发射与敏感。Z0=L/C=377(d/w(r/r,如果 模型:屏蔽效能 SE(dB=反射

5、损耗 R(dB+吸收损耗 A(dB 高频射频屏蔽的关键是反射,吸收是低频磁场屏蔽的关键机理。入射 反射 发射 屏蔽材料 吸收区域 中继/低速低频数字 I/O 逻辑电路 时钟 低频模拟 I/O 带状电缆连接器 扰的三要素是干扰源干扰传输途径干扰接收器就围绕这些问题进行研究最基本的干扰抑制技术是屏蔽滤波接地它们主要用来切断干扰的传输途径广义的电磁兼容控制技术包括抑制干扰源的发射和提高干扰接收器的敏感度但已延伸到少电路在样机中发电磁干扰问题的种类包括公共阻抗耦合串扰高频载流导线产的辐射和通过由互连布线和印制线形成的回路拾取噪声等在高速逻辑电路里这类问题特别脆弱原因很多电源与地线的阻抗随频率增加而增加

6、公共阻抗耦合相比拟辐射更加显著引起信号线路反射的阻抗不匹配问题一总体概念与考虑硬件设计规范精五一五规则即时钟频率到或脉冲上升时间小于则板须采用多层板不同电源平面不能重叠公共阻抗耦合问题模型硬件设计规范精为电源流经地硬件 EMC 设计规范(精)6/10 摸-数转换器 数-模转换器 存储器 yf-f4-06-cjy 2、工作频率低于 1MHz 时,噪声一般由电场或磁场引起,(磁场引起时干扰,一般在几百赫兹以内,1MHz 以上,考虑电磁干扰。单板上的屏蔽实体 包括变压器、传感器、放大器、DC/DC 模块等。更大的涉与单板间、子 架、机架的屏蔽。3、静电屏蔽不要求屏蔽体是封闭的,只要求高电导率材料和接

7、地两点。电磁屏蔽不要求接地,但要求感应电流在上有通路,故必须闭合。磁屏蔽 要求高磁导率的材料做封闭的屏蔽体,为了让涡流产生的磁通和干扰产 生的磁通相消达到吸收的目的,对材料有厚度的要求。高频情况下,三 者可以统一,即用高电导率材料(如铜封闭并接地。4、对低频,高电导率的材料吸收衰减少,对磁场屏蔽效果不好,需采用高磁导率的材料(如镀锌铁。5、磁场屏蔽还取决于厚度、几何形状、孔洞的最大线性尺寸。6、磁耦合感应的噪声电压 U N=jwB.A.coso=jwM.I1,(A 为电路 2 闭合环路时面积;B 为磁通密度;M 为互感;I1 为干扰电路的电流。降低噪声电压,有两个途径,对接收电路而言,B、A

8、和 COS0 必须减小;对干扰源而言,M 和 I1 必须减小。双绞线是个很好例子。它大大减小电路的环路面积,扰的三要素是干扰源干扰传输途径干扰接收器就围绕这些问题进行研究最基本的干扰抑制技术是屏蔽滤波接地它们主要用来切断干扰的传输途径广义的电磁兼容控制技术包括抑制干扰源的发射和提高干扰接收器的敏感度但已延伸到少电路在样机中发电磁干扰问题的种类包括公共阻抗耦合串扰高频载流导线产的辐射和通过由互连布线和印制线形成的回路拾取噪声等在高速逻辑电路里这类问题特别脆弱原因很多电源与地线的阻抗随频率增加而增加公共阻抗耦合相比拟辐射更加显著引起信号线路反射的阻抗不匹配问题一总体概念与考虑硬件设计规范精五一五规

9、则即时钟频率到或脉冲上升时间小于则板须采用多层板不同电源平面不能重叠公共阻抗耦合问题模型硬件设计规范精为电源流经地硬件 EMC 设计规范(精)7/10 并同时在绞合的另一根芯线上产生相反的电动势。7、防止电磁泄露的经验公式:缝隙尺寸 min/20。好的电缆屏蔽层覆视率应为 70%以上。五、接地 1、300KHz 以下一般单点接地,以上多点接地,混合接地频率范围 50KHz 10MHz。另一种分法是:0.05单点接地;0.05多点接地。2、好的接地方式:树形接地 3、信号电路屏蔽罩的接地。电源地信号地 多点接地。多级电路的接地选择 告近低电平端并按信号由小到 大逐步移动的原则。单点接地 yf-f

10、4-06-cjy 接地点选在放大器等输出端的地线上。4、对电缆屏蔽层,L 0.15时,一般均在输出端单点接地。L0.15时,则采用多点接地,一般屏蔽层按 0.05 或 0.1 间隔接地。混合接地时,一端屏蔽层接地,一端通过电容接地。5、对于射频电路接地,要求接地线尽量要短或者根本不用接线而实现接地。最好的接地线是扁平铜编织带。当地线长度是/4 波长的奇数倍时,扰的三要素是干扰源干扰传输途径干扰接收器就围绕这些问题进行研究最基本的干扰抑制技术是屏蔽滤波接地它们主要用来切断干扰的传输途径广义的电磁兼容控制技术包括抑制干扰源的发射和提高干扰接收器的敏感度但已延伸到少电路在样机中发电磁干扰问题的种类包

11、括公共阻抗耦合串扰高频载流导线产的辐射和通过由互连布线和印制线形成的回路拾取噪声等在高速逻辑电路里这类问题特别脆弱原因很多电源与地线的阻抗随频率增加而增加公共阻抗耦合相比拟辐射更加显著引起信号线路反射的阻抗不匹配问题一总体概念与考虑硬件设计规范精五一五规则即时钟频率到或脉冲上升时间小于则板须采用多层板不同电源平面不能重叠公共阻抗耦合问题模型硬件设计规范精为电源流经地硬件 EMC 设计规范(精)8/10 阻抗会很高,同时相当/4 天线,向外辐射干扰信号。6、单板内数字地、模拟地有多个,只允许提供一个共地点。7、接地还包括当用导线作电源回线、搭接等内容。六、滤波 1、选择 EMI 信号滤波器滤除导

12、线上工作不需要的高频干扰成份,解决高频 电磁辐射与接收干扰。它要保证良好接地。分线路板安装滤波器、贯通 滤波器、连接器滤波器。从电路形式分,有单电容型、单电感型、L 型、型。型滤波器通带到阻带的过渡性能最好,最能保证工作信号质量。一个典型信号的频谱:2 1 3 T 0.1A t r 0.5A 扰的三要素是干扰源干扰传输途径干扰接收器就围绕这些问题进行研究最基本的干扰抑制技术是屏蔽滤波接地它们主要用来切断干扰的传输途径广义的电磁兼容控制技术包括抑制干扰源的发射和提高干扰接收器的敏感度但已延伸到少电路在样机中发电磁干扰问题的种类包括公共阻抗耦合串扰高频载流导线产的辐射和通过由互连布线和印制线形成的

13、回路拾取噪声等在高速逻辑电路里这类问题特别脆弱原因很多电源与地线的阻抗随频率增加而增加公共阻抗耦合相比拟辐射更加显著引起信号线路反射的阻抗不匹配问题一总体概念与考虑硬件设计规范精五一五规则即时钟频率到或脉冲上升时间小于则板须采用多层板不同电源平面不能重叠公共阻抗耦合问题模型硬件设计规范精为电源流经地硬件 EMC 设计规范(精)9/10 0.9A A 傅里叶变换 yf-f4-06-cjy 2、选择交直流电源滤波器抑制内外电源线上的传导和辐射干扰,既防止EMI 进入电网,危害其它电路,又保护设备自身。它不衰减工频功率。DM(差 摸干扰在频率 1MHz 时,占主导地位。3、使用铁氧体磁珠安装在元件的

14、引线上,用作高频电路的去耦,滤波以与 寄生振荡的抑制。4、尽可能对芯片的电源去耦(1-100nF,对进入板极的直流电源与稳压器和 DC/DC 转换器的输出进行滤波(uF。CminIt/Vmax Vmax 一般取 2%的干扰电平。注意减小电容引线电感,提高谐振频率,高频应用时甚至可以采取四芯电容。电容的选取是非常讲究的问题,也是单板 EMC 控制的手段。七、其它 单板的干扰抑制涉与的面很广,从传输线的阻抗匹配到元器件的 EMC 控制,扰的三要素是干扰源干扰传输途径干扰接收器就围绕这些问题进行研究最基本的干扰抑制技术是屏蔽滤波接地它们主要用来切断干扰的传输途径广义的电磁兼容控制技术包括抑制干扰源的

15、发射和提高干扰接收器的敏感度但已延伸到少电路在样机中发电磁干扰问题的种类包括公共阻抗耦合串扰高频载流导线产的辐射和通过由互连布线和印制线形成的回路拾取噪声等在高速逻辑电路里这类问题特别脆弱原因很多电源与地线的阻抗随频率增加而增加公共阻抗耦合相比拟辐射更加显著引起信号线路反射的阻抗不匹配问题一总体概念与考虑硬件设计规范精五一五规则即时钟频率到或脉冲上升时间小于则板须采用多层板不同电源平面不能重叠公共阻抗耦合问题模型硬件设计规范精为电源流经地硬件 EMC 设计规范(精)10/10 从生产工艺到扎线方法,从编码技术到软件抗干扰等。一个机器的孕育与诞生实际上是 EMC 工程。最主要需要工程师们设计中注

16、入 EMC 意识。_ 扰的三要素是干扰源干扰传输途径干扰接收器就围绕这些问题进行研究最基本的干扰抑制技术是屏蔽滤波接地它们主要用来切断干扰的传输途径广义的电磁兼容控制技术包括抑制干扰源的发射和提高干扰接收器的敏感度但已延伸到少电路在样机中发电磁干扰问题的种类包括公共阻抗耦合串扰高频载流导线产的辐射和通过由互连布线和印制线形成的回路拾取噪声等在高速逻辑电路里这类问题特别脆弱原因很多电源与地线的阻抗随频率增加而增加公共阻抗耦合相比拟辐射更加显著引起信号线路反射的阻抗不匹配问题一总体概念与考虑硬件设计规范精五一五规则即时钟频率到或脉冲上升时间小于则板须采用多层板不同电源平面不能重叠公共阻抗耦合问题模型硬件设计规范精为电源流经地