[精选]PCI AGP PCIE关键测点.pptx
( 4.5 )《[精选]PCI AGP PCIE关键测点.pptx》由会员分享，可在线阅读，更多相关《[精选]PCI AGP PCIE关键测点.pptx（31页珍藏版）》请在淘文阁 - 分享文档赚钱的网站上搜索。
1、vPCIvPCI总线信号定义在介绍PCI总线信号之前，有两个名称需要解释：主设备和从设备。按照PCI总线协议，总线上所有引发PCI传输事务的实体都是主设备，但凡响应传输事务的实体都是从设备，从设备又称为目标设备。主设备应具备处理能力，能对总线进行控制，即当一个设备作为主设备时，它就是一个总线主控器。1信号类型说明在PCI总线标准中对信号类型作了规定。下面的类型是从设备连接在PCI总线上的每一台设备角度定义的，而不是从仲裁器和中央资源信号角度定义的。in：表示标准输入信号。out：表示标准输出信号。ts：表示双向的三态信号。sts：表示持续的且低电平有效的三态信号，该信号在某一时刻只能属于一个主
2、设备并被其驱动，它从有效变为浮空高阻状态之前必须保证使其具有至少一个时钟周期的高电平状态，另一主设备要想驱动它，至少要等待该信号的原有驱动者将其释放变为三态一个时钟周期之后才能开始。od：表示漏极开路，以线或的形式允许多个设备共同驱动和分享。vPCI总线信号描述1系统信号1CLKin：PCI系统总线时钟对于所有的PCI设备该信号均为输入，其频率最高可达33MHz，最低频率一般为0HzDc。除RST#、INTA#、INTB#、INTC#及INTD#之外，所有其他PCI信号都在CLK的上升沿有效或采样。2RST#in：复位信号用于复位总线上的接口逻辑，并使PCI专用的存放器、序列器和有关信号复位到
3、指定的状态。该信号低电平有效，在它的作用下PCI总线的所有输出信号处于高阻状态，SERR#被浮空v2地址与数据信号v1AD3100ts：地址数据多路复用信号这是一组信号，双向三态，为地址和数据公用。在FRAME#有效低电平时，表示地址相位开始，该组信号线上传送的是32位物理地址；对于IO端口，这是一个字节地址；对于配置空间或存储器空间，是双字地址。在数据传送相位，该组信号线上传送数据信号，AD70为最低字节数据，而AD3124为最高字节数据。当IRDY#有效时，表示写数据稳定有效，而TRDY#有效时，则表示读数据稳定有效。在：IRDY#和TRDY#都有效期间传送数据。v2CBE30#ts：总线
4、命令和字节允许复用信号双向三态信号。在地址相位中，这四条线上传输的是总线命令；在数据相位内，它们传输的是字节允许信号，说明整个数据相位中AD3100上哪些字节为有效数据，CBE0#CBE3#分别对应字节03。v3PARParitvts：奇偶校验信号双向三态。该信号用于对AD3100和cBE30上的信号进行奇偶校验，以保证数据的准确性。对于地址信号，在地址相位之后的一个时钟周期PAR稳定有效；对于数据信号，在IRDY#写操作或TRDY#读操作有效之后的一个时钟周期PAR稳定并有效，一旦PAR有效，它将保持到当前数据相位结束后一个时钟。在地址相位和写操作的数据相位，PAR由主设备驱动，而在读操作的
5、数据相位，则由从设备驱动。v3接口控制信号接口控制信号共有7个，对这些信号本身及相互间配合的理解是学习PCI总线的一个关键。v1FRAME#Framests：帧周期信号双向三态，低电平有效。该信号由当前主设备驱动，用来表示一个总线周期的开始和结束。该信号有效，表示总线传输操作开始，此时AD3l0和CBE30上传送的是有效地址和命令。只要该信号有效，总线传输就一直进行着。当FRAME#变为无效时，表示总线传输事务进入最后一个数据相位或该事务已经结束。v2IRDY#InitiatorReadysts：主设备准备就绪信号双向三态，低电平有效，由主设备驱动。该信号有效说明引起本次传输的设备为当前数据相
6、位做好了准备，但要与TRDY#配合，它们同时有效才能完成数据传输。在写周期，IRDY#表示AD310上数据有效；在读周期，该信号表示主控设备已准备好接收数据。如果IRDY#和TRDY#没有同时有效，则插入等待周期v3TRDY#TargetReadysts：从设备准备就绪信号。双向三态，低电平有效，由从设备驱动。该信号有效表示从设备已作好当前数据传输的准备工作，可以进行相应的数据传输。同样，该信号要与IRDY#配合使用，二者同时有效才能传输数据。在写周期内，该信号有效表示从设备已作好接收数据的准备；在读周期内，该信号有效表示有效数据已提交到AD310上。如果TRDY#和IRDY#没有同时有效，则
7、插入等待周期。v4STOP#stopsts：从设备请求主设备停止当前数据传输事务双向三态，低电平有效，由从设备驱动，用于请求总线主设备停止当前数据传送。v5LOCK#Locksts：锁定信号双向三态信号，低电平有效，由主设备驱动。PCI利用该信号提供一种互斥访问机制。该信号有效表示驱动它的设备对桥所进行的一个原子操作atomicoperation可能需要屡次传输才能完成，此期间该桥路被独占，而非互斥性传输事务可以在未加锁的桥上进行。LOCK#有自己的协议，并和GNt#信号合作。即使有几个不同的设备在使用总线，但对LOCK#的控制权只属于某一个主设备。对主桥、PCI-T0-PCI桥以及扩展总线桥
8、的传输事务都可以加v6IDSEL#InitializationDeviceSelectin：初始化设备选择信号输入信号，高电平有效，在参数配置读写传输期间用作芯片选择片选。v7DEVSEL#DeviceSeleclsts：设备选择信号双向三态，低电平有效，由从设备驱动。当该信号由某个设备驱动时输出，表示所译码的地址属于该设备的地址范围；当作为输入信号时，可以判断总线上是否有设备被选中。v4仲裁信号主设备使用1REQ#Requestts：总线占用请求信号双向三态，低电平有效，由希望成为总线主控设备的设备驱动。它是一个点对点信号，并且每一个主控设备都有自己的REQ#。2GNT#Grantts：总线
9、占用允许信号双向三态，低电平有效。当该信号有效时表示总线占用请求被响应。这也是点对点信号，每个总线主控设备都有自己的GNT#。v5错误报告信号v1PERR#ParityErrorsts：数据奇偶校验错信号双向三态，低电平有效。当该信号有效，表示总线数据奇偶错，但该信号不报告特殊周期中的数据奇偶错。一个设备只有在响应设备选择信号DEVSEL#和完成数据相位之后，才能报告一个PERR#。对于每个数据接收设备，如果发现数据有错误，就应在数据收到后的两个时钟周期内将PERR#激活。该信号的持续时间与数据相位的多少有关。如果是一个数据相位，则最小持续时间为一个时钟周期；假设是一连串的数据相位且每个数据相
10、位都有错，那么，PERR#的持续时间将多于一个时钟周期。该信号是sts信号，和所有sts信号一样，在被释放到三态之前，必须为高电平并维持一个时钟周期。另外，对于数据奇偶错的报告既不能丧失也不能推迟。v2SERR#SystemErrorod：系统错误报告信号漏极开路信号，低电平有效。该信号用于报告地址奇偶错、数据奇偶错、命令错等可能引起灾难性后果的系统错误。SERR#信号一般接至微处理器的NMI引脚上，如果系统不希望产生非屏蔽中断，就应该采用其他方法来实现SERR#的报告。由于该信号是一个漏极开路信号，因此，发现错误的设备需将它驱动一个PCI时钟周期。SERR#信号的发出要与时钟同步，并满足所有
11、总线信号的建立和保持的时间需求。而SERR#恢复成无效由中央资源负责，此时需要进行微小的上拉值与上拉sts信号时相同并持续3个时钟周期。v6中断请求信号可选1INTx#Interruptod：中断请求信号漏极开路信号，电平触发，低电平有效。此类信号的建立与撤消与时钟不同步。对于单功能设备，只有一条中断线，而多功能设备最多可有四条中断线。在前一种情况下，只能使用INTA#，其他三条中断线没有意义。所谓多功能的设备是指将几仑相互独立的功能集中在一个设备中。PCI总线中共有四条中断请求线，分别是INTA#、INTB#、INTC#和INTD#，均为漏极开路信号，其中后三个只能用于多功能设备。一个多功能
12、设备上的任何功能都可对应于四条中断请求线中的任何一条，即各功能与中断请求线之间的对应关系是任意的，没有附加限制。二者的最终对应关系由中断引脚存放器定义，因而具有很大的灵活性。如果一个设备要实现一个中断，就定义为INTA#；要实现两个中断，则定义为INTA#和INTB#，其他情况依此类推。对于多功能设备，可以多个功能公用同一条中断请求线，或者各自占一条，或者是两种情况的组合；而单功能设备，只能使用一条中断请求线。v7高速缓冲支持信号为了使具有缓存功能的PCI存储器能够和通写式Write-through或回写式Write-back的Cache操作相配合，PCI总线设置了两个高速缓冲支持信号。1SB
- 配套讲稿：
如PPT文件的首页显示word图标，表示该PPT已包含配套word讲稿。双击word图标可打开word文档。
- 特殊限制：
部分文档作品中含有的国旗、国徽等图片，仅作为作品整体效果示例展示，禁止商用。设计者仅对作品中独创性部分享有著作权。
- 关 键 词：
- 精选 精选PCI AGP PCIE关键测点 PCI PCIE 关键
淘文阁 - 分享文档赚钱的网站所有资源均是用户自行上传分享，仅供网友学习交流，未经上传用户书面授权，请勿作他用。
限制150内